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パイプラインプロセッサの英語
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英訳・英語 pipeline processor
「パイプラインプロセッサ」を含む例文一覧
該当件数 : 21件
パイプラインプロセッサ例文帳に追加
PIPELINE PROCESSOR - 特許庁
パイプラインプロセッサ生成装置及びパイプラインプロセッサ生成方法並びにパイプラインプロセッサ例文帳に追加
PIPELINE PROCESSOR CREATING DEVICE AND METHOD, AND PIPELINE PROCESSOR - 特許庁
パイプラインプロセッサ及びマルチプロセッサコアのパイプライン制御方法例文帳に追加
PIPELINE PROCESSOR AND PIPELINE CONTROL METHOD FOR MULTIPROCESSOR CORE - 特許庁
多重化実行に対してスケーラブルなパイプラインプロセッサシステム例文帳に追加
PIPELINE PROCESSOR SYSTEM SCALABLE TO MULTIPLEX EXECUTION - 特許庁
パイプラインプロセッサシステムにおいて、多重化コストを削減する。例文帳に追加
To reduce costs for multiplexing in a pipeline processor system. - 特許庁
パイプラインプロセッサにおける電力有効処理メカニズム例文帳に追加
EFFICIENT POWER PROCESSING MECHANISM IN PIPELINE PROCESSOR - 特許庁
パイプラインプロセッサにおける命令データの転送メカニズム例文帳に追加
TRANSFER MECHANISM OF INSTRUCTION DATA IN PIPELINE PROCESSOR - 特許庁
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「パイプラインプロセッサ」を含む例文一覧
該当件数 : 21件
パイプラインプロセッサにおける制御空間への高速アクセスメカニズム例文帳に追加
MECHANISM FOR FAST ACCESS TO CONTROL SPACE OF PIPELINE PROCESSOR - 特許庁
パイプラインプロセッサにおける命令キャッシュブロックの無効化メカニズム例文帳に追加
MECHANISM FOR INVALIDATING INSTRUCTION CACHE BLOCK IN PIPE LINE PROCESSOR - 特許庁
パイプラインプロセッサにおいてコンテキストスイッチを不要とする。例文帳に追加
To dispense with a context switch in a pipe line processor. - 特許庁
多重化実行が可能な複数のパイプラインプロセッサ1a〜1eと、前記複数のパイプラインプロセッサの多重化度を適応的に変更する制御部3と、を備えていることを特徴とする多重化実行に対してスケーラブルなパイプラインプロセッサシステム。例文帳に追加
The pipeline processor system scalable to multiple execution includes: a plurality of pipeline processors 1a to 1e where multiplex execution is possible; and a control part 3 which adaptively changes the degree of multiplexing of the pipeline processors. - 特許庁
内部メモリ容量を増大させると共に、高速なハードウェアリソースを増加させながら、パイプライン処理のストール増加を防止し、システムLSIの仕様を満足させるパイプラインプロセッサ生成装置及びパイプラインプロセッサ生成方法並びにパイプラインプロセッサを提供する。例文帳に追加
To provide a pipeline processor creating device, a pipeline processor creating method and a pipeline processor capable of increasing the capacity of internal memory, preventing the increase of stalls in pipeline processing while increasing high-speed hardware resource, and satisfying specifications of a system LSI. - 特許庁
パイプラインプロセッサにおける命令データの効果的な転送メカニズムを提供する。例文帳に追加
To provide efficient transfer mechanism of instruction data in a pipeline processor. - 特許庁
効率的なパイプラインプロセッサ、マルチタスクプロセッサおよびリソースアクセス技術を提供する。例文帳に追加
To provide an efficient pipeline processor, multi-tasking processor, and resource access technique. - 特許庁
パイプラインプロセッサにおける電力の有効処理が可能なメカニズムを提供する。例文帳に追加
To provide a mechanism to enable an efficient processing of power in a pipeline processor. - 特許庁
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