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mCiとは 意味・読み方・使い方

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意味・対訳 軽度認知機能障害


研究社 英和コンピューター用語辞典での「mCi」の意味

MCI

【2】 MCI Communications Corp.米国長距離電話会社; 旧名 Microwave Communications Inc.; 1998 年に WorldCom 合併して MCI WorldCom, Inc.なった》.

「mCi」を含む例文一覧

該当件数 : 15



例文

METHOD FOR FORECASTING MCI OF MICROORGANISM AGAINST ANTIBACTERIAL AGENT例文帳に追加

抗菌剤に対する微生物のMICを予測する方法。 - 特許庁

Launched in 1995, the vBNS (very high-speed Backbone Network Service) is the product of a five-year cooperative agreement between MCI and the National Science Foundation.発音を聞く 例文帳に追加

1995年に始まったvBNS(超高速バックボーン・ネットワーク・サービス)は,MCIと全米科学財団の5年間の提携の産物である. - コンピューター用語辞典

To provide a structure of cutting drive circuit power supply in a power converter (MCI).例文帳に追加

電力変換装置(MCI)において駆動回路用電源を削減する構成を提供する。 - 特許庁

To provide a method for deciding or forecasting the MCI of microorganisms against an antibacterial agent rapidly without performing culture for a long time.例文帳に追加

抗菌剤に対する微生物のMICを、長時間の培養を行うことなく、迅速に決定または予測する方法を提供すること。 - 特許庁

To provide an MCI method by ME of a superposed block base and a frame rate conversion device using the method.例文帳に追加

重畳されたブロック基盤のMEによるMCI方法及びそれを適用したフレームレート変換装置を提供する。 - 特許庁

In nonvolatile memory cells (MC; MCO, MCI), a selection transistor (ST) is connected to a memory cell transistor (MT) in series.例文帳に追加

不揮発性メモリセル(MC;MC0,MC1)において、メモリセルトランジスタ(MT)と直列に選択トランジスタ(ST)を接続する。 - 特許庁

例文

A read circuit 12 and a write circuit 13 are provided for each of 16 memory cells MCi for composing one column.例文帳に追加

1カラムを構成する16個のメモリセルMCi毎に、読み出し回路12、及び書き込み回路13が設けられている。 - 特許庁

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マイクロソフト用語集での「mCi」の意味

MCI


JST科学技術用語日英対訳辞書での「mCi」の意味

MCI


MC‐I


Weblio英和対訳辞書での「mCi」の意味

MCI


MCI


MCI


MCI (電気通信事業者)

Weblio英和対訳辞書はプログラムで機械的に意味や英語表現を生成しているため、不適切な項目が含まれていることもあります。ご了承くださいませ。

「mCi」を含む例文一覧

該当件数 : 15



例文

The output from a transmission port TX1 of the microcomputer MCi (i=0 or 1) selected by a selection signal Se is outputted from an RD terminal of the mixing side connector CNx through changeover switches 15 and 12.例文帳に追加

そして、選択信号Seにより選択されたマイコンMCi(i=0又は1)の送信ポートTX1からの出力を、切替スイッチ15,12を介して混合側コネクタCNxのRD端子から出力する。 - 特許庁

Namely, the bank bit discriminating a memory bus is allocated to MCI, the bank bit discriminating a memory bus segment to CEI and the bank bit discriminating the bank on the single memory bus segment to DPI.例文帳に追加

すなわち、メモリ・バスを区別するバンク・ビットはMCIに、メモリ・バス・セグメントを区別するバンク・ビットはCEIに、単一メモリ・バス・セグメント上のバンクを区別するバンク・ビットはDPIにそれぞれ割り当てられる。 - 特許庁

Each of the memory cells MCi is connected between the bit lines BLn and BLnB, and composed of two access transistors T1 and T2, and two ferroelectric capacitors CF1 and CF2.例文帳に追加

メモリセル各々MCiはビットラインBLn,BLnBの間に連結されて2個のアクセストランジスタT1,T2及び2個の強誘電体キャパシタCF1,CF2で構成される。 - 特許庁

A pair of bit lines BL, /BL is divided for each of, for example, 16 memory cells MCi (i=0-15), and one column is composed for each pair of divided bit lines BBL, /BBL.例文帳に追加

ビット線対BL、/BLは、たとえば16個のメモリセルMCi(i=0〜15)毎に分割されており、この分割された分割ビット線対BBL、/BBL毎に1カラムを構成している。 - 特許庁

An optimum system in the memory interleaving systems of plural cache rows interleaving(MCI), cache effect interleaving(CEI) and DRAM page interleaving(DPI) is allocated to respective bank bits based on the number of bank bits.例文帳に追加

バンク・ビットの数に基づいて複数キャッシュ行インターリービング(MCI)、キャッシュ効果インターリービング(CEI)およびDRAMページ・インターリービング(DPI)というメモリ・インターリービング方式のいずれか最適方式を各バンク・ビットに割り当てる。 - 特許庁

When the operation mode is a normal mode, microcomputers MCi (i=0 and 1) detect a bit string (frame) conforming to the transmission format through reception ports RXk (k=0 and 1) and temporarily store reception data in buffers BFk in the case that the detected frame is normal.例文帳に追加

動作モードが通常モードの時にマイコンMCi(i=0,1)は、受信ポートRXk(k=0,1)を介して伝送フォーマットに一致するビット列(フレーム)を検出し、検出されたフレームが正常である場合には、その受信データを一旦バッファBFkに格納する。 - 特許庁

At this time, the microcomputer MCi sets a flash memory 24 to the writable state and successively writes data inputted through the reception port RX1 in the flash memory 24 and outputs the check result of written contents through the transmission port TX1.例文帳に追加

この時、マイコンMCiは、フラッシュメモリ24を書込可能な状態とし、受信ポートRX1を介して入力されるデータを、順次フラッシュメモリ24に書き込み、書込内容のチェック結果を送信ポートTX1を介して出力する。 - 特許庁

例文

A non-volatile DRAM includes two or more word lines WL1,..., WLi, at least one plate line PL, at least one pair of bit lines BLn and BLnB arranged so as to intersect the word lines WLi, and two or more memory cells MCi.例文帳に追加

本発明の不揮発性DRAM装置は、複数のワードラインWL1,...,WLiと、少なくとも一つのプレートラインPLと、ワードラインWLiと交差するように配列された少なくとも一対のビットラインBLn,BLnBと、そして複数のメモリセルMCiとを含む。 - 特許庁

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