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Weblio 辞書 > 英和辞典・和英辞典 > コンピューター用語 > n address instructionの意味・解説 

n address instructionとは

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主な意味nアドレス命令

コンピューター用語辞典での「n address instruction」の意味

n-address instruction



「n address instruction」の部分一致の例文検索結果

該当件数 : 7



例文

Whereby an operand field of the NOP instruction of n+1 address is agreed with an operand field of the instruction code of preceding n address, and the number of changed bit can be reduced even when the processing is transferred from the instruction of n address to the instruction of n+1 address.例文帳に追加

これによって、n+1番地のNOP命令のオペランドフィールドが、先行するn番地の命令コードのオペランドフィールドと一致し、n番地の命令からn+1番地の命令に処理が移る場合でも、変化するビット数を削減することができる。 - 特許庁

An operand [26:0] of NOP instruction of n+1 address is substituted by a bit string of operand field [26:0] (operand A) of an instruction code of preceding n address.例文帳に追加

n+1番地のNOP命令のオペランド[26:0]を、先行するn番地の命令コードのオペランドフィールド[26:0](オペランドA)のビット列に置換える。 - 特許庁

例文

When a loop instruction detector 105 detects a loop setting instruction, a relative address of a loop head address to a loop end address, which is limited to m-bit smaller than N-bit of an instruction address fetched from an instruction code, is stored in a highest-order hierarchy 109 of the stack register 103.例文帳に追加

ループ命令検出器105がループ設定命令を検出した場合、命令コードから取り出した、命令アドレスのNビットよりも小さいmビットに制限された、ループ終端アドレスに対するループ先頭アドレスの相対アドレスを、スタックレジスタ103の最上位階層109に格納する。 - 特許庁

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日英・英日専門用語辞書での「n address instruction」の意味

n address instruction

クロスランゲージ 37分野専門語辞書での「n address instruction」の意味

n address instruction

「n address instruction」の部分一致の例文検索結果

該当件数 : 7



例文

A projected address on the target processor forms the sum of an offset (D) that is greater than or equal to a first offset (D_1) of a base register-relative instruction and less than a difference (max-min), and contents of a base register (R) and projects the sum onto a cyclical address space with addresses having a length of n bits.例文帳に追加

目標プロセッサ上の投影されたアドレスは、ベースレジスタ相対命令の第1のオフセット(D_1)以上であり、差(max−min)未満のオフセット(D)及びベースレジスタ(R)の内容の和を形成し、nビットの長さを有するアドレスで巡回アドレス空間に和を投影する。 - 特許庁

An L/I selector 3 selects either output of the linear arithmetic register 1 or output of the interleave arithmetic register 2 according to the instruction of an L/I selecting signal and inputs the output, as a burst address arithmetic variable N, into a linear burst address generating circuit 100 and an interleave burst address generating circuit 200.例文帳に追加

L/Iセレクタ3は、L/I選択信号の指示に従って、リニア演算レジスタ1の出力、インターリーブ演算レジスタ2の出力のいずれかを選択し、バーストアドレス演算変数Nとして、リニア用バーストアドレス発生回路100およびインターリーブ用バーストアドレス発生回路200へ入力する。 - 特許庁

例文

Since the device incapable of reading a correct device address among the devices 2 to n due to the error in the setting of its own device address or the failure of a device address setting switches 22 to n2 can not execute an instruction based on the lamp turning-off command outputted from the device 1, the lamp of the device is turned on as it is.例文帳に追加

全ての被電源制御装置2〜nのうち自装置の装置アドレスの設定に誤りがあるかあるいは装置アドレス設定用のスイッチ22〜n2部分が故障して、正しい装置アドレスが読み出せなくなった被電源制御装置2〜nは、電源制御装置1からのランプ消灯コマンドによる指示を実行できないため、ランプが点灯したままとなる。 - 特許庁

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