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sequential logicとは 意味・読み方・使い方
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意味・対訳 順序回路（じゅんじょかいろ、sequential circuit）とは、ディジタル回路において外部からの入力信号と記憶されている内部状態（記憶回路）との組み合わせによって出力状態が決定される回路である。
「sequential logic」の部分一致の例文検索結果
該当件数 : 31件
A control section 101 calculates an error rate of the logic circuit from the value obtained by subtracting the number of errors of the sequential circuit where the logic block of the logic block group 120 is bypassed, from the number of errors of the logic block and the sequential circuit of the logic block group 120.例文帳に追加
制御部１０１は、論理ブロック群１２０の論理ブロック及び順序回路のエラー数から、論理ブロック群１２０の論理ブロックを迂回した順序回路のエラー数を差し引いた値から、論理回路のエラー率を算出する。 - 特許庁
SIGNAL PROCESSOR, RECONFIGURABLE LOGIC CIRCUIT DEVICE AND RECONFIGURABLE SEQUENTIAL CIRCUIT例文帳に追加
信号処理装置及び再構成可能論理回路装置及び再構成可能順序回路 - 特許庁
Output terminals present in an unchanged logic circuit and a changed logic circuit in common and the output signals of the sequential circuit are compared with one another for every event.例文帳に追加
変更前後の論理回路に共通に存在する出力端子と順序回路の出力信号をすべての事象毎に比較する。 - 特許庁
To provide a sequential circuit and a logic synthesis circuit capable of surely reducing power consumption without shifting synchronous timing.例文帳に追加
同期のタイミングをずらすことなく、消費電力を確実に削減可能な順序回路および論理合成装置を提供する。 - 特許庁
A medium access logic accesses a sequential access storage medium related to a drive according to a second protocol.例文帳に追加
媒体アクセス論理は、第２のプロトコルに従って、ドライブに関連付けられるシーケンシャルアクセス記憶媒体にアクセスする。 - 特許庁
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ウィキペディア英語版での「sequential logic」の意味 |
Sequential logic
出典:『Wikipedia』 (2011/04/09 14:34 UTC 版)
「sequential logic」の部分一致の例文検索結果
該当件数 : 31件
A measurement means 3 measures a signal value to be input to the sequential circuit by changing the logic of the extracted domain signal.例文帳に追加
測定手段３は、抽出されたドメインの信号の論理を変化させて順序回路に入力される信号値を測定する。 - 特許庁
When it is decided that no unprocessed branch instruction is included, the priority order logic 41 selects the sequential take-out addresses.例文帳に追加
この選択信号は、複数の目標アドレスのうちの１つまたは順次アドレスをメモリ要求アドレスとして選択するのに使用される。 - 特許庁
A sequence logic sets each PWM signal by a sequential order based on a master clock signal.例文帳に追加
シーケンスロジックは、各ＰＷＭ信号をマスタークロック信号に基づいてシーケンス順序にセットする。 - 特許庁
An operation part 3 including a key input part 4 and a display part 5 comprises a hardwired logic sequential circuit.例文帳に追加
キー入力部４と表示部５のある操作部３を、ハードワイヤードロジックの順序回路で構成する。 - 特許庁
A logic block group 120 having at least one set of a logic block having at least one logic circuit and a sequential circuit that receives the output of the logic block is arranged in an irradiation region 110 of a high-energy particle irradiation device, and subjected to irradiation with high-energy particles.例文帳に追加
少なくとも一つの論理回路を有する論理ブロックと、当該論理ブロックの出力を入力する順序回路と、の組を少なくとも一つ以上有する論理ブロック群１２０を高エネルギー粒子照射装置の照射領域１１０に配置して、高エネルギー粒子を照射する。 - 特許庁
By providing a sequential logic circuit for each component and changing the status of the sequential logic circuit using either the components layered in the previous step or control data sent from the control element, the status of a component subject to control is set to a status for accepting selections made by the control element.例文帳に追加
各構成要素に順序論理回路を設け、前段に積層された構成要素、或いは制御要素から送信された制御データにより順序論理回路の状態を変更することにより、制御対象の構成要素の状態を制御要素による選択を受け付ける状態に設定する。 - 特許庁
STATE ASSIGNMENT OPTIMIZATION DEVICE FOR SYNCHRONOUS SEQUENTIAL CIRCUIT, STATE ASSIGNMENT OPTIMIZATION METHOD FOR SYNCHRONOUS SEQUENTIAL CIRCUIT, LOGIC COMPOUNDING DEVICE, PROGRAM AND READABLE RECORDING MEDIUM例文帳に追加
同期式順序回路の状態割当て最適化装置、同期式順序回路の状態割当て最適化方法、論理合成装置、プログラム、および可読記録媒体 - 特許庁
To provide a method and device for creating test patterns for a logic circuit capable of shortening the lengths of the test patterns created by an ATPG system for a sequential circuit and an ATPG system for a sequential circuit.例文帳に追加
本発明は、順序回路用ＡＴＰＧシステム及び組み合わせ回路用ＡＴＰＧシステムが生成するテストパタン長を短縮できる論理回路のテストパタン生成方法及び装置を提供することを課題とする。 - 特許庁
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