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書込みイネーブルの英語

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電気・電子用語集での「書込みイネーブル」の英訳

書込みイネーブル



「書込みイネーブル」の部分一致の例文検索結果

該当件数 : 17



例文

第一の書込みアドレスカウンタであるWカウンタ2は書込みイネーブル信号WEN1と書込みクロックWCLKとを基に実際の書込みアドレスWAD1を生成する。例文帳に追加

A W counter 2 which is a first write address counter generates an actual write address WAD1 based on write enable signals WEN1 and a write clock WCLK. - 特許庁

第二の書込みアドレスカウンタであるWカウンタ4は遅延回路3で一定時間遅延された書込みイネーブル信号WEN2と書込みクロックWCLKとを基に実際の書込みアドレスWAD1に対して一定時間の遅延を持った書込みアドレスWAD2を生成する。例文帳に追加

The W counter 4 which is a second write address counter generates a write address WAD2 provided with the delay of fixed time to the actual write address WAD1 based on the write enable signals WEN2 delayed for the fixed time in a delay circuit 3 and the write clock WCLK. - 特許庁

RAM13はマッピング用データ及びイネーブル信号にしたがって、出力データの書込み及び読出しを行う。例文帳に追加

The RAM 13 performs write and read of output data in accordance with the data for mapping and the enable signal. - 特許庁

本発明においては、外部装置に対して、このメモリへの書込みイネーブル信号DWを出力することとした。例文帳に追加

In this invention, a write-enable signal DW to this memory is to be outputted to an external device. - 特許庁

書込制御部40は、RAM90へ書込みを行なうための書込イネーブル信号WEXを活性化/非活性化する。例文帳に追加

A write control part 40 either activates or deactivates a write enable signal WEX for implementing writing in a RAM 90. - 特許庁

応答信号ACKが書込み制御停止を通知する内容である場合、ライトイネーブル信号WEの出力が停止される。例文帳に追加

When a response signal ACK is contents to notify write control stop, the output of the write enable signal WE is stopped. - 特許庁

例文

書込み保護回路は、第1制御信号に応答してイネーブルされるか、またはディセーブルされ、イネーブルされる時、ローアドレス信号、第2ストローブ信号、及び第2制御信号に応答してマスキング制御信号を出力する。例文帳に追加

The write protection circuit is enabled or disabled responding to a first control signal, and when enabled, it outputs a masking control signal responding to a row address signal, a second strobe signal, and a second control signal. - 特許庁

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「書込みイネーブル」の部分一致の例文検索結果

該当件数 : 17



例文

後置書込みバッファ12は、アドレス・バッファ27,データ・バッファ29,第1のクロック・タイミング信号,第2のクロック・タイミング信号,アドレス・デコーダ24,書込みイネーブル回路31で構成される。例文帳に追加

A post-write buffer 12 is composed of an address buffer 27, a data buffer 29, first and second clock timing signals, an address decoder 24 and a write enable circuit 31. - 特許庁

書込みイネーブル信号DWは、図8(a)に示すように、最後のサブフィールドSF4の書込み期間Trが終了した後にHレベル(書込み許可状態)になるから、現サブフィールドおよび次のサブフィールドの何れにも悪影響を与えることなく階調データを更新することができる。例文帳に追加

Since the write-enable signal DW becomes H-level (write-enable state) as shown in Fig. 8 (a) after the write period Tr of the final sub-field SF4 has ended, the gradation data can be updated without influencing any of the present sub-field and the next sub-field. - 特許庁

書込みイネーブル回路31は、2つのクロック信号を同期させて、宛先レジスタがいつデータ・バッファ29からデータを受けることが可能になるかを決定する。例文帳に追加

The write enable circuit 31 synchronizes two clock signals and determines when the destination register can receive the data from the data buffer 29. - 特許庁

二重サンプリング除外回路は更に、デュアルポートRAMといったメモリエレメントへの書込みイネーブルラインをディアサートすることによってより大きいインクリメントの一部として既に計数されているコードを「除外」する。例文帳に追加

The duplicate sample removal circuit also "removes" those codes that have already been counted as part of a larger increment by de-asserting a write enable line to a memory element such as a dual port RAM. - 特許庁

1次セキュリティ・セクション214の内容は、保護レジスタのビット7(ブロックプロテクト)がイネーブル(ゼロにセット)されると、読取り不可で書込み不可にされる。例文帳に追加

When the bit 7 (block protection) of the protective register is enabled (set to zero), the contents of a primary security section 214 made non-readable and non-writable. - 特許庁

シリアルインタフェースに必要なシリアルイネーブル、シリアルクロック、シリアルデータのタイミングを制御するシリアル出力パターンを書込み可能なメモリ(42)に展開し、メモリ(42)をインクリメントして、シリアル出力パターンを順次出力し、シリアルインタフェースに必要なシリアルイネーブル、シリアルクロック、シリアルデータのタイミングを制御する。例文帳に追加

Serial output patterns for controlling the timing of serial enabling, serial clocks and serial data which are necessary for the serial interface are developed in a writable memory (42), the contents of the memory (42) are increased and the serial output patterns are successively outputted to control the timing of the serial enabling, the serial clocks and the serial data which are necessary for the serial interface. - 特許庁

このようにして、アドレス・バスおよびデータ・バス上にアドレスおよびデータがそれぞれ用意されると、次にチップ・セレクト信号、次に書込み信号の順にイネーブルされ、その結果、対応するメモリのアドレスに、データ・バス上のデータが書き込まれる。例文帳に追加

Accordingly, when the address and data are prepared on an address bus and a data bus, a chip-select signal and next a write signal are enabled, and as a result, the data on the data bus are written in the address of the corresponding memory. - 特許庁

例文

ゲートドライバ5A〜5Nそれぞれへのイネーブル信号(VOE)を独立して制御し、ゲートドライバ5Aに対して、1フレーム期間内の任意のタイミングに黒信号書込みのためのスタートパルス(VSP)入力を行い、1フレーム期間内に黒画像を挿入する。例文帳に追加

An enable signal (VOE) to each of gate drivers 5A-5N is independently controlled, and a start pulse (VSP) input to write a black signal is performed at an arbitrary timing within one frame period with respect to the gate driver 5A to insert a black image within one frame period. - 特許庁

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