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2 1アドレスの英語
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英訳・英語 two plus one address; two-plus-one address
「2 1アドレス」の部分一致の例文検索結果
該当件数 : 883件
SIPアドレス変換装置２は、変換対象アドレスを抽出し、アドレス変換装置１に問い合わせる。例文帳に追加
The SIP address translator 2 extracts a conversion object address and inquires of the address translator 1. - 特許庁
メモリ管理ユニット（ＭＭＵ）１は、仮想アドレスバス２から仮想アドレスを入力し、物理アドレスバス３に物理アドレスを出力する。例文帳に追加
A memory management unit(MMU) 1 inputs a virtual address from a virtual address bus 2 and outputs a physical address to a physical address bus 3. - 特許庁
したがって、メイン電子機器ユニット１から出力されるアドレスが実アドレスであっても、上位４ビットのアドレスが固定のラッチアドレスであるアドレスであっても、拡張ユニット２は、そのメイン電子機器ユニット１の出力するアドレスに応じたアドレス信号を出力することができる。例文帳に追加
Then, even though an address outputted from a main electronic equipment unit 1 is a real address and even though a high-order 4-bit address is an address of a fixed latch address, an expansion unit 2 can output an address signal corresponding to an address outputted by the main electronic equipment unit 1. - 特許庁
SIPメッセージ検出時、アドレス変換装置１はSIPアドレス変換装置2にSIPメッセージを送信する。例文帳に追加
At the detection of an SIP message, the address translator 1 transmits the SIP message to the address translator 2. - 特許庁
SIPメッセージ検出時、アドレス変換装置１はSIPアドレス変換装置2にSIPメッセージを送信する。例文帳に追加
The SIP address converter 2 extracts a conversion target address and then inquires it to the address converter 1. - 特許庁
仮想有効アドレスビット抽出部１は、上記抽出した仮想アドレスのビットのうちから、有効アドレスビット指定部２にて設定された有効アドレスビットを抽出し、該抽出した有効アドレスビットを実アドレスとして実アドレステーブル３に格納する。例文帳に追加
The extraction part 1 extracts the valid address bit set by the designation part 2 from the bits of the extracted virtual address, and stores the extracted valid address bit as an actual address in an actual address table 3. - 特許庁
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「2 1アドレス」の部分一致の例文検索結果
該当件数 : 883件
アドレス供給回路１は、第１階層メモリ２に対して、９ビットの水平アドレスおよび垂直アドレスをアドレスとして供給するとともに、第２階層メモリ３に対して、水平アドレスまたは垂直アドレスそれぞれの最下位ビットを除く上位８ビットをアドレスとして供給する。例文帳に追加
An address supply circuit 1 supplies, as addresses, horizontal and vertical addresses of 9 bits to a first hierarchy memory 2 and supplies, as an address, high-order 8 bits except for the least significant bits of the horizontal address or vertical address to a second hierarchy memory 3. - 特許庁
アドレス論理回路(12,14)は、第1および第2のグループのアドレスエレメント(26a，26b)を含む。例文帳に追加
The address logic circuits (12, 14) comprises address elements (26a, 26b) of first and second groups. - 特許庁
これと同時に、この応答アドレスとＩＰアドレスを接続装置２へ通知する。例文帳に追加
At the same time, the network apparatus 1 notifies the response and IP addresses to a connection apparatus 2. - 特許庁
ＣＰＵ２からメモリ１にアクセスする際にアドレス変換装置３によりアドレス変換が行われる。例文帳に追加
When a CPU 2 accesses the memory 1, an address converting device 3 performs address conversion. - 特許庁
アドレス変換器２は画質設定信号に応じてアドレス発生器１が発生するアドレスを変換して係数記憶部３に供給する。例文帳に追加
An address converter 2 converts the address generated by the address generator 1 according to an image quality setting signal and supplies the result to a coefficient storage part 3. - 特許庁
SIPアドレス変換装置２は、アドレス変換装置１の変換情報を活用してSIPメッセージに含まれるIPアドレスを変換する。例文帳に追加
By effectively utilizing the conversion information of the address conversion device 1, the SIP address conversion device 2 converts an IP address included in the IP message. - 特許庁
SIPアドレス変換装置２は、変換対象アドレスを抽出し、アドレス変換装置１に問い合わせる。例文帳に追加
The SIP address conversion device 2 extracts a conversion target address and makes an inquiry to the address conversion device 1. - 特許庁
SIPアドレス変換装置２は、変換対象アドレスを抽出し、アドレス変換装置１に問い合わせる。例文帳に追加
The SIP address converter 2 converts an IP address contained in the SIP message using conversion information of the address converter 1. - 特許庁
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