「Address Line」を含む例文一覧(1108)

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  • In the browser, type in an address in the Address Line 1, Address Line 2 and City State & Zip text fields and click Validate.
    ブラウザで、Address Line 1、Address Line 2、および City State Zip テキストフィールドの住所を入力して「Validate」をクリックします。 - NetBeans
  • ROW ADDRESS DECODE-LINE CIRCUIT
    ロウアドレスデコードライン回路 - 特許庁
  • TESTING METHOD FOR ADDRESS LINE
    アドレス線のテスト方法 - 特許庁
  • The word line address is the X address.
    ワード線アドレスはＸアドレスである。 - 特許庁
  • A line address generating circuit 145 generates the address of the Y data in the line.
    ラインアドレス発生回路１４５は、ライン内のＹデータのアドレスを発生する。 - 特許庁
  • A transfer source address line 2 for instructing a data transfer source address and a transfer destination address line 3 for instructing a data transfer destination address are provided as an address line.
    アドレス線として、データの転送元アドレスを指示するための転送元アドレス線２と、データの転送先アドレスを指示するための転送先アドレス線３とを設ける。 - 特許庁
  • Component line 2 has an EMAIL type-definition (meaning an email address).
    二行目は EMAIL 型(email アドレス) の定義です。 - PEAR
  • METHOD AND DEVICE FOR TESTING ADDRESS LINE
    アドレス線の試験方法及び試験装置 - 特許庁
  • A comparator 23 compares a previous line address bit previously stored in an address latch 25, with a line address bit of the present address stored in the present address latch 19.
    比較器２３は、以前アドレスラッチ２５に記憶された前の行アドレスビットを現在アドレスラッチ１９に記憶された現在アドレスの行アドレスビットと比較する。 - 特許庁
  • SIGNAL LINE DRIVING DEVICE, ADDRESS DECODER AND MEMORY
    信号線駆動装置、アドレスデコーダ及びメモリ - 特許庁
  • For example, when one of address line is cut off, a value of the address line is made always to be 0.
    例えば、アドレスラインの１本が断線していれば、そのアドレスラインの値は常に０となる。 - 特許庁
  • The current line (address) in the buffer.
    l -tag -width indentt .バッファ中の現在行を表します。 - JM
  • The file name and line number for each address is printed on a separate line.
    各アドレスに対応してこのペアが行ごとに表示される。 - JM
  • LINE ADDRESSING An address represents the number of a line in the buffer.
    lh 行指定行は、バッファ内の行番号で表現されます。 - JM
  • +1)newlinePrints the addressed line, and sets the current address to that line.
    そして、現在行番号を表示した行のものに設定します。 - JM
  • A line maximum value register 31a stores the maximum value of the line address.
    行最大値レジスタ３１ａは、行アドレスの最大値を記憶する。 - 特許庁
  • This was my address until two days ago, when I started standing in line.
    2日前の住所よ... 並んで手に入れたわ - 映画・海外ドラマ英語字幕翻訳辞書
  • Component line 1 has an ADR type-definition (meaning a delivery address).
    一行目は ADR 型(連絡先の住所) の定義です。 - PEAR
  • A line selecting register 16 (holds an address specifying a line buffer) is added.
    ライン選択レジスタ１６（ラインバッファを特定するアドレスを保持）が付加される。 - 特許庁
  • This circuit allows electric charges to pass between an address line and a 1st discharge line 30 when the address line has a potential lower than the potential of the 1st discharge line and between the address line and a 2nd discharge line when the address line has a potential higher than the potential of the 2nd discharge line.
    この回路は、アドレスラインが第１放電ラインの電位より低い電位にあるときにアドレスラインと第１放電ライン３０との間において電荷の通過を、アドレスラインが第２放電ラインの電位より高い電位にあるときにアドレスラインと第２放電ライン３２との間における電荷の通過を許容する。 - 特許庁
  • A CPU 102 inputs an address through an address line 103 to the memory 101.
    ＣＰＵ１０２は、アドレス線１０３を介してメモリ１０１にアドレスを入力する。 - 特許庁
  • The bit line address is a function of the Y and Z addresses.
    ビット線アドレスは、Ｙ及びＺアドレスの関数である。 - 特許庁
  • ELECTRONIC DISK UNIT AND ITS ADDRESS LINE FAULT DETECTING METHOD
    電子ディスク装置とそのアドレス線故障検出方法 - 特許庁
  • Thereafter the value of the line fail counter is written in an allotted address, corresponding to a line address of the fail count memory 113.
    その後、行フェイルカウンタの値を、フェイルカウントメモリ１１３の行アドレスに対応し、割り当てられたアドレスに書き込む。 - 特許庁
  • (. )aAppends text to the buffer after the addressed line, which may be the address 0 (zero).
    l -tag -width indentt (.)a指定した行の後にテキストを追加します。 - JM
  • The line address circuit generates the line address of M (M: an integer of 2 or more) bits corresponding to n1 and outputs a line lead address of the M bits offset in response to a frame address of k bits being an offset value.
    ラインアドレス回路は、ｎ１に応じたＭ（Ｍは２以上の整数）ビットのラインアドレスを発生、オフセット値であるｋビットのフレームアドレスに応じてオフセットされたＭビットのラインリードアドレスを出力する。 - 特許庁
  • Using the address line, a bank selection address and an in-bank address are input to different periods.
    ここでアドレス線を用いて、バンク選択アドレスと、バンク内アドレスとをそれぞれ互いに異なる期間に入力する。 - 特許庁
  • The nonvolatile memory 20 is connected to the memory controller 10 by an address line, a data line and a control line.
    さらに、不揮発性メモリ２０とメモリコントローラ１０をアドレス線とデータ線と制御線によって接続する。 - 特許庁
  • Different data is written for an address making an address line 1 and an address making it 0, but data is written in the same address in the RAM.
    そのアドレスラインを１とするアドレスと０とするアドレスに対して異なるデータを書き込むが、ＲＡＭでは同じアドレスにデータが書き込まれる。 - 特許庁
  • The current address is set to the resultant line.
    現在行番号は、置き換えられた行に設定されます。 - JM
  • The camera 2 detects whether the address on the address line 3 is coincident with its own peculiar address and when these addresses are coincident, a video signal is outputted to the video line 4.
    カメラ２は、アドレスライン３上のアドレスと自己の固有アドレスとが一致するかを検出し、一致するとビデオライン４に映像信号を出力する。 - 特許庁
  • A DMA control part 9 makes the DMA address of a reference line of a data buffer (storage means) 8 follow the DMA address of an encoding line or makes the DMA address of the reference line of the data buffer 8 follow the DMA address of a decoding line.
    ＤＭＡ制御部９が、データバッファ（記憶手段）８の参照ラインのＤＭＡアドレスを符号化ラインのＤＭＡアドレスに追従させたり、データバッファ８の参照ラインのＤＭＡアドレスを復号化ラインのＤＭＡアドレスに追従させたりする。 - 特許庁
  • The address generation means properly changes a frame start address of an image frame, a burst transmission start address and a line start address according to a mirror image mode.
    アドレス発生手段はミラー画像モードに従って画像フレームのフレーム開始アドレス、バースト伝送開始アドレス、ライン開始アドレスを適切に変更する。 - 特許庁
  • SEMICONDUCTOR MEMORY DEVICE USING COMMON ADDRESS BUS LINE BETWEEN PLURAL ADDRESS BUFFERS AND COLUMN PRE- DECODER
    複数のアドレスバッファとカラムプリデコ—ダとの間で共通アドレスバスラインを利用する半導体メモリ素子 - 特許庁
  • The corresponding entry shows translation from the valid address into the actual address with respect to the cache line.
    対応するエントリは、有効アドレスからキャッシュ・ラインに対する実アドレスへの変換を表す。 - 特許庁
  • An address driver 200 applies a gate voltage to a first transistor 111 through an address line A.
    アドレスドライバ２００は、アドレスラインＡを介して第１トランジスタ１１１にゲート電圧を印加する。 - 特許庁
  • The current address is set to last line entered.
    現在行番号は、入力した最後の行に設定されます。 - JM
  • The current address is set to the last line moved.
    現在行番号は、移動された最後の行に設定されます。 - JM
  • The current address is set to the last line printed.
    現在行番号は、表示された最後の行に設定されます。 - JM
  • Zero- or One- address commands = Print the current line number.
    アドレスを 0 または 1 個とるコマンド=現在の行番号を表示する。 - JM
  • ADDRESS LINE WIRING STRUCTURE AND PRINTED WIRING BOARD HAVING THE SAME
    アドレス線配線構造及びこれを有するプリント配線基板 - 特許庁
  • A address name demarcating part 105 separates the word recognized by the word recognizing part 103 into an address character line and a name character line.
    住所名称切り分け部105は単語認識部103で認識された単語を住所文字列と名称文字列とに分離する。 - 特許庁
  • An adder 146 sums the line address generated by the line address generating circuit 145 and the address in the line generated by the Y pixel counter 143 to generate an address for the Y data when they are written in the memory.
    加算器１４６は、ラインアドレス発生回路１４５により発生されたラインのアドレスと、Ｙピクセルカウンタ１４３により発生されたライン内のアドレスとを加算することにより、Ｙデータのメモリ内に書き込む際のアドレスを発生する。 - 特許庁
  • A DMA (Direct Memory Access) control device 1 receives an instruction of DMA data transfer, outputs the transfer source address to the transfer source address line 2, and outputs the data transfer destination address to the transfer destination address line 3.
    ＤＭＡ制御装置１は、ＤＭＡデータ転送の指示を受け、転送元アドレスを転送元アドレス線２に出力し、かつ、データ転送先アドレスを転送先アドレス線３に出力する。 - 特許庁
  • In this organic EL display device, when an address driver 2 selects an address line AL and the address line AL impresses a positive voltage to top gates of corresponding double-gate transistors 10, n-channels are formed in their semiconductor layers.
    アドレスドライバ２がアドレスラインＡＬを選択し、対応するダブルゲートトランジスタ１０のトップゲートに正電圧を印加すると、その半導体層内にｎチャネルが形成される。 - 特許庁
  • A redundant cell array block section is constituted identically with a main cell array block section, when a defect is caused in a column address line, a column address of the main cell array block is used as a substitute for the defective column address line.
    冗長セルアレイブロック部をメインセルアレイブロック部と同一に構成され、カラムアドレスラインに欠陥が発生した時、メインセルアレイブロックのカラムアドレスに代替して使用する。 - 特許庁
  • When the start address line is instructed by a start address instruction line 102a, a plurality of codes preparing part 123 collectively processes addresses from the line 102a to the start address number.
    そして、開始アドレス指示行１０２ａにより開始アドレス番号が指示されると、開始アドレス指示行１０２ａから開始アドレス番号までのアドレスを複数コード作成部１２３によりまとめて処理する。 - 特許庁
  • The control gate line address is a function of the X and Z addresses.
    コントロール・ゲート線アドレスは、Ｘ及びＺアドレスの関数である。 - 特許庁
  • Thereby, the entry line of the invalidation scheduled entry address is invalidated.
    これにより、無効化予定エントリアドレスのエントリのラインを無効化する。 - 特許庁
  • Setting a transfer mode is made by using part of an address signal line.
    転送モードの設定は、アドレス信号線の一部を用いて行う。 - 特許庁
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