「Bit Error Rate」を含む例文一覧(486)

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  • An error rate measurement circuit 28 measures a bit error rate(BER) from the output of the circuit 24 and applies this measurement result to a threshold control circuit 30.
    誤り率測定回路２８は、弁別回路２４の出力から符号誤り率（ＢＥＲ）を測定し、その測定結果を閾値制御回路３０に印加する。 - 特許庁
  • The line quality determining circuit 81 of a receiving circuit 12 issues BER alarm when a parity error occurs on a received digital signal after correction, and issues the BER (bit-error rate) before correction which is calculated from syndrome error pulse S4 exceeds a threshold value.
    受信回路１２の回線品質判定回路８１は誤り訂正後の受信デジタル信号にパリティエラーが発生し、かつシンドロームエラーパルスＳ４より計算された誤り訂正前のＢＥＲ(bit error rate)が閾値を超えた場合にＢＥＲアラームを発動する。 - 特許庁
  • The equalization method and device attains a bit error rate permissible for an overhead.
    等化の方法および装置は、比較的低いオーバーヘッドで許容可能なビット誤り率を達成する。 - 特許庁
  • To provide a VSB demodulator capable of controlling a bit error rate small.
    ビット誤り率を小さくするように調整することができるＶＳＢ復調装置を提供する。 - 特許庁
  • By the CDMA system and the canceling method, a BER (bit error rate) is reduced for increasing an S/N ratio.
    このシステムおよび方法はビット誤り率（ＢＥＲ）を低減して信号対雑音比を高める。 - 特許庁
  • The system and method decreases the bit-error rate (BER) and enhances the signal-to-noise ratio.
    このシステムおよび方法はビット誤り率（ＢＥＲ）を低減して信号対雑音比を高める。 - 特許庁
  • Here, the power p(i) is selected advantageously by applying a bit error rate minimization standard.
    累乗p(i)は、ビット誤り率最小化基準を適用することにより選ばれることが有利である。 - 特許庁
  • A comparator (35) compares the tuner performance, such as bit error rate (34), with a predetermined performance.
    比較器（３５）はビット誤り率（３４）のようなチューナ性能を予め決められた性能と比較する。 - 特許庁
  • PSK (Phase Shift Keying) shows good bit-error rate characteristics and makes multi-phase modulation available.
    PSK（位相偏移キーイング）は良好なビット誤り率特性を示し、多位相変調を可能にする。 - コンピューター用語辞典
  • To provide an error testing device in a TCM (time division direction control) interface which directly inserts an error bit into a main signal and can optionally set an error occurrence rate.
    主信号に直接エラービットを挿入し、エラー発生率を任意に設定できるＴＣＭインタフェースにおけるエラー試験装置を提供する。 - 特許庁
  • To provide a low cost bit error rate measuring instrument which shortens time required for auto search of a clock phase and is well balanced in terms of cost, regarding the bit error rate measuring instrument.
    本発明は、ビット誤り率測定器に関し、クロック位相のオートサーチに要する時間を短縮し、低コストのコストバランスのとれたビット誤り率測定器を提供することを目的としている。 - 特許庁
  • The computed error rate is compared with a threshold for predetermined bit position synchronism determination and if the computed error rate is higher, the transmitter notifies the receiver of that synchronism of bit positions is not established.
    計算した誤り率と所定のビット位置同期判定用のしきい値を比較し、計算された誤り率が高ければ、送信器は受信器へビット位置の同期が確立していないことを知らせる。 - 特許庁
  • To reduce the scale of the whole device by reducing the operation quantity and size of a bit error rate estimation operation circuit for estimating the bit error rate of a data signal in a receiving signal as much as possible.
    受信信号におけるデータ信号のビット誤り率の推定演算回路を極力、少演算量で且つ小型化することができ、これによって装置全体の規模を小型化すること。 - 特許庁
  • When the client communication apparatus 20 receives the data string, a gateway 22 obtains the error rate and the error variation of the error estimating bit data added to the data string, and selects an optimum error-correctable coding system, based on the error rate and the error variation.
    クライアント通信装置２０がこのデータ列を受信すると、ゲートウェイ２２は、データ列に付加された誤り推定ビットデータの誤り率と誤りのばらつきとを求め、誤り率と誤りのばらつきとに基づいて誤り訂正可能な最適な符号化方式を選択する。 - 特許庁
  • To provide a magnetic recording medium which can lower the occurrence ratio of a bit error (bit error rate) occurring in a drop-out and thermal asperity.
    本発明では、ドロップアウトやサーマルアスペリティに起因するビットエラーの発生比率（ビットエラーレート）を低くすることができる磁気記録媒体を提供することを課題とする。 - 特許庁
  • Since the comparison result of an appropriate bit can be used according to circumstances, the detection accuracy of the bit error rate can be improved.
    状況に応じて適したビットの比較結果を用いることができるので、ビット誤り率の検出精度を向上することができる。 - 特許庁
  • By cooperation between the GS decoding portion 50 and the turbo-decoding portion 60, the reliability is increased and the bit error rate of the information bit u is decreased.
    ＧＳ復号部５０とターボ復号部６０の連携により、信頼度が増加し、情報ビットｕのビット誤り率が低減する。 - 特許庁
  • The control means 36 is controlled in response to the detected bit error rate to select an inverse quantizer with a different inverse quantization bit number.
    検出されたビット誤り率に応じて、制御手段３６を制御し、逆量子化ビット数の異なる逆量子化器を選択する。 - 特許庁
  • The bit error rate can be reduced more in comparison with a conventional error correction device where the symbol stream subjected to the error correction is given to the de-randomizer 10 independently of whether or not the error correction is normally conducted.
    誤り訂正が正常に行なわれたか否かに関係なく、誤り訂正を行なったシンボル列をデ・ランダマイザ１０に与えていた従来に比べ、ビットエラー率が低くなる。 - 特許庁
  • To provide a signal interruption detection circuit capable of equalizing a bit error rate at the time of signal interruption detection regardless of a bit rate even in the case where signals of different bit rates are received in time division manner.
    異なるビットレートの信号を時分割で受信した場合においても、ビットレートに関係なく信号断検出時のビットエラーレートを等しくし得る信号断検出回路を提供する。 - 特許庁
  • To provide a measurement equipment which can simultaneously perform transmission delay time measurement and bit error rate measurement.
    測定器において、伝送遅延時間測定とビットエラーレート測定とを同時に行なえるようにする。 - 特許庁
  • A baud rate error detection circuit includes an edge detector, a start bit sampling circuit, and an abnormal waveform detection circuit.
    ボーレートエラー検出回路は、エッジディテクタと、スタートビットサンプリング回路と、異常波形検出回路とを備える。 - 特許庁
  • To lower an error rate about symbols with a repetition bit mapped thereto.
    ＲＥＰＥＴＩＴＩＯＮビットをマッピングしたシンボルについて誤り率を低下することを目的とする。 - 特許庁
  • APPARATUS AND ASSOCIATED METHOD FOR ESTIMATING BIT ERROR RATE OF COMMUNICATION DATA IN COMMUNICATION SYSTEM
    通信システムにおける通信データのビット誤り率を推定するための装置およびその関連方法 - 特許庁
  • DATA TRANSMISSION METHOD AND APPARATUS BETWEEN TIMING CONTROLLER AND SOURCE DRIVER WITH ADDITIONAL BIT ERROR RATE TEST FUNCTION
    ビットエラー率テスト機能が追加されたタイミングコントローラとソースドライバの間のデータ伝送方法及び装置 - 特許庁
  • To provide a modulation/demodulation system capable of minimizing bit error rate in six-phase phase modulation system.
    ６相位相変調方式においてビット誤り率を最小化可能な変復調システムを提供する。 - 特許庁
  • To provide a device and method for measurement of an error rate, capable of simply setting parameter values necessary in performing a bit error rate of a tested device or waveform measurement and display.
    被試験デバイスのビット誤り率や波形測定・表示を行う際に必要なパラメータ値設定を簡便に行える誤り率測定装置及び方法を提供する。 - 特許庁
  • The device obtains a partial integrated error rate by dividing the sum total of the number of bit errors with the sum total of the number of accesses by using contents of a set of the fixed number of error indexes.
    部分積分エラーレートは一定数のエラー指標の組から、ビットエラー数の総和をアクセス数の総和で除して得る。 - 特許庁
  • To improve a network bit error rate after error correction and decoding when impulsive noise is present in a wireless OFDM network.
    無線ＯＦＤＭネットワークにおいてインパルス性ノイズが存在する時、誤り補正及び復号後のネットワークビット誤り率を改善する。 - 特許庁
  • Data transmitted from a transmission node 1 are received by a reception node 1 and a bit error rate is measured by an error-correcting decoder 23.
    送信ノード１より送信されたデータは、受信ノード１により受信され、誤り訂正復号器２３でビットエラーレートが計測される。 - 特許庁
  • 3. Electronic computers or electronic assemblies thereof designed for a rate of error of less than 1/10 million per 1 bit per day from a single event error
    （三）　単事象障害によるエラー率が一日当たり一、〇〇〇万分の一毎ビット未満となるように設計したもの - 日本法令外国語訳データベースシステム
  • Writing and erasing errors to a data written block and data erased block, respectively, are detected in a bit unit in order of the physical block number by using firmware and the errors are totaled to calculate a BER (Bit Error Rate) of the flash memory.
    ファームウエアによって、物理ブロック番号順に、データ書込済のブロックに対してはその書込みエラーを、データ消去済ブロックに対してはその消去エラーを、それぞれｂｉｔ単位で検出し、それらを総計して当該フラッシュメモリのBER（Bit Error Rate）を算出する。 - 特許庁
  • To permit reading with a reduced BER (bit-error rate) without deterio rating the data transfer rate, even when BER is high.
    ビットエラーレート（ＢＥＲ）が高い場合であっても、データ転送レートを悪化させることなくＢＥＲを低下させた読出しを可能とする。 - 特許庁
  • A field strength detection section 46 detects a field strength of the signal received by the second receiving section 45, and a bit error rate measuring section 54 measures a bit error rate of the signal received by the second receiving section 45.
    電界強度検出部４６は、第２受信部４５によって受信された信号の電界強度を検出し、ビットエラーレート測定部５４は、第２受信部４５によって受信された信号のビットエラーレートを測定する。 - 特許庁
  • The range above is selected between a first value a little smaller than the bit error rate at which the decoded audio signal is discontinuous and a second value of the bit error rate at which the decoding of the audio signal is disabled.
    上記の範囲は、デコードされた前記音声信号が不連続になるビットエラーレートの値よりも若干小さい第１の値と、前記音声信号のデコードが不可能になるビットエラーレートの第２の値との間にされる。 - 特許庁
  • To provide a bit error rate measurement apparatus for mainly measuring a bit error rate of a plurality of kinds of patterns and reducing the cost through the reduction in the circuit scale.
    主として複数種類のパターンの符号誤り率を測定する符号誤り率測定装置において、回路規模を縮小することでコストの低減を図ることができる符号誤り率測定装置を提供する。 - 特許庁
  • A bit error rate signal generated by a bit error rate signal generating section 52 is transmitted to an attenuation section 41 by a transmission section 31, attenuated by the attenuation section 41, and then input to a coupling section 43.
    ビットエラーレート信号発生部５２によって発生させたビットエラーレート信号は、送信部３１によって減衰部４１に送信され、減衰部４１によって減衰された後、結合部４３に入力される。 - 特許庁
  • The terminal with a digital broadcast reception function is provided with an error rate detection unit 310 for detecting a bit error rate and a packet error rate before and after a decoder (FEC decoder) capable of correcting the error of a received signal and displays the reception sensitivity according to the result of the detection.
    デジタル放送受信機能を有する端末機において、受信信号のエラーを訂正可能なデコーダ（ＦＥＣデコーダ）前後のビットエラー率及びパケットエラー率を検出するエラー率検出部３１０を設け、その検出結果に従い受信感度を表示する。 - 特許庁
  • The bit error rate calculating section 30 is capable of switching which bit comparison result between an information bit rXi, reXi and a redundant bit rYij, reYij is to be used.
    このビット誤り率算出部３０は、ビット誤り率の算出に情報ビットｒＸｉ，ｒｅＸｉおよび冗長ビットｒＹｉｊ，ｒｅＹｉｊのうちどのビットの比較結果を用いるかを切り替えることができる。 - 特許庁
  • To provide a receiving circuit capable of improving a bit error by limiting a transmission bit rate and without increasing it.
    伝送ビットレートを制限し上昇させることなくビット誤りを改善することができる受信回路およびディジタル伝送システムを提供する。 - 特許庁
  • A demultiplexer 120 executes demultiplex processes on video signals received by the three antennas, and obtains three bit streams and an error rate for each bit stream.
    デマルチプレクサ１２０は、３つのアンテナが受信した映像信号に対してデマクス処理をし、３つのビットストリームと、各ビットストリームのエラー率を得る。 - 特許庁
  • To make the value of a bit error rate, at which an error floor phenomenon occurs, smaller by improving a distribution of the output distance of an internal code to the input distance.
    内符号の入力距離に対する出力距離分布を改善し、エラーフロア現象が生じるビットエラーレートの値をより低くする。 - 特許庁
  • A direction signal transmitting part 24 transmits a transfer rate control direction signal for directing adjustment of the transfer rate of the transmitting part 11 according to the measured bit error rate.
    指示信号送信部２４が、測定されたビット誤り率に応じて、送信部１１の転送速度の調節を指示する転送速度制御指示信号を送信する。 - 特許庁
  • To provide a bit error rate evaluation device which surely and automatically detects generation of communication abnormality within a short period of time.
    通信異常の発生を、短時間で確実に自動検出する、ビット誤り率評価装置を提供する。 - 特許庁
  • To reduce a bit error rate of a received QPSK signal by balancing an amplitude and a phase of the signal when it is received.
    ＱＰＳＫ信号の振幅および位相を受信時に平衡化して信号のビット誤り率を低下させる。 - 特許庁
  • To reduce a bit error rate of a signal by balancing an amplitude and a phase of a QPSK signal in receiving.
    ＱＰＳＫ信号の振幅および位相を受信時に平衡化して信号のビット誤り率を低下させる。 - 特許庁
  • A bit error rate performance is maintained, even in the case of a long-time delay where a diffusion channel exceeds 10 microseconds.
    拡散チャンネルが１０マイクロ秒を超える長時間遅延の場合でも、ビット誤り率性能は維持される。 - 特許庁
  • A change pattern judging part 74 judges a pattern in change of bit error rate for a plurality of unit time periods.
    さらに変化パターン判定部７４で、複数単位時間分のビット誤り率の変化のパターンを判定する。 - 特許庁
  • To reduce the bit error rate of a signal by equilibrating the amplitude and phase of QPSK signal upon receiving.
    ＱＰＳＫ信号の振幅および位相を受信時に平衡化して信号のビット誤り率を低下させる。 - 特許庁
  • Further, in the digital broadcast receiver disclosed herein, a relationship between the bit error rate and the sound volume has a hysteresis.
    また、本発明のデジタル放送受信機では、ビットエラーレートに対する音量の関係は、ヒステリシスを有している。 - 特許庁
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