「Memory System」を含む例文一覧(9226)

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  • To reduce circuit scale of a cache memory system having an associative memory device and a cache RAM block.
    連想記憶装置（ＣＡＭ）２４とキャッシュＲＡＭブロック２８をもつキャッシュメモリシステム２２の回路規模を小さくする。 - 特許庁
  • Only selected system programs of additional functionality are transferred from the nonvolatile memory to the volatile memory (S9, S10).
    選択された付加的機能のシステムプログラムのみを不揮発性メモリから揮発性メモリに転送する（Ｓ９，Ｓ１０）。 - 特許庁
  • An apparatus for performing bus tracing in a memory in a data processing system having a distributed memory comprises a bus tracing macro (BTM) module.
    分散型メモリを有するデータ処理システムにおいてメモリ内バストレーシングを行うための装置を開示する。 - 特許庁
  • COMPUTER IMPLEMENTATION METHOD, COMPUTER PROGRAM, AND SYSTEM FOR MEMORY USAGE QUERY GOVERNOR (MEMORY USAGE QUERY GOVERNOR)
    メモリ使用量照会ガバナのためのコンピュータ実装方法、コンピュータ・プログラム、およびシステム（メモリ使用量照会ガバナ） - 特許庁
  • To provide a low-power-consumption memory system allowing input/output operation of data of a memory with high accuracy.
    高い精度でメモリのデータの入出力動作を実施できる、低消費電力のメモリシステムを提供する。 - 特許庁
  • The memory access system includes first to fourth memories 10, 20, 30, 40 and a memory controller 1.
    本発明にかかるメモリアクセスシステムは、第１乃至第４のメモリ１０、２０、３０、４０と、メモリコントローラ１とを備える。 - 特許庁
  • DATA MANAGEMENT DEVICE, DATA MANAGEMENT METHOD, NONVOLATILE MEMORY, AND STORAGE DEVICE AND DATA PROCESSING SYSTEM HAVING NONVOLATILE MEMORY
    データ管理装置、データ管理方法、不揮発性メモリ、不揮発性メモリを有する記憶装置及びデータ処理システム - 特許庁
  • To provide a data protection system of a main memory capable of protecting data stored in a main memory from hang up.
    メイン・メモリに記憶されたデータをハングアップから保護することができるメイン・メモリのデータ保護システムを提供する。 - 特許庁
  • An active device 1 and a standby system device 2 are connected by a memory synchronization adapter 3 and a memory synchronization adapter 4.
    稼働系装置１と待機系装置２とをメモリ同期用アダプタ３とメモリ同期用アダプタ４とで結ぶ。 - 特許庁
  • The memory cell array in the semiconductor storage system is configured so that 3-bit information can be stored in one memory cell MC.
    メモリセルアレイは、１つのメモリセルＭＣ中に３ビットの情報を記憶することが可能に構成されている。 - 特許庁
  • The memory system includes: a controller for generating a control signal; and a primary memory for receiving the control signal from the controller.
    メモリシステムは、制御信号を生成するコントローラとコントローラから制御信号を受信するプライマリメモリを含む。 - 特許庁
  • This storage system comprises a cache memory, a side file as a storage region prepared in the memory, and a copy source storage device.
    ストレージシステムは、キャッシュメモリと、メモリに用意された記憶域であるサイドファイルと、コピー元記憶装置とを備える。 - 特許庁
  • This often means that the memory allocation is limited by the socket buffer limits, not by the system memory.
    多くの場合は、システムメモリが足りないわけではなく、ソケットバッファの大きさによるメモリ割り当ての制限である。 - JM
  • A memory system includes a plurality of nonvolatile memory cells MC connected electrically to a common word line WL.
    メモリシステムは、共通のワード線ＷＬに電気的に接続された複数の不揮発性メモリセルＭＣを有する。 - 特許庁
  • To provide a system and a method for determining a logic state of a memory cell in a magnetic tunnel junction (MTJ) memory device.
    磁気トンネル接合(MTJ)メモリデバイスにおけるメモリセルの論理状態を判定するためのシステムと方法の提供。 - 特許庁
  • The information processing apparatus 10 has a CPU 11, a main memory 12 (RAM), and the memory system 20.
    本発明に係る情報処理装置１０は、ＣＰＵ１１、メインメモリ１２（ＲＡＭ）およびメモリシステム２０を有する。 - 特許庁
  • To provide a memory management system and method which reduces the area occupied by a memory and improves performance.
    メモリの占有面積を減少すると共に性能を改善するメモリマネージメントシステム及び方法を提供する。 - 特許庁
  • To provide an information processing system capable of recognizing a U3 memory etc. by a simple method and accessing the recognized memory.
    簡易な方式でＵ３メモリ等を認識してアクセスすることが可能な情報処理システムを提供する。 - 特許庁
  • To provide a memory system in which no third party except a specified person is allowed to easily perform writing to a memory.
    特定の者を除いて第３者が容易にメモリへの書き込みができないメモリシステムを提供することである。 - 特許庁
  • To accurately measure a setup time and a hold time of a signal for a memory in a mixed memory system LSI.
    メモリ混載システムＬＳＩにおいて正確にメモリに対する信号のセットアップ時間およびホールド時間を測定する。 - 特許庁
  • METHOD AND SYSTEM FOR MONITORING FACILITY TO ACQUIRE DATA FROM NON-VOLATILE MEMORY AND VOLATILE MEMORY, AND MANUFACTURING PRODUCT
    不揮発性メモリ及び揮発性メモリからデータを取得するための設備監視システム、方法及び製造物品 - 特許庁
  • An on-demand server system includes a memory controller for adjusting access to a memory device of one or more of flash bases.
    オンデマンド・サーバ・システムは、１つ以上のフラッシュ・ベースのメモリ・デバイスへのアクセスを調整するメモリ・コントローラを含む。 - 特許庁
  • To provide a method for copying data between a plurality of memory cards without occupying a system bus and a main memory.
    システムバスとメインメモリとを占領することなく、複数のメモリカード間のデータをコピーする方法を提供する。 - 特許庁
  • A processor having a cache memory is connected through the bus mechanism with the transaction as a base with the memory system.
    キャッシュメモリを有するプロセッサがトランズアクションをベースとしたバスメカニズムを介してメモリシステムへ結合されている。 - 特許庁
  • To provide a semiconductor memory file system using semiconductor memories having constitution advantageous to the formation of a large scale memory.
    大容量化に有利な構成を有する半導体メモリを使用した半導体メモリファイルシステムを提供する。 - 特許庁
  • MEMORY RESOURCE ARRANGEMENT CONTROL METHOD FOR ARRANGING MEMORY RESOURCE IN VIRTUAL MACHINE ENVIRONMENT, VIRTUAL MACHINE SYSTEM, AND PROGRAM
    仮想マシン環境においてメモリ資源を配置するメモリ資源配置制御方法、仮想マシンシステム及びプログラム - 特許庁
  • A first part of a task 610 under execution is stored in a system memory 616 by direct memory access.
    実行中のタスク６１０の第１の部分は、ダイレクト・メモリ・アクセスによってシステムメモリ６１６に格納される。 - 特許庁
  • To prevent the deterioration of utilization efficiency of a memory while suppressing the deterioration of the through-put and response performance of a memory system.
    メモリシステムのスループット及び応答性能の低下を抑制しつつ、メモリの利用効率の悪化を防止する。 - 特許庁
  • To provide a memory system that makes it possible to increase the speed of external bus access by means of a memory controller using FIFO.
    ＦＩＦＯを用いたメモリコントローラにより外部バスアクセスの高速化を可能としたメモリシステムを提供する。 - 特許庁
  • A data processing system is provided with at least one of processors 4, 6, a main memory 18 and a cache memory 14.
    データ処理システムは、少なくとも１つのプロセッサ４、６と、メインメモリ１８と、キャッシュメモリ１４とを提供される。 - 特許庁
  • The system LSI 211 has an MCU 205 which is a memory access control means having an integrated memory interface to which at least two systems of an integrated memory A 210 and an integrated memory B 212 can be connected.
    システムＬＳＩ２１１は、少なくとも２系統の統合メモリＡ２１０，Ｂ２１２を接続可能な統合メモリインタフェースを備えるメモリアクセス制御手段であるＭＣＵ２０５を有する。 - 特許庁
  • For ODT control in the memory module system, only one pin from a memory controller of memory devices is used to transmit a command signal indicating one activated memory device.
    メモリモジュールシステム内のＯＤＴ制御において、メモリ装置のうちメモリ制御器から一つのピンのみが、活性化された一つのメモリ装置を示す命令信号を伝送するために使われる。 - 特許庁
  • To enable performing refreshing of a first memory during accessing a second memory in a system in which the first memory requiring refreshing and the second memory requiring no refreshing share one part of a bus.
    リフレッシュが必要な第１のメモリと、リフレッシュが不要な第２のメモリとがバスの一部を共有するシステムにおいて、第２のメモリアクセス中に第１のメモリのリフレッシュを実行可能にすること。 - 特許庁
  • To reduce the number of times nonvolatile memory is rewritten in a processor system where part of either main memory or cache memory includes nonvolatile memory such as PCM having a bit variable function.
    メインメモリまたはキャッシュメモリのどちらかの一部が、ビット可変機能を持つＰＣＭ等の不揮発性メモリから構成されるプロセッサシステムにおける不揮発性メモリの書き換え回数を削減する。 - 特許庁
  • Thus, the flash memory data storage apparatus of the present invention improves the data transfer rate between the flash memory and a buffer memory, resulting in remarkable advancement of the data transfer rate between the flash memory and the external system.
    よって、本発明のフラッシュメモリデータ記憶装置によれば、フラッシュメモリとバッファメモリ間の伝送速度が改善され、フラッシュメモリと外部システム間のデータ伝送速度が著しく改善される。 - 特許庁
  • The nonvolatile storage system 1 includes a reference cell 12 for main memory corresponding to a main memory cell array 10 and a reference cell 13 for spare memory corresponding to a spare memory cell array 11.
    不揮発性記憶システム１は、メインメモリセルアレイ１０に対応してメインメモリ用リファレンスセル１２が備えられ、スペアメモリセルアレイ１１に対応してスペアメモリ用リファレンスセル１３が備えられる。 - 特許庁
  • To provide a memory determination system, a memory determination method and a memory determination program for discriminating whether or not failure is caused by hardware without interrupting the operation of a memory.
    メモリの運用を中断することなく、ハードウェアに起因する障害であるかの判別を行うことのできるメモリ判定システム、メモリ判定方法およびメモリ判定プログラムを得ること。 - 特許庁
  • To provide a control method for a flash memory for detecting data which is rewritten by an illegal means, and also to provide a memory controller, and a flash memory system equipped with the memory controller.
    データが不正な手段により書き換られたことを検出できるフラッシュメモリの制御方法、メモリコントローラ及び当該メモリコントローラを備えるフラッシュメモリシステムを提供することを目的とする。 - 特許庁
  • To provide a nonvolatile memory device, a memory controller, an operation methods thereof, an operation method of a memory system, and a wear-leveling method, in which deterioration of a memory cell can be accurately detected.
    メモリセルの劣化度を正確に検出することができる不揮発性メモリ装置及びメモリコントローラとこれらの動作方法、メモリシステムの動作方法、並びにウェアレベリング方法を提供する。 - 特許庁
  • To provide a memory sharing method, a program and a memory sharing system, through which a memory can be shared by arranging a variable number group common to a plurality of objects in the same memory arrangement.
    複数のオブジェクト間で共通する変数群を同一メモリ配置としてメモリを共有させることができるメモリ共有方法、プログラム、メモリ共有化システムを提供する。 - 特許庁
  • To provide a memory controller capable of rapidly and efficiently transferring data between itself and a flash memory, and to provide a flash memory system comprising the memory controller.
    本発明は、フラッシュメモリとの間でのデータの転送を迅速、効率的にすることが可能なメモリコントローラ、及び当該メモリコントローラを備えるフラッシュメモリシステムを提供することを目的とする。 - 特許庁
  • To provide a memory controller, a flash memory system with the memory controller, and to provide a method of controlling the flash memory, capable of updating efficiently a data, while restraining a substantial storage volume from becoming low.
    実質的な記憶容量の低下が抑制されつつ効率的にデータ更新が行われるようにするメモリコントローラ、フラッシュメモリシステム、及びフラッシュメモリの制御方法を提供する。 - 特許庁
  • In a high speed memory subsystem, differences in each memory device's minimum device read latency and differences in signal propagation time between the memory device and a memory controller results in widely varying system read latencies.
    高速メモリサブシステムにおいて、各メモリデバイスの最小デバイスリードレイテンシーの差と、メモリデバイスとメモリコントローラとの間の信号伝搬時間の差があるため、システムリードレイテンシーが大幅に変化する。 - 特許庁
  • OVER-ERASURE CELL DETECTION SYSTEM FOR NON-VOLATILE SEMICONDUCTOR MEMORY, OVER-ERASION CELL ELIMINATION SYSTEM FOR NON-VOLATILE SEMICONDUCTOR MEMORY, NON- VOLATILE SEMICONDUCTOR MEMORY, OVER-ERASURE CELL DETECTION METHOD FOR SEMICONDUCTOR MEMORY, OVER- ERASURE CELL ELIMINATION METHOD FOR NON-VOLATILE SEMICONDUCTOR MEMORY
    不揮発性半導体メモリの過剰消去セル検出システム，不揮発性半導体メモリの過剰消去セル解消システム，不揮発性半導体メモリ，不揮発性半導体メモリの過剰消去セル検出方法，不揮発性半導体メモリの過剰消去セル解消方法 - 特許庁
  • In a second step S2, the memory check circuit performs memory check for a storage area by using the system program data written in the first buffer memory.
    第２ステップＳ２として、メモリチェック回路により、格納領域について、第１バッファメモリに書き込まれたシステムプログラムデータを用いてメモリチェックを行う。 - 特許庁
  • MEMORY CARD RECOGNIZING SYSTEM, CAPACITY SWITCHING TYPE MEMORY CARD HOST EQUIPMENT, CAPACITY SWITCHING TYPE MEMORY CARD, STORAGE CAPACITY SETTING METHOD, AND STORAGE CAPACITY SETTING PROGRAM
    メモリカード認識システム、容量切り替え型メモリカード・ホスト機器、容量切り替え型メモリカード、記憶容量設定方法及び記憶容量設定プログラム - 特許庁
  • To provide a method and a device which improve the throughput of a memory access request in a data processing system regardless of memory access time and memory bandwidth.
    メモリ・アクセス時間およびメモリバンド幅とは無関係に、データ処理システム内のメモリ・アクセス要求のスループットを向上させる方法および装置を提供すること。 - 特許庁
  • To provide a memory control device, a memory control system, a recording device and a memory control method, allowing improvement of latency when accessing a dynamic RAM.
    ダイナミックＲＡＭにアクセスする際のレイテンシーを改善することができるメモリー制御装置、メモリー制御システム、記録装置及びメモリー制御方法を提供する。 - 特許庁
  • To provide a nonvolatile semiconductor memory device capable of restraining the time taken to transfer read data to the exterior, and a memory system having the memory device.
    リードされたデータの外部への転送にかかる時間を抑えられる不揮発性半導体メモリ装置及びそのメモリ装置を有するメモリシステムを提供する。 - 特許庁
  • A multiprocessor system is provided with: a first memory; and a processing part connected to the first memory for executing processing by using data stored in the first memory.
    マルチプロセッサシステムは、第１メモリと、第１メモリに接続され、第１メモリに記憶されたデータを用いて処理を実施する処理部とを有している。 - 特許庁
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