「RAM」を含む例文一覧(7327)

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  • A device 10 is equipped with a flash memory 16a and a RAM 16b which is faster than the flash memory 16a.
    デバイス10は、フラッシュメモリ16aと、フラッシュメモリ16aよりも高速なRAM16bとを備えている。 - 特許庁
  • When RAM clear processing is executed, the number of the execution is displayed on a screen of a pattern display device 32a.
    RAMクリア処理が実行されると、その実行回数が図柄表示器32aの画面上に表示される。 - 特許庁
  • To provide a semiconductor integrated circuit device mounted with a static RAM which is inexpensive and has less number of elements.
    低コストで素子数の少ないスタティックRAMを搭載した半導体集積回路装置を提供すること。 - 特許庁
  • Thereafter, the lock release file is deleted (S750), and a lock setting file is stored in the RAM 13a (S760).
    その後、ロック解除ファイルを削除し(S750)、ロック設定ファイルをRAM13aに格納する(S760)。 - 特許庁
  • A DSP 1 performs main data processing based on the program written in the RAM 10 provided therein.
    DSP1は、内部に設けられたRAM10に書き込まれたプログラムに基づいて主演算処理を行なう。 - 特許庁
  • An inner RAM/PROM-A8 stores an interpolation detecting program for detecting interpolation of the processing program.
    内部RAM−PROM−A8は、処理プログラムの改竄を検出する改竄検出プログラムを記憶する。 - 特許庁
  • The control circuit 10 breaks electrical connection between the RAM 2 and other internal circuits 3 during the retention test.
    コントロール回路10は、リテンションテスト中、RAM2と他の内部回路3との間の電気的接続を遮断する。 - 特許庁
  • The module 10 accesses the RAM 15 to input/output the moving image data being the processing object through a port.
    モジュール10は、RAM15へアクセスし、処理対象の動画像データをポートを経由して入出力する。 - 特許庁
  • A semiconductor integrated circuit device (10) includes a nonvolatile memory (108), a control unit (101), and a RAM (107).
    半導体集積回路装置(10)は、不揮発性メモリ(108)と制御部(101)とRAM(107)とを含む。 - 特許庁
  • The multifunction machine 10 calculates the hash value using each data 114a-114e in the RAM 26 preferentially.
    多機能機10は、RAM26内の各データ114a〜114eを優先的に用いて、ハッシュ値を算出する。 - 特許庁
  • To provide a memory which materializes both ROM and RAM using memory devices of the same constitution.
    同じ構成の記憶素子を用いて、ROMとRAMとを共に実現することができるメモリを提供する。 - 特許庁
  • To provide a display unit capable of writing moving picture data and still picture data in a RAM with time division.
    時分割にて動画データ及び静止画データをRAMに書き込むことができる表示ユニットを提供すること。 - 特許庁
  • A plurality of pieces of inputted analog data are stored into a RAM 3 via a selector control part 12 and successively outputted.
    入力された複数のアナログデータをセレクタ制御部12を介してRAM3に記憶し、順次出力する。 - 特許庁
  • When receiving the detection timing command, the CPU for prize ball control stores the number of prize balls into a battery backup RAM.
    賞球制御用CPUは、検出時コマンドを受信すると、賞球数をバッテリバックアップRAMに記憶する。 - 特許庁
  • In an NMI interruption processing, the number of unpaid prize balls is stored in a backup RAM area as a total number.
    NMI割込処理において、未払出の賞球個数が総数としてバックアップRAM領域に格納される。 - 特許庁
  • To provide a cell structure of a low-power static RAM which reduces the standby current and can control the data holding voltage.
    スタンバイ電流を低減させ、データ維持電圧を制御し得る低電力スタティックラムのセル構造を提供する。 - 特許庁
  • In step S11, a digital numerical value is acquired from a RAM 14, and converted into spectrum data.
    まずステップS11で、デジタル数値がRAM14から取得され、そのデジタル数値がスペクトルデータに変換される。 - 特許庁
  • The handler program is stored in the system management memory part of a RAM 106 that is hard for the user to access.
    ハンドラ・プログラムは、ユーザにとってアクセスしにくいRAM106のシステム管理メモリ部分に格納されている。 - 特許庁
  • To reduce circuit scale of a cache memory system having an associative memory device and a cache RAM block.
    連想記憶装置(CAM)24とキャッシュRAMブロック28をもつキャッシュメモリシステム22の回路規模を小さくする。 - 特許庁
  • The RAM 13 performs write and read of output data in accordance with the data for mapping and the enable signal.
    RAM13はマッピング用データ及びイネーブル信号にしたがって、出力データの書込み及び読出しを行う。 - 特許庁
  • An image display device 1 is equipped with a 1st storage portion (HDD 3a etc.) and a 2nd storage portion (RAM 3b etc.).
    画像表示装置1は、第1の記憶部(HDD3a等)と第2の記憶部(RAM3b等)とを備える。 - 特許庁
  • In the data processor DP1, an Fe RAM 1b stores a first table T1 and a second table T2.
    データ処理装置DP1では、FeRAM1bが、第1のテーブルT1及び第2のテーブルT2を記憶している。 - 特許庁
  • The information processor is provided with a flash memory 6, a RAM area 10, an EEPROM 7 and a microcomputer 5.
    情報処理装置は、フラッシュメモリー6とRAM領域10とEEPROM7とマイコン5とを具備する。 - 特許庁
  • A control unit 20 copies update data in the memory card loaded in a memory card slot 2b to a RAM 20C.
    制御部20は、メモリカードスロット2bに装填されたメモリカード内の更新データを、RAM20Cにコピーする。 - 特許庁
  • A demonstration image and different types of five two-dimensional code image data as specific images are stored into a sub RAM.
    サブRAMに、デモ画像と、特殊画像としての種類の異なる5個の二次元コード画像データとを記憶する。 - 特許庁
  • To provide a memory system including a large capacity ROM and RAM in which high speed read and write are enabled.
    高速読み出し、書き込みが可能な大記憶容量のROMとRAMを含むメモリシステムを提供する。 - 特許庁
  • The CPU 41 stores a map image drawn on the basis of the read map information in a RAM 42.
    そして、CPU41は、この読み出した地図情報に基づいて描画した地図画像をRAM42に記憶する。 - 特許庁
  • A phone book in which telephone numbers and e-mail addresses of a plurality of users are registered is stored in a RAM 9.
    RAM9には、複数のユーザの電話番号や電子メールアドレスが登録された電話帳が記憶されている。 - 特許庁
  • Then the CPU 10 reads a replacement instruction 61 of the specified replacement instruction storage address from the RAM 60 and executes it.
    そして、特定した置換命令格納アドレスの置換命令61をRAM60から読み出して実行する。 - 特許庁
  • After that, when HDD audio playback is ended, the compressed data stored in the RAM 31 are held.
    その後、HDDオーディオ再生を終了する際には、RAM31が記憶している圧縮データを保持させる。 - 特許庁
  • It is formatted when the cumulative historical information is stored in the work RAM after loading the tape cassette.
    また、フォーマットは、テープカセットがロードされた後に累積履歴情報を前記ワークRAMに格納したうえで行なう。 - 特許庁
  • To improve operability of a semiconductor memory device by enhancing convenience of a static type RAM or the like in the word line pulse drive system.
    ワード線パルス駆動方式をとるスタティック型RAM等の利便性を高め、その使い勝手を高める。 - 特許庁
  • This device obtains specified transmission data via a LAN I/F 17 first and the data are stored in a RAM 13.
    本装置では、まず、LAN I/F17を介して所定の送信データが取得され、RAM13に記憶される。 - 特許庁
  • Further, an index table consisting of cell group codes and head addresses is stored in a RAM (1 to 4) functioning as a cache memory.
    またセルグループコードと先頭アドレスからなるインデックステーブルをキャッシュメモリとして機能するRAM(1-4)に記憶する。 - 特許庁
  • A casing-in and bookbinding machine is provided with a CPU 301, a RAM 303, a glue preparation part 308 and a gluing part 309.
    くるみ製本機は、CPU301、RAM303、糊準備部308、糊付け部309を備える。 - 特許庁
  • A RAM 303 holds therein information on communication channel settings of wireless communication and communication attributes of wireless communication.
    RAM303は、無線通信の通信チャネル設定および無線通信の通信属性の情報を保持する。 - 特許庁
  • A transport decoder 504 of the digital broadcast transmitter stores the SI in a service information storage RAM 505.
    デジタル放送受信装置において、トランスポートデコーダ504は、SIをサービス情報格納RAM505に記憶させる。 - 特許庁
  • During the time, since power is supplied from a capacitor 53 to the RAM 32, the saved register value is preserved.
    この間、RAM32にはコンデンサ53から電力が供給されるので、待避されたレジスタ値は保存される。 - 特許庁
  • By calculating Ki=Vr/Vsi, a correction value Ki is obtained (ST6) and stored in the RAM 23.
    そして、Ki=Vr/Vsiを計算して、補正値Kiを求め(ST6)、補正値KiをRAM23に記憶する。 - 特許庁
  • To provide a failure detection circuit capable of efficiently performing a test of a RAM macro output circuit.
    RAMマクロ出力回路のテストを効率良く行うことができる故障検出回路を提供すること。 - 特許庁
  • Then, when the power of the PC is turned on, the data stored in the storage unit are returned to the CMOS RAM unit.
    次にPCがパワーオンされると、ストレージユニットに格納されたデータがCMOSRAMユニットに戻される。 - 特許庁
  • To reduce a RAM required for shading correction inter-line correction or gamma correction with a film scanner.
    フィルムスキャナにおいて、シェーディング補正やライン間補正、ガンマ補正等を行うのに必要なRAMを削減する。 - 特許庁
  • Therefore, RAM clear processing is achieved by a single loop, thus restraining the program capacity.
    こうすることによって、RAMクリアの処理を単一ループで実現でき、プログラム容量を抑えることができる。 - 特許庁
  • The remaining capacity of RAM and the size of print data required for executing printing are calculated (step S12).
    RAMの残要領及び印刷を実行するために必要な印刷データのサイズが算出される(ステップS12)。 - 特許庁
  • A RAM 113 temporarily stores the result of the judgement on every time when the judgement is done by the judging means 117.
    RAM113は判定手段117で判定がなされる度にその判定結果を一時的に格納する。 - 特許庁
  • The decode buffer returns the packets required for the actual reproduction (packets except the low hierarchy packet) to a buffer RAM 103.
    デコードバッファは、実際の再生に必要なパケット(低階層パケット以外のパケット)をバッファRAM103に戻す。 - 特許庁
  • Thus, it is prevented that unnecessary protocol processing programs consumes the areas of the RAM 50.
    このため、不要なプロトコル処理プログラムがRAM50の領域を浪費してしまうのを、防止することができる。 - 特許庁
  • To reduce the memory region of a command RAM for command storage to be supplied to an ALU relating to parallel processing.
    並列処理に係るALUに供給するコマンド格納用のコマンドRAMのメモリ領域を削減する。 - 特許庁
  • On the data bus of another bit, the value of the data outputted from the RAM 1 is still held with the bus latch 12.
    他のビットのデータバスは、依然RAM1から出力されたデータの値がバスラッチ12によって保持されている。 - 特許庁
  • The CPU 41a initializes the unused area and an unused stack area of the RAM 41c for every single game.
    また、CPU41aは、1ゲーム毎にRAM41cの未使用領域及び未使用スタック領域を初期化する。 - 特許庁
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