「data lines」を含む例文一覧(3970)
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特性劣化に関係するデータ線Ｄｉ+及びＤｉ-の寄生容量が一番大きいのがウェルであることに着目し、ウェル電圧が揺すれないようにすることで、表示画面の横帯の発生や、フリッカ、焼きつきの発生を防止する。 - 特許庁 - The semiconductor device 101 is provided with a plurality of read circuits RDCs which are provided in association with bit lines BL, each reading the storage data of a memory cell MC connected to the corresponding bit line BL and output them to a global read line GRIO.
半導体装置１０１は、ビット線ＢＬに対応して設けられ、各々が、対応のビット線ＢＬに結合されたメモリセルＭＣの記憶データを読み出してグローバル読み出し線ＧＲＩＯへ出力する複数の読み出し回路ＲＤＣを備える。 - 特許庁 - To previously prevent commerce data from being illegally referred to or recorded by a third person through an information system (a repeater such as a router, an electronic exchange and a server) on a transmission line in a financial transaction through transmission lines between a financial institute and an individual or a corporation.
金融機関と個人、法人間の伝送路を通じた金融取引において、伝送路上の情報システム（ルータ、電子交換機、サーバなどの中継装置）で第三者が不正に取引データを参照、記録することを事前に防止する。 - 特許庁 - The client 100, the organization 200, the credit card company 300, and the provider 400 transmit and receive information via public networks and information communication lines such as the Internet and use personal computers and servers to carry out various processes on the data transmitted and received.
顧客１００，組織200，クレジットカード会社300及びプロバイダ400は、公衆回線網及びインターネット等の情報通信回線を介した相互の情報の送受信，及び送受信する各種のデータ処理を、パーソナルコンピュータやサーバなどで行う。 - 特許庁 - To produce a planographic printing plate applicable even to the writing of a fine image such as thin lines or dots and excellent in image reproducibility with a negative type image recording material which directly produces a printing plate from digital data with IR laser.
赤外線レーザを用いて、デジタルデータから直接製版するネガ型画像記録材料に好適な、細線や網点などの微細な画像の書き込みにも適用しうる画像再現性に優れた平版印刷版の作成方法を提供する。 - 特許庁 - In the data communication repeater 1 having line interface sections 11, 12 that conduct transmission reception processing to lines 3, 4, buffering sections A13, B14 that apply buffering to the relay data and having the buffering sections A13, B14 that selectively abort data packets from back addresses of buffers so that the packets in the buffers are discontinuously aborted without aborting newly arrived packets on the occurrence of buffer overflow.
回線３、４に対する送受信処理を行う回線インターフェース部１１、１２と、中継データのバッファリングを行うバッファリング部Ａ１３、バッファリング部Ｂ１４とを有するデータ通信中継装置１であって、バッファリング部Ａ１３、バッファリング部Ｂ１４は、バッファ溢れが発生した際、新規到着パケットを廃棄することなく、バッファ内のパケットが非連続的廃棄になるようにバッファ後方より選択的に廃棄する。 - 特許庁 - The display driver 200 for driving a plurality of data lines of the electro-optical device includes a fetch start timing setting register 384 for setting a period until the timing to start fetching gradation data on the basis of a given instruction signal for timing to start fetching the gradation data, and a shift start signal generation circuit 388 for generating a shift start signal based on the set content of the fetch start timing setting register 384.
電気光学装置の複数のデータ線を駆動する表示ドライバ２００は、所与の取込開始タイミング指示信号を基準に、階調データの取込開始タイミングまでの期間を設定するための取込開始タイミング設定レジスタ３８４と、前記取込開始タイミング設定レジスタ３８４の設定内容に基づいてシフトスタート信号を生成するシフトスタート信号生成回路３８８とを含む。 - 特許庁 - Data including the telephone number of the repeater and the numbers or addresses of the communication lines connected to the repeater are inputted by using an operation part 105 (steps S11, S115, and S117 in Fig. 5) and a main control part 101 generates and transmits the ACR table based upon the input data to the repeater (steps S132 and S135 in Fig. 6).
中継機の電話番号及び上記中継機に接続された通信回線の番号又はアドレスを含むデータが操作部１０５を用いて入力され（図５のステップＳ１１１，Ｓ１１５，Ｓ１１７）、主制御部１０１は、入力されたデータに基づいてＡＣＲテーブルを生成して上記中継機に送信する（図６のステップＳ１３２，Ｓ１３５）。 - 特許庁 - To decrease each of the number of data lines and the number of output channels included in the data driver by 1/3, thereby decreasing the manufacturing cost and lowering the power consumption, and to prevent deterioration in color vision by making transition of video signals different for each adjacent unit pixels, thereby improving the image quality.
液晶表示装置及びその駆動方法において、データライン数及びそれによるデータドライバの出力チャネル数をそれぞれ１／３に減少させ、製造コストを減少させるとともに、消費電力を減少させ、かつ、隣接する単位画素ごとに画像信号のトランジッションを異ならせることによって色感不良を防止し、画質を向上させる。 - 特許庁 - The composite printer comprises first and second controllers interconnected through internal communication lines wherein print object data is transferred between the first and second controllers using a first logic channel and control data is transferred using a second logic channel.
本発明に係るプリンタは、内部通信線によって相互に接続された第１の制御装置と第２の制御装置とを備えた複合プリンタにおいて、前記第１の制御装置と前記第２の制御装置間で、印刷対象データを第１の論理チャネルで転送する一方、前記制御データを第２の論理チャネルで転送することを特徴としている。 - 特許庁 - The required number of positive-polarity γ D/A converters (601-606) and negative-polarity γ D/A converters (607-612), for actual dot inversion driving, are arranged in a line, and data line driving voltages outputted from the D/A converters are supplied to the corresponding data lines (that is, subpixels) through multilayer wiring structure 320.
実際のドット反転駆動に必要な数の正極性のγ用Ｄ／Ａ変換器（６０１〜６０６）と、負極性のγ用Ｄ／Ａ変換器（６０７〜６１２）とを一列に配置し、Ｄ／Ａ変換器から出力されるデータ線駆動電圧を、多層配線構造３２０を経由して、対応するデータ線（すなわちサブピクセル）に供給する。 - 特許庁 - The pixel drive circuit DC sets the pixel PIX in a selective state, on the basis of selection signals Vsea, Vseb applied on selection lines Lsea and Lseb, respectively and obtains parameters specific to the pixel PIX, by measuring a current Imeas allowed to flow in a data line Ld, on the basis of an inspection voltage Vmeas written through the data line Ld.
画素駆動回路ＤＣは、少なくとも、選択ラインＬsea及びＬsebに各々印加される選択信号Ｖsea、Ｖsebに基づいて、画素ＰＩＸを選択状態に設定し、データラインＬｄを介して書き込まれる検査用電圧Ｖmeasに基づいて、データラインＬｄに流れる電流Ｉmeasを測定することにより、画素ＰＩＸに固有のパラメータを取得する。 - 特許庁 - On the basis of a mode of the arrangement of the point-like image corresponding to an intersection of the set arrangement lines, the electronic pen generates digital data associated with the coordinate of each intersection, and calculates a confidence arrangement 500 indicating a level of confidence of the digital data from the association relationship between the set arrangement line and the point-like image.
電子ペンは、設定した配列線同士の交差部に対応する点状画像の配置の態様に基づいて、交差部の座標と対応付けたデジタルデータをそれぞれ生成するとともに、設定した配列線と点状画像との対応関係に基づいて、デジタルデータの信頼の度合いである信頼度配列５００を算出する。 - 特許庁 - The correction data generation circuit 42 captures noise signals from each of regions resulting from dividing the light shield section in a way of segmenting the horizontal lines to calculate an average value, and applies linear interpolation to the average value to generate correction data corresponding to each pixel position.
補正データ作成回路４２は、ＣＣＤイメージセンサ３７からの撮像信号の読み出し時に、遮光部を水平ラインを分断するように複数に分割した各領域からノイズ信号を取り込んで平均値を算出し、これを線形補間することによって水平ラインに平行な方向の各画素位置に対応した補正データを作成する。 - 特許庁 - In this way, the array tester compares inspection data of the calibrating pixels B between the signal lines, thus making it possible to obtain data for correcting the output result of the array tester, which is affected by the variations in sensitivity for the input signals of the respective inspection pins of the array tester.
これにより、アレイテスタが蓄積容量に蓄積された電荷を検出するときの検出感度を高くすることができ、アレイテスタは、信号線間で校正用画素Ｂの検査データを比較することで、アレイテスタの各検査ピンの入力信号に対する感度ばらつきにより影響を受けるアレイテスタの出力結果を補正するためのデータを得ることができる。 - 特許庁 - To obtain a method for saving the quantity of toner being used in a multibeam laser printer at the time of performing decimation printing of pixels on any one line through simpler circuitry, when both patterns of pixels arranged above and below remarked data in the subscanning direction are composed of black dots with regard to a plurality of lines of video data being outputted simultaneously to a print section.
マルチビーム方式のレーザビームプリンタにおいて、複数ライン同時に印刷部に出力されるビデオデータに関して、副走査方向のデータに注目して上下に並びあう画素のパターンが両方黒ドットである場合、より簡単な回路構成によりどちらかいづれかのラインの画素を間引き印刷時に使用するトナーの量の節約する方法を目的とする。 - 特許庁 - A transmission format 1 has lateral bytes (a) and longitudinal block lines (b) including a video signal data area 8 capable of including effective pixel data of a digital video signal containing a blanking period and determines (a) and (b) on a condition of keeping a synchronous relationship at least with a vertical synchronizing signal of the digital video signal.
伝送フォーマット１は、ブランキング期間を含むディジタル映像信号の有効画素データを包含可能な映像信号データエリア８を含む横方向のバイト数ａ及び縦方向ブロックライン数ｂとする伝送フォーマットであり、少なくともディジタル映像信号の垂直同期信号と同期関係を保つことを条件にａとｂを定めた伝送フォーマットである。 - 特許庁 - The pixel drive circuit DC acquires a parameter specific to the pixel PIX by at least setting the pixel PIX in a selection state based on selection signals Vsea, Vseb applied to selection lines Lsea and Lseb, respectively, and by measuring a current Imeas flowing in a data line Ld based on a voltage Vmeas for inspection written via the data line Ld.
画素駆動回路ＤＣは、少なくとも、選択ラインＬsea及びＬsebに各々印加される選択信号Ｖsea、Ｖsebに基づいて、画素ＰＩＸを選択状態に設定し、データラインＬｄを介して書き込まれる検査用電圧Ｖmeasに基づいて、データラインＬｄに流れる電流Ｉmeasを測定することにより、画素ＰＩＸに固有のパラメータを取得する。 - 特許庁 - The data driver includes a gamma correction resistance which outputs a gradation voltage, a gradation voltage supply switch DVSWi, 1st and 2nd operational amplifiers OP1 and OP2 whose inputs are connected to a gradation voltage line and which drive 1st and 2nd data lines, and 1st and 2nd bypass switches BPSW1 and BPSW2 for bypassing the operational amplifiers.
データドライバは、階調電圧を出力するガンマ補正抵抗と、階調電圧供給スイッチＤＶＳＷｉと、その入力が階調電圧信号線に接続され第１及び第２のデータ線を駆動する第１及び第２のオペアンプＯＰ１、ＯＰ２と、各オペアンプをバイパスするための第１及び第２のバイパススイッチＢＰＳＷ１、ＢＰＳＷ２とを含む。 - 特許庁 - DCC circuits DC1-DCj charge a capacitor Cs1 with a reference current Istd by a signal from a shift register 42, stores the current value and outputs the current of the stored current value to data lines S1-Sj via a switching element SW3 conducted by a digital image data signal (H) of a single line outputted from a line latch 44.
ＤＣＣ回路ＤＣ１〜ＤＣｊは、シフトレジスタ４２からの信号により基準電流ＩｓｔｄでコンデンサＣｓ１を充電して、その電流値を記憶し、ラインラッチ４４から出力される１行分のデジタル画像データ信号（Ｈ）により導通したスイッチング素子ＳＷ３を介して記憶した電流値の電流をデータラインＳ１〜Ｓｊに出力する。 - 特許庁 - A state holding control part 154 switches the processing lines of the encoding part 172 and the decoding part 176, by time division processing, while interlocked with switching of a data transfer system by the data mediation part 152, and controls respective pieces of internal state information at the time when processing is interrupted for the time division processing, to be evacuated to state holding registers 182, 186, and to be restored.
状態保持制御部１５４は、データ調停部１５２よるデータ転送系統の切替えに連動して、符号化部１７２や復号化部１７６の処理系統を時分割処理で切り替え、かつ、時分割処理のための処理中断時点のそれぞれの内部状態の情報を状態保持レジスタ１８２，１８６へ退避し復帰するように制御する。 - 特許庁 - When it is in a burst mode, an address decoder 50 outputs internal address signals AN and ANB and block coding signals ANI-I and ANO-I, the data of plural memory cells connected to a same word lines W/L of memory cell blocks 61 to 64 are simultaneously read and a multiplexer 100, which is controlled by a decoding signal COS from a counter 40, successively outputs the data to the external.
バーストモード時には、アドレスデコーダ５０が内部アドレス信号ＡＮ，ＡＮＢ及びブロックコーディング信号ＡＮＩ＿Ｉ，ＡＮＯ＿Ｉを出力することにより、メモリセルブロック６１〜６４の同じワードラインＷ／Ｌに接続する複数のメモリセルのデータが同時にリードされ、カウンタ４０からのデコーディング信号ＣＯＳにより制御されるマルチプレクサー１００により順次外部に出力される。 - 特許庁 - In each arithmetic processing part 41-43, the photographic data are image-processed for 100 lines to perform specifying a detection range, elicitation by binarization of the image data with a defect threshold, bleb processing for taking, the elicited defect images, when they are vertically and laterally continued, as a mass of bleb, and defect determination and defect kind determination based on the area of bleb.
各演算処理部４１〜４３で１００ライン毎に画像処理して、検出範囲の特定、欠陥しきい値による画像データの２値化による顕在化、顕在化された欠陥画像が上下左右で連続しているときにこれを１かたまりのブレブとするブレブ処理、ブレブの面積に基づく欠陥判別及び欠陥種別判別を行う。 - 特許庁 - At this point, in a data line selection circuit 150 for determining data lines 114 to be sampled, NAND circuits 1512 of odd-numbered columns are made effective by supply of one of enable signals Enb1-Enb4 in the first half period Sub1 and NAND circuit 1522 of even-numbered columns are made effective by supply of one of enable signals Enb5-Enb8 in the second half period Sub2.
このとき、サンプリングすべきデータ線１１４を決めるデータ線選択回路１５０においては、前半期間Ｓub1で奇数列のＮＡＮＤ回路１５１２についてイネーブル信号Ｅnb1〜Ｅnb4のいずれかの供給で有効とさせ、後半期間Ｓub2で偶数列のＮＡＮＤ回路１５２２についてイネーブル信号Ｅnb5〜Ｅnb8のいずれかの供給で有効とさせる。 - 特許庁 - The telephone set for simultaneously speaking through plural lines is obtained by connecting a line interface means 3, a digital signal processor means 1 and a voice control processor means 5 through a data bus means 4 preparing plural digital signal processor means 1 in accordance with the number of effective time slots on a data bus and the number of the corresponding channels of the means 5.
回線インターフェース手段３、デジタルシグナルプロセッサ手段１、音声制御プロセッサ手段５をデータバス手段４を介して接続し、データバス上の有効タイムスロットの数および音声制御プロセッサ手段５の対応チャンネル数に応じてデジタルシグナルプロセッサ手段１を複数個準備することにより複数回線の同時通話を可能にした電話装置とする。 - 特許庁 - In an electronic board, a control signal is inputted to an LSI for data transmission from an LSI having a source management function on the controller board, and switching signal lines of an input signal and output signal which communicate with the LSI for data transmission on another controller board is carried out, and straight wiring on the backboard between the controller boards is performed.
コントローラ基板上の資源管理機能を持つＬＳＩより、制御信号をデータ転送用ＬＳＩに入力して、他の一方のコントローラ基板上のデータ転送用ＬＳＩとやり取りする入力信号と出力信号の信号線の切替えをおこなって、コントローラ基板間のバックボード上の配線をストレートに配線する。 - 特許庁 - To provide a multifunction machine having a facsimile function and a copying function, the multifunction machine detecting a table containing personal information based upon presence of ruled lines or presence of a predetermined amount of blank areas and performing restrained printing of image data when there is the table and the personal information is found in the table to prevent the image data from leaking out.
本発明はファクシミリ機能や複写機能を有する複合機であり、罫線の存在、又は所定量の空白領域の存在に基づき個人情報が存在する表を検出し、表が存在する場合当該表内に個人情報があれば、画像データに牽制印刷を行い、当該画像データの漏出を防止する。 - 特許庁 - A processing unit of compression processing and decompression processing by the compression/decompression combination circuit 100 is set to the prescribed number of lines of image data to be stored in input image line memories 112 and 113 and output image line memories 122 and 123, compression data are divided by the processing unit, and the compression processing and the decompression processing are repeatedly processed separately in turn.
圧縮伸長兼用回路１００による圧縮処理と伸長処理の処理単位が入力画像用ラインメモリ１１２，１１３と出力画像用ラインメモリ１２２，１２３とに記憶される画像データの所定ライン数に設定され、圧縮データが処理単位で分割されて、圧縮処理と伸長処理とが別々に交互に繰り返し処理される。 - 特許庁 - A corresponding code addition unit 20 adds a source code line extracted from a source file by referencing position information to each data line in a warning table consisting of data lines each of which has: an identifier indicating a warning type and obtained by static analysis of the source file; and the position information including a line number of the line written with a source code including a warning point.
該当コード追加部２０は、ソースファイルの静的解析によって得られ、警告種別を示す識別子と、警告箇所を含むソースコードが記述された行の行番号を含む位置情報と、を有するデータ行から構成される警告テーブルに対し、位置情報を参照してソースファイルから抽出したソースコード行を各データ行に追加する。 - 特許庁 - Especially, data voltages with opposite polarities are applied to the first subpixel included in one of two adjacent pixels and the second subpixel included in the other in each column of the matrix of pixels and a part of active periods of gate signals to each of gate lines connected to the second subpixels of each line of the matrix of pixels and gate lines connected to the first subpixel of the next line is overlapped.
特に、画素のマトリクスの各列で隣接する二つの画素の一方に含まれる第１副画素と、他方に含まれる第２副画素と、に対して逆極性のデータ電圧を印加し、画素のマトリクスの各行の第２副画素に接続されているゲート線と、その次の行の第１副画素に接続されているゲート線とのそれぞれに対するゲート信号のアクティブ期間の一部を重複させる。 - 特許庁 - A first writing changes resistance of a plurality of memory cells MCs connected to a word line oWL to a first state using current flowing from a source line SL to a plurality of bit lines BLs, and a second writing changes the resistance of the memory cells MCs to a second state using current flowing from the bit lines BLs to the source line SL based on data stored in a sense amplifier 13 after performing the first writing.
第１の書き込みは、ソース線ＳＬから複数のビット線ＢＬへ流れる電流で、ワード線ｏＷＬに接続された複数のメモリセルＭＣの抵抗を第１状態に変化させ、第２の書き込みは、第１の書き込みを行った後にセンスアンプ１３が保持するデータに基づいて、ビット線ＢＬからソース線ＳＬへ流れる電流でメモリセルＭＣの抵抗を第２状態に変化させる。 - 特許庁 - The semiconductor storage device 100 comprises a memory cell array MCA including memory cells MC arranged in a matrix form, a plurality of word lines WL connected to the memory cells MC of each row in the memory cell array MCA, and a counter cell array CCA which includes counter cells prepared correspondingly to each word line, and stores the frequency of activating the word lines WL for reading the data of the memory cells MC.
半導体記憶装置１００は、マトリクス状に配置されたメモリセルＭＣを含むメモリセルアレイＭＣＡと、メモリセルアレイＭＣＡの各行のメモリセルＭＣに接続された複数のワード線ＷＬと、ワード線ＷＬの各々に対応して設けられたカウンタセルＣＣを含み、メモリセルＭＣのデータを読み出すためにワード線ＷＬを活性化させた回数を記憶するカウンタセルアレイＣＣＡとを備えている。 - 特許庁 - In the liquid crystal display which has a TFT substrate 1 and its facing substrate 2 with negative permittivity anisotropy liquid crystals 3 in between; the pixel electrodes 8 on the TFT substrate are displaced by the predetermined distance from the areas demarcated by the gate lines and data lines toward the edge of the substrate aligned by the alignment layer in a plan view of the TFT substrate.
ＴＦＴ基板１と、対向基板２と、ＴＦＴ基板と対向基板に挟持された誘電率異方性が負である液晶３とを備える液晶表示装置において、ＴＦＴ基板に設けられた画素電極８は、それぞれ対応するゲートラインとデータラインで区画される領域から、ＴＦＴ基板を平面視した際における配向膜の配向処理の基端方向に所定距離だけ変位している。 - 特許庁 - The latent image forming section comprises a circuit 30 for grouping the image data into odd lines and even lines, a memory 31 for storing the light emitting position, a pulse generating position control circuit 32 generating a pulse generating position signal, a PWM circuit 33 generating a triangular wave based on the pulse generating position signal, and beam A circuit 34 and beam B circuit 35 for controlling the beam of the semiconductor laser.
潜像形成部は、画像データの奇数行と偶数行を分類する画像分離回路３０と、発光位置を記憶するメモリ３１と、パルス発生位置信号を生成するパルス発生位置制御回路３２と、パルス発生位置信号に基づいて三角波を生成するＰＷＭ回路３３と、半導体レーザーのビームを制御するビームＡ回路３４およびビームＢ回路３５とを備える。 - 特許庁 - A semiconductor memory provided with an access sequencer for simultaneously accessing a plurality of memory cells in the direction of data lines 111 to 114 and the direction of word lines 101 to 104 at the time of a write access to the memory array 100 of the above constitution and a test decoder 300 which is a control signal generation circuit improves write access processing efficiency and shortens test access time by using the test decoder 300.
前記構成のメモリアレイ１００に対して、書込みアクセスにおいてデータ線１１１，１１２，１１３，１１４方向、及びワード線１０１，１０２，１０３，１０４方向に複数のメモリセルを同時にアクセスするアクセスシーケンサ、及び制御信号生成回路としてのテストデコーダ３００を設け、前記テストデコーダ３００を用いて、書込みアクセス処理効率の向上を図り、テストアクセス時間を削減する。 - 特許庁 - Data transfer is executed by the one bit unit or by the two or more bit units between the DRAM cell array 30 and an arithmetic circuit 32 in which arithmetic elements are arranged according to the pairs of the prescribed number of bit lines of the DRAM cell array, and an arithmetic operation corresponding to an instruction is executed in the arithmetic element.
ＤＲＡＭセルアレイの所定数のビット線対に対応して演算エレメントが配置された演算回路（３２）との間で１ビット単位または複数ビット単位でデータ転送を実行し、演算エレメント内で命令に応じた演算を実行する。 - 特許庁 - This device/method receives a downlink through two satellites by two reception antennas 10-11, makes AD-sampling of reception signals in two lines at the same time to acquire digital data, and conducts correlation processing for calculating an arrival time difference and a Doppler frequency difference, in a correlation processing part 40.
２つの受信アンテナ１０〜１１で、２つの衛星経由のダウンリンクを受信し、２系統での受信信号を同時にＡＤサンプリングしてデジタルデータを取得し、相関処理部４０にて、到達時間差、ドップラ周波数差を算出するための相関処理を行う。 - 特許庁 - It is possible to reduce signal line driving power to a half or less by replacing scanning sequence of scanning lines by using two scanning line driving circuits differing in scanning direction from each other and thereby prolonging inversion period of data signal polarities two times or more.
走査方向が互いに異なる２つの走査線駆動回路を用いて走査線の走査順を入れ替えることによってデータ信号極性の反転周期を２倍以上に長くし、信号線駆動電力を２分の１以下に低減することができる。 - 特許庁 - To provide a server device that can be simply utilized by reducing setting troubles in a communication device, for example by connecting the communication device utilizing other communication lines so far to a data exchange network, in a system for communicating by an electronic mail; and to provide the communication device.
電子メールで通信を行うシステムにおいて、通信装置における設定の手間を軽減し、例えばそれまで他の通信回線を利用していた通信装置をデータ交換ネットワークに接続して簡単に利用可能なサーバ装置及び通信装置を提供する。 - 特許庁 - A communication control part 2 memorizes specific informations of the communication terminals 20 based on information data from the communication terminals 20 obtained through the communication lines L2 and at same time, makes various kinds of communication controls between communication terminals through the connector connecting part 5.
通信制御部２は、通信線Ｌ２を介して取得した通信端末２０からの通信データに基づいて通信端末２０の固有情報を記憶するとともに、コネクタ接続部５を介して通信端末との間で所定の各種通信制御を行う。 - 特許庁 - Two memory sub arrays MAB0 and MAB1 are provided adjacent to a write/read circuit, a pair of internal data lines IOP are connected to the write/read circuit via a pair of passage wirings FLP at the upper layer of the closer memory sub array for the farther memory sub array.
書込／読出回路に隣接して２つのメモリサブアレイ（ＭＡＢ０，ＭＡＢ１）を設け、遠い方のメモリサブアレイに対して内部データ線対（ＩＯＰ）は、近い方のメモリサブアレイ上をそれより上層の通過配線対（ＦＬＰ）を介して書込／読出回路に接続する。 - 特許庁 - When the user enters the user code via an operation display section 3, the user references a table in a data storage section 6 in which user codes and lines to be used corresponding to them are registered and selectively uses the line registered on the table to start faxing.
操作表示部３を介してユーザコードが入力されたら、ユーザコードとそれに対応している使用する回線とが登録されている、データ記憶部６内のテーブルを参照し、このテーブルに登録されている回線を選択使用して送信動作を開始する。 - 特許庁 - To reduce the number of transmission lines for clock signals of different frequencies and to simplify a circuit scale of a reception circuit even if a frequency difference of clocks is a small, in a system for transmitting and receiving a plurality of data signals in an asynchronous relationship and synchronized with the clock signals of different frequencies.
異なる周波数のクロック信号に同期した非同期関係にある複数のデータ信号を送受信するシステムにおいて、クロック信号の伝送線数を削減すると共に、各クロックの周波数差が小さくても受信回路の回路規模を簡略化する。 - 特許庁 - Accordingly, a current exhausted at the time of precharging operation can be lessened and a write rate can be improved, and a voltage difference between the pair of the global data lines does not decrease at the time of read operation, an undesirable impact for a read rate can be prevented.
従って、プリチャージ動作時に消耗となる電流を少なくさせることができると共に、ライト速度を改善することができ、リード動作時にグローバルデータライン対間の電圧差が減少しないので、リード速度によくない影響を及ぼすことを防止できる。 - 特許庁 - To provide a router and a dual line data transmission system using the router which properly interconnects duplexed first and second lines hub units 101, 101a with terminals and properly executes the relay control of frames and the transmission right control (real time control).
二重化された１系ハブ装置１０１及び２系ハブ装置１０１ａと端末とを適正に相互接続でき、フレームの中継制御や送信権制御（リアルタイム制御）も適正に行える、ルータ装置及びルータ装置を用いた二重系データ伝送システムを提供する。 - 特許庁 - When a predetermined number of line feed commands or continuous blank lines are positioned in a printable maximum region in coordinates of a small paper size for executing printing, page break is executed so that all the original manuscript data is divided to perform the printing.
印刷を実行させる小さい用紙サイズの座標内の印刷可能な最大の領域に、所定数の改行コマンドが位置した場合や連続した空白行などが位置することで改ページを行っていき、もとの原稿データ全てを分割し、印刷を行っていく。 - 特許庁 - A load on a CPU is reduced since lines of two-dimensional arrangement data are thinned and transfer by every line is further performed by repeating addition of offset values to an base point address and further repeating addition of block length to a transfer starting address.
基点アドレスにオフセット値を加算することを繰り返し更に転送開始アドレスにブロック長を加算することを繰り返すことにより、二次元配列データの行を間引きして更に列ごとに転送を行うため、ＣＰＵの負荷を軽減することができる。 - 特許庁 - To sufficiently suppress data error occurrence and an increase of EMI with simple constitution by a communication system including a transmission means of transmitting a plurality of bit signals through two or more predetermined communication lines each time one clock is generated.
クロックが１クロック生成される毎に、予め定められた２以上の通信ラインにより複数のビット信号を送信する送信手段を備える通信システムにおいて、簡単な構成により、データ化けが発生することやＥＭＩが大きくことを十分に抑制する。 - 特許庁 - The electrooptic device is provided with, on a first substrate, a plurality of pixel electrodes and a plurality of data lines for supplying an image signal in a sampling period to the plurality of pixel electrodes and on a second substrate, provided with a counter electrode which is opposite to the plurality of pixel electrodes via an electrooptic material.
第１基板に、複数の画素電極と、該複数の画素電極にサンプリング期間に画像信号を供給するための複数のデータ線とを備え、第２基板に、電気光学物質を介して複数の画素電極と対向する対向電極を備える。 - 特許庁 - To eliminate the deviation of a video display time caused by a delay difference between transmission lines for transmitting monitor object video data of a plurality of monitoring cameras, the deviation of a video synchronizing signal between the monitoring cameras, and deviation in a display time of a decoded video image caused by a difference of reference frequencies between encoders.
複数の監視カメラでの監視対象映像データを伝送する伝送路の遅延差による映像の表示時間のずれ、監視カメラ間の映像同期信号のずれ、各エンコーダの基準周波数の差による復号映像の表示時間のずれをなくす。 - 特許庁
- 特許庁
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