Output signals of the pre-processor 10 are added and outputted as addition complex by an adder 12 of the tap TAP_N employing a Wallace-Tree structure until dyadic addition is completed. タップTAP_Nの加算部12は、Wallace Tree構成が用いられており、前処理部10の出力信号を加算の複合体として2項加算となるまで加算して出力する。 - 特許庁