To highly accurately correct the error (clock phase error) in the precision less than the operation clock cycle out of the errors of an FFT segmentation timing and a symbol boundary timing. FFTの切り出しタイミングとシンボルの境界タイミングとの誤差のうち、動作クロック周期以下の精度の誤差(クロック位相誤差)を高精度に補正する。 - 特許庁
By controlling the number and the timing of clock signals to be input to the electronic shutter vertical shift register circuits A20, B21, a reduction ratio in "thinning", the average number of pixels in "pixel averaging" and a range of segmentation in "segmentation" are freely changed only by preparing the two electronic shutter vertical shift register circuits A20, B21. この電子シャッター垂直シフトレジスタ回路A20,B21に入力するクロック信号の数およびタイミングを制御することにより、2個の電子シャッター垂直シフトレジスタ回路A20,B21を用意するのみで、“間引き”時の縮小率、“画素平均”時の平均画素数、および、“切り出し”時の切り出しの範囲を自由に変更できる。 - 特許庁