In this debug system, the integrated circuit device 20 of a target system 10 includes: a first clock generation circuit 70; and a first asynchronous communication control circuit 80 performing communication control for performing transmission/reception of debugging data with a pin reduction type debugtool by the asynchronous type serial data transmission with a clock generated by the first clock generation circuit 70 as an operation clock. ターゲットシステム10の集積回路装置20は、第1のクロック生成回路70と、第1のクロック生成回路で生成されたクロックを動作クロックとして、省ピン型のデバッグツールとのデバッグ用のデータの送受信を非同期式のシリアルデータ伝送で行うための通信制御を行う第1の非同期通信制御回路80とを含む。 - 特許庁
The pin reduction type debugtool 110 includes: a second clock generation circuit 170 generating a clock of the same baud rate as the first clock generation circuit; and a second asynchronous communication control circuit 180 performing communication control for performing transmission/reception of the debugging data with the target system by asynchronous type serial data transmission with the clock generated by the second clock generation circuit as an operation clock. 省ピン型のデバッグツール110は、第1のクロック生成回路と同じボーレートのクロックを生成する第2のクロック生成回路170と、 第2のクロック生成回路で生成されたクロックを動作クロックとして、前記ターゲットシステムとのデバッグ用のデータの送受信を非同期式のシリアルデータ伝送で行うための通信制御を行う第2の非同期通信制御回路180とを含む。 - 特許庁