「data cache」を含む例文一覧(2143)

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  • When the data is not cached, the cache access section 23 writes the data received from the LAN data decision section 31 into the main storage section 12.
    また、キャッシュアクセス部２３はデータをキャッシュしない場合、ＬＡＮデータ判定部３１より受け取ったデータを主記憶部１２に書き込む。 - 特許庁
  • When block data or line data are transferred, necessary data are transferred to the cache on the basis of the indication bit in the software prefetch instruction.
    ブロックデータまたはラインデータの転送時、前述のソフトウェアプリフェッチ命令内の指示ビットに基づいて、所要のデータをキャッシュに転送する。 - 特許庁
  • To cache only a portion of document data having a specific data structure, and to lay out an object by use of the cached data.
    特定のデータ構造を有する文書データのうち一部分のみをキャッシュし、キャッシュしたデータを用いてオブジェクトをレイアウトすること。 - 特許庁
  • The data consistency determination unit 6 can also determine the consistency of the data on the basis of the data address written to the cache memory.
    データ整合性判定部６は、キャッシュメモリに書き込まれたデータのアドレスに基づいて、データの整合性を判定することもできる。 - 特許庁
  • To surely detect an error in a cache memory due to a miss on logical design or a data change.
    論理設計上のミスやデータ化けによるキャッシュメモリのエラーを確実に検出する。 - 特許庁
  • Furthermore, the number of times of data transfer between the external storages and the cache device can be reduced also.
    さらに，外部記憶装置とキャッシュ装置間でのデータの転送回数も低減できる。 - 特許庁
  • The interrupted processor reads the communication data stored in the cache block.
    そして、割込みを受けたプロセッサが、キャッシュブロックに格納されている通信データをリードする。 - 特許庁
  • To provide a technology for storing a single block in a cache memory by using a data storage device.
    データ記憶装置を用いてシングルブロックをキャッシュメモリに格納する技術を提供する。 - 特許庁
  • To prevent loss of cache data with high accuracy when a power failure occurs during power restoration.
    復電処理中に停電が発生した場合に、キャッシュデータのロストを精度よく防止する。 - 特許庁
  • CACHE SYSTEM AND CACHING METHOD FOR STORING FILE DATA BY DIVIDING CHACE MEMORY INTO MEMORY BLOCKS
    キャッシュメモリをメモリブロックに分けてファイルのデータを保存するキャッシュ方法及びキャッシュシステム - 特許庁
  • To provide an efficient font cache management system for making character data expansion faster.
    文字データ展開の高速化を図るべく、効率的なフォントキャッシュ管理方式を提供する。 - 特許庁
  • Each group assigns priority to data belonging to its own group according to its unique cache algorithm.
    各グループは、独自のキャッシングアルゴリズムで、自グループに属するデータに優先度を割り当てる。 - 特許庁
  • When accessing data, host computers send packets to the cache memory through the switch.
    ホストコンピュータはデータをアクセスするときパケットをスイッチを介してキャッシュメモリに送出する。 - 特許庁
  • A cache control part 42 processes data in page units matching stripes of the disk devices.
    キャッシュ制御部４２はディスク装置のストライプに一致するページ単位にデータを処理する。 - 特許庁
  • Further, the data is "locked" into the cache or other fast memory until it is loaded for use.
    さらに、データは、使用のためにロードされるまでキャッシュ又は他の高速メモリに「ロック」される。 - 特許庁
  • The storage device which has received the instruction of prefetch reads the designated data on a cache memory.
    プリフェッチの指示を受けた記憶装置は、指定されたデータをキャッシュメモリ上に読み出す。 - 特許庁
  • METHOD AND SYSTEM FOR ENABLING PCI-PCI BRIDGE TO CACHE DATA WITHOUT COHERENCY SIDE REACTION
    コヒーレンシ副作用なしでＰＣＩ−ＰＣＩブリッジがデータをキャッシングできる方法とシステム - 特許庁
  • To protect important cache data from access from a malicious external module.
    悪意のある外部モジュールからのアクセスから重要なキャッシュデータを保護できるようにする。 - 特許庁
  • To provide constantly continued data by using a multiplexed cache device.
    多重化されたキャッシュ装置を用いて恒常的に継続したデータ提供を可能とする。 - 特許庁
  • To make an access to a system memory occurring in changing (lightening) cache data more efficient.
    キャッシュ・データの変更（ライト）に伴って発生するシステム・メモリヘのアクセスを効率化する - 特許庁
  • DISK UNIT, DISK ROTATIONAL SPEED CONTROL METHOD THEREFOR AND CACHE DATA TRANSFER CONTROL METHOD
    ディスク装置、そのディスク回転速度制御方法及びキャッシュデータ転送制御方法 - 特許庁
  • COMPUTER SYSTEM HAVING INPUT/OUTPUT READ DATA ARRANGED DIRECTLY IN PROCESSOR LOCAL CACHE
    入力／出力読出しデータがプロセッサローカルキャッシュに直接配置されるコンピュータシステム - 特許庁
  • To attain speed-up of data processing by reducing the time necessary for cache flush processing.
    キャッシュフラッシュ処理に要する時間を削減して、データ処理の高速化を実現する。 - 特許庁
  • To reduce power required for saving cache data into a nonvolatile memory.
    不揮発性メモリにキャッシュデータを退避させるために必要な電力を減少させること。 - 特許庁
  • To get reasonable performance, the client must cache frequently accessed data.
    適切な性能を得るには、クライアントは頻繁にアクセスされたデータをキャッシュしなければなりません。 - FreeBSD
  • The local cache maintains copies of the primary data storage according to the received information.
    ローカル・キャッシュは、受信した情報に従って一次データ記憶装置のコピーを維持する。 - 特許庁
  • This cache matching data processing system includes first and second matching domains at least.
    キャッシュ整合データ処理システムは、少なくとも第１および第２の整合ドメインを含む。 - 特許庁
  • Each of the access requests includes an identification signal showing that data of a cache line is rewritten.
    アクセス要求は、キャッシュラインのデータが書き換えられた旨を示す識別信号を含む。 - 特許庁
  • The transmission means transmits biometric data and the identifier of the cache target user to a client.
    送信手段は、キャッシュ対象ユーザの生体データおよび識別子をクライアントに送信する。 - 特許庁
  • METHOD FOR INVALIDATING DATA IN MEMORY CACHE, COMPUTER READABLE MEDIUM, AND IMAGE PROCESSING SYSTEM
    メモリ・キャッシュ内のデータを無効化する方法、コンピュータ可読媒体及びイメージ処理システム - 特許庁
  • To simultaneously and efficiently cache a plurality of data systems whose access patterns are different.
    アクセスパターンが異なる複数のデータ系列を同時に効率良くキャッシュできるようにする。 - 特許庁
  • To provide a cache memory device capable of reducing a data size of a tag storage unit.
    タグ記憶部のデータサイズを少なくすることができるキャッシュメモリ装置を提供すること - 特許庁
  • This can increase a cache hit rate of data requested by users.
    本構成により、ユーザからの要求データのキャッシュヒット率を高めることが可能となる。 - 特許庁
  • For high speed, data in the nonvolatile memory is transferred to and retained in the cache memory.
    不揮発性メモリのデータをキャッシュメモリへ転送させ、保持することにより高速化を図る。 - 特許庁
  • The cache memory 13 stores part of data subject to a real FFT operation.
    キャッシュメモリ１３は、実数ＦＦＴ演算の対象となるデータの一部を格納する。 - 特許庁
  • When the total number of cash lines required to store data for one line of two-dimensional data of the cache memory 10 is a multiple of the number of cache lines, a decoder 2 determines a cache line for storing the two-dimensional data, with the index converted based on the look-up table 1.
    キャッシュメモリ１０の、二次元データ１行分のデータを格納するのに必要なキャッシュラインの総数が、キャッシュラインの個数の倍数であった場合、デコーダ２は、ルックアップテーブル１で変換されたインデックスで、二次元データを格納するキャッシュラインを決定する。 - 特許庁
  • When receiving a data write request, the channel adapter 11 duplicates and writes write data into the local cache memory 105, sends a write-completion message to the host 50, and thereafter transfers the write data in the local cache memory 105 to a main cache memory 14 at a time in an asynchronous manner.
    チャネルアダプタ１１はホスト５０からデータライト要求を受けるとライトデータをローカルキャッシュメモリ１０５に二重化して書き、ライト完了をホスト５０に送信し、その後、非同期タイミングで、ローカルキャッシュメモリ１０５内のライトデータを一括してメインキャッシュメモリ１４へ転送する。 - 特許庁
  • A cache management part 32 decides whether the hash value generated by the identifier generation part 33 is held in a cache data table 23 or not.
    キャッシュ管理部３２は、識別子生成部３３によって生成されたハッシュ値がキャッシュデータテーブル２３に保持されているか否かを判定する。 - 特許庁
  • The first cache control means stores write data to be written onto the first external storage in a cache area in the volatile memory.
    第１キャッシュ制御手段は前記第１外部記憶装置に書き込むべきライトデータを前記揮発性メモリ内のキャッシュ領域に格納する。 - 特許庁
  • When the data in the address region are written in a cache memory according to cache mistake, the replacement protection bit L of the write entry is set as a valid value.
    キャッシュミスによりアドレス領域内のデータをキャッシュメモリに書き込むときに、書き込むエントリのリプレース保護ビットＬを有効な値に設定する。 - 特許庁
  • To provide a cache memory capable of keeping the coherency of data between processors with the excellent efficiency of operation, and to provide a processor provided with the cache memory.
    プロセッサ間でデータのコヒーレンシーを動作効率よく保つことができるキャッシュメモリ及びこのキャッシュメモリを備えたプロセッサを提供する。 - 特許庁
  • In response to a request for writing from a file system, when any old data and related old parity are not present in the cache, they are read in the cache.
    ファイルシステムからの書出要求により、旧データおよび関連する旧パリティがキャッシュにないときにはそれらがキャッシュに読込まれる。 - 特許庁
  • A cache control circuit discriminates whether target block data is stored in the cache memory in response to a request from a keystone correction circuit.
    キャッシュ制御回路は、キーストーン補正回路からの求めに応じて、キャッシュメモリ上に、目的のブロックデータが格納されているか否かを判別する。 - 特許庁
  • For the write request of data for which the cache control is performed in the OS 52, the cache control is not performed in the disk controller 54.
    一方、ＯＳ５２にてキャッシュ制御が行われたデータの書き込み要求に対しては、ディスクコントローラ５４ではキャッシュ制御を行わない。 - 特許庁
  • To improve efficiency of debug operation by supporting data analysis relating to the cache memory of a program to be carried out by a processor having the cache memory.
    キャッシュメモリを有するプロセッサで実行されるプログラムのキャッシュメモリに係るデータ解析を支援してデバッグ作業効率を向上させる。 - 特許庁
  • To improve an execution performance for a load instruction to access a plurality of element data items in a cache line while a cache memory is in an invalid state.
    キャッシュメモリが無効な状態でキャッシュライン中の複数の要素データをアクセスするロード命令に関し、実行性能を向上させる。 - 特許庁
  • The memory controller 109 includes a directory cache 112 holding second entry information consisting of cache data of a part of a first entry information.
    メモリコントローラ１０９は、第一のエントリ情報の一部のキャッシュデータからなる第二のエントリ情報を保持するディレクトリキャッシュ１１２を備えている。 - 特許庁
  • A memory device, such as a DRAM cache memory, may be used to cache write data corresponding to particular addresses of a PCM DIMM.
    ＤＲＡＭキャッシュメモリのようなメモリデバイスを用いて、ＰＣＭＤＩＭＭの特定のアドレスに対応する書き込みデータをキャッシュに格納することができる。 - 特許庁
  • The analysis device 20, having acquired the sampling data D1, calculates cache miss ratio, by dividing the number of cache misses by the number of accesses for each sector configuration.
    サンプリングデータＤ１を取得した分析装置２０は、セクタ構成ごとにキャッシュミス数をアクセス数で除してキャッシュミス率を算出する。 - 特許庁
  • In the case of updating the data base whose copy is stored in the area 216, the device 1 invalidates the cache by a cache clear instruction 45.
    上位装置１はキャッシュエリア216 にそのコピーが保持されているデータベースを更新する場合、キャッシュクリア指示45によって、キャッシュを無効化する。 - 特許庁
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