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frequency demultiplierとは 意味・読み方・使い方
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意味・対訳 周波数逓降器
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There is provided the PLL frequency synthesizer circuit equipped with a voltage controlled oscillator, a phase comparator, a lowpass filter, and a variable frequency demultiplier.例文帳に追加
発明は、希望信号周波数近傍のスプリアスであっても、これを除去し得る機能を備えたＰＬＬ周波数シンセサイザ回路を提供することを目的とする。 - 特許庁
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