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standard test blockとは 意味・読み方・使い方
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This device is provided with a test mode switching circuit 4 in which sense amplifier circuits 5a-5d in all operation blocks 2a-2d are activated independently of block selecting signals BS1-BS4 at the time of test mode where it is tested whether an operation current of a semiconductor memory 1 satisfies a standard requirement or not.例文帳に追加
半導体記憶装置１の動作電流が規格を満足しているか否かをテストするテストモード時に、外部から入力されるブロック選択信号ＢＳ１〜ＢＳ４に関係なく、すべての動作ブロック２ａ〜２ｄにおけるセンスアンプ回路５ａ〜５ｄを活性化させるテストモード切換回路４を備えた。 - 特許庁
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