「Cache」を含む例文一覧(5776)

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  • When the music data are stored as the cache data, and when the cache area of the HDD 8 is full, it is stored, after the cache data of the lowest priority is deleted.
    また、キャッシュデータとして記憶するとき、ＨＤＤ８のキャッシュ領域が一杯であれば優先順位の最も低いキャッシュデータを消去してから記憶する。 - 特許庁
  • DISPLAY DEVICE AND CACHE CONTROL METHOD FOR DISPLAY DEVICE
    表示装置および表示装置のキャッシュ制御方法 - 特許庁
  • According to this, the frequency of cache flush processing is reduced.
    これにより、キャッシュフラッシュ処理の回数を低減する。 - 特許庁
  • DISPLAY DEVICE AND METHOD FOR CONTROLLING CACHE OF DISPLAY DEVICE
    表示装置および表示装置のキャッシュ制御方法 - 特許庁
  • To provide an integrated type cache memory that can concurrently execute a fetch instruction and data access, which are used to be implemented only by using a separated type cache memory, and a processor that can realize use of both integrated and separated type cache memory devices.
    本発明の課題は、従来分離型でのみ可能であった命令フェッチとデータアクセスの同時実行を統合型キャッシュメモリで達成することである。 - 特許庁
  • IMAGE DISPLAY DEVICE, PRINTER AND IMAGE CACHE METHOD
    画像表示装置、印刷装置および画像キャッシュ方法 - 特許庁
  • If the electronic article is successfully provided by the cache to the user, then the cache generates confirmation data that indicates that the electronic article is successfully provided by the cache to the user.
    キャッシュによるユーザへの電子商品の提供に成功すれば、キャッシュによるユーザへの電子商品の提供に成功したことを示す確認データをキャッシュが生成する。 - 特許庁
  • PRINT DATA PROCESSING APPARATUS, CACHE PROCESSING METHOD, AND PROGRAM
    印刷データ処理装置、キャッシュ処理方法及びプログラム - 特許庁
  • According to the cache use information stored in the second register 11a, the cache control circuit 11 turns the cache memory 11b into available state or unavailable state.
    キャッシュ制御回路１１は、第２のレジスタ１１ａに格納されたキャッシュ使用情報に従って、キャッシュメモリ１１ｂを使用可能状態又は使用不可状態にする。 - 特許庁
  • PROCESSOR, INFORMATION PROCESSING DEVICE AND CACHE CONTROL METHOD OF PROCESSOR
    プロセッサ、情報処理装置、プロセッサのキャッシュ制御方法 - 特許庁
  • To maintain, with software, consistency of a cache in a memory area to which only an access utilizing the cache is allowed.
    キャッシュを利用するアクセスのみ許されるメモリ領域にかかるキャッシュの一貫性をソフトウェアで維持する。 - 特許庁
  • To achieve simplification of data management required for cache processing and improvement of use efficiency of cache memory at the same time.
    キャッシュ処理に要するデータ管理の簡素化と、キャッシュメモリの利用効率の向上とを同時に実現する。 - 特許庁
  • To dispense with initialization processing of a cache memory to immediately start read transfer or write transfer to the cache memory.
    キャッシュメモリの初期化処理を不要とし、即座にキャッシュメモリへのリード転送又はライト転送を開始可能とする。 - 特許庁
  • To provide a cache memory device which operates a cache memory with the lowest possible power consumption while having cache hit performance equivalent to a normal access mode.
    通常アクセスモードと同等のキャッシュヒット性能を持ちつつ、可能な限りの低消費電力でキャッシュメモリを動作させることができるキャッシュメモリ制御回路を提供する。 - 特許庁
  • A high-order cache destaging means writes data for destaging in the disk unit, it instructs staging of data written in the low-order cache, and it carries out destaging of data from the high-order cache.
    上位キャッシュデステージング手段は、ディスク装置にデステージングするデータを書き出し、下位キャッシュに書き出したデータのステージングを指示し、上位キャッシュからデータをデステージングする。 - 特許庁
  • To effectively reduce the number of instruction cache conflicts.
    命令キャッシュ競合の回数を効果的に削減する。 - 特許庁
  • The commands include commands for writing data to the cache, loading data from the cache, and for marking data in the cache as no longer needed.
    コマンドは、キャッシュにデータを書き込むためのコマンド、キャッシュからデータをロードするためのコマンド、およびキャッシュ中のもはや必要としないデータにマーキングするためのコマンドを含む。 - 特許庁
  • DATA PROCESSING SYSTEM, CACHE SYSTEM, AND METHOD FOR SENDING REQUEST ONTO MUTUAL CONNECTION FABRIC WITHOUT REFERRING TO LOWER LEVEL CACHE BASED ON TAGGED CACHE CONDITION
    タグ付きキャッシュ状態に基づいて下位レベル・キャッシュへの参照なしに相互接続ファブリック上にリクエストを送出するためのデータ処理システム、キャッシュ・システム、および方法 - 特許庁
  • CACHE DEVICE, SEMICONDUCTOR DEVICE, MICROCOMPUTER, AND ELECTRONIC EQUIPMENT
    キャッシュ装置、半導体装置、マイクロコンピュータ及び電子機器 - 特許庁
  • METHOD AND DEVICE FOR CALCULATING CACHE SERVER PERFORMANCE VALUE AND STORAGE MEDIUM STORED WITH CACHE SERVER PERFORMANCE VALUE CALCULATING PROGRAM
    キャッシュサーバ性能値算出方法及び装置及びキャッシュサーバ性能値算出プログラムを格納した記憶媒体 - 特許庁
  • Higher cache hit rates are thus possible in cache areas corresponding to communication ports 41 producing larger measured values.
    この結果、測定値がより大きい通信ポート４１に対応するキャッシュ領域でのキャッシュヒット率が高まる。 - 特許庁
  • FLASH CONTROL CIRCUIT FOR CACHE MEMORY AND ITS CONTROL METHOD
    キャッシュメモリのフラッシュ制御回路及びその制御方法 - 特許庁
  • BANK CONTROL CIRCUIT AND CACHE MEMORY DEVICE AND METHOD FOR DESIGNING CACHE MEMORY DEVICE AND METHOD FOR DESIGNING MICROPROCESSOR
    バンク制御回路及びキャッシュメモリ装置、並びにキャッシュメモリ装置の設計方法及びマイクロプロセッサの設計方法 - 特許庁
  • To improve a cache hit rate in a cache device for reading and caching contents from a large scaled database.
    大規模なデータベースからその内容を読み出してキャッシュするキャッシュ装置において、キャッシュヒット率を向上させる。 - 特許庁
  • The second directory manages the cache state of the other node.
    第二のディレクトリは、他ノードのキャッシュ状態を管理する。 - 特許庁
  • A data cache control 330 controls the data cache memory based on the line size stored in the register 301.
    データキャッシュコントロール３３０は、レジスタ３０１に格納されているラインサイズに基づいて、データキャッシュメモリを制御する。 - 特許庁
  • When a cache line referred to is corrected in a local cache (a cache subsystem, corresponding to the processor under execution of instructions), it is written back to a main memory.
    参照されたキャッシュ・ラインがローカル・キャッシュで修正されている場合（命令実行中のプロセッサに対応するキャッシュ・サブシステム）、それはメイン・メモリにライトバックされる。 - 特許庁
  • To make efficient cache access performable by improving a reply data registering method when a cache mistake happens.
    キャッシュミス時におけるリプライデータの登録方法を改善することにより、効率のよいキャッシュアクセスを可能とする。 - 特許庁
  • To provide a compiler capable of arranging a variable on a cache for making the cache available effectively.
    キャッシュを有効に利用可能なように変数をキャッシュ上に配置することができるコンパイラを提供すること。 - 特許庁
  • The disk array controller 100 is provided with a plurality of data cache memory parts 105-1 to 105-3 and a parity cache memory part 106.
    ディスクアレイ制御装置100 内には、複数個のデータキャッシュメモリ部105-1 〜105-3 と、パリティキャッシュメモリ部106 とが設けられている。 - 特許庁
  • When the cache hit is performed, the second processor (16) transfers data to a buffer memory (17) from a cache memory 130.
    キャッシュヒットしていれば、第二のプロセッサ（１６）は、キャッシュメモリ（１３０）からバッファメモリ（１７）にデータを転送する。 - 特許庁
  • LIBRARY SYSTEM, VIRTUAL LIBRARY APPARATUS AND CACHE RECOVERY METHOD
    ライブラリシステム，仮想ライブラリ装置，及びキャッシュ復元方法 - 特許庁
  • STORAGE CLUSTER SYSTEM HAVING CACHE CONSISTENCY GUARANTEE FUNCTION
    キャッシュ一貫性保証機能を有するストレージクラスタシステム - 特許庁
  • CACHE SYSTEM, CACHE DEVICE, PACKET PROCESSOR, CACHING METHOD, PACKET PROCESSING METHOD, CACHING PROGRAM, AND PACKET PROCESSING PROGRAM
    キャッシュシステム、キャッシュ装置、パケット処理装置、キャッシュ方法、パケット処理方法、キャッシュプログラム、およびパケット処理プログラム - 特許庁
  • The cache includes a data storage and a tag storage.
    キャッシュは、データ記憶装置及びタグ記憶装置を含む。 - 特許庁
  • An L1 cache 18 receives an instruction from an external memory.
    Ｌ１キャッシュ１８は外部メモリから命令を受け取る。 - 特許庁
  • When the cache server can retrieve contents corresponding to the contents request, the cache server transfers the contents to the router.
    キャッシュサーバでは、コンテンツ要求に対応するコンテンツを、検索できた場合には、該ルータにコンテンツを転送する。 - 特許庁
  • An initializer reads the cache initialization record and initializes the cache entry by a record including an effective address-way pair.
    イニシャライザは、キャッシュ初期化記録を読み出し、有効なアドレス−ウェイペアを含む記録でキャッシュエントリを初期化する。 - 特許庁
  • An explosion atop a chemical weapons cache is easy to explain.
    化学兵器の隠し場所を 説明するのは簡単よ - 映画・海外ドラマ英語字幕翻訳辞書
  • cache lifetime in seconds (since 1.6.0beta 1, you can use a null value for an eternal cache lifetime)
    キャッシュ生存期間を秒単位で指定します(1.6.0beta 1以降、無期限のキャッシュ生存期間を表す null値が利用可能です) 。 - PEAR
  • An optimized cache is also available for both parts.
    その両方で、最適化されたキャッシュが使用可能です。 - PEAR
  • If filename is omitted, it will check the whole cache entries.
    もしfilenameがなければ、全てのキャッシュエントリをチェックします。 - Python
  • CACHE MEMORY DIVIDED MANAGEMENT METHOD IN DISK ARRAY DEVICE
    ディスクアレイ装置におけるキャッシュメモリ分割管理方式 - 特許庁
  • An instruction to start a branch resolution routine of, for example, loading a branch destination cache block 42 is embedded in each branch position of the cache blocks 42 to another cache block 42.
    各キャッシュブロック４２の他のキャッシュブロック４２への分岐位置には、分岐先のキャッシュブロック４２のロード等の処理を行う分岐解決ルーチンを起動する命令を埋め込む。 - 特許庁
  • To make an instruction code and data, which should be reside, resident in a cache memory 3 to improve a cache hit.
    キャッシュヒットを向上させるために、常駐させるべき命令コードやデータをキャッシュメモリ３に常駐させる。 - 特許庁
  • Additionally, the cache controller is composed so that at least one memory request is made to be bypassed the cache memory by processing cache activity information.
    追加的には、キャッシュ活動情報を処理することによって、少なくとも１つの前記メモリリクエストが、前記キャッシュメモリをバイパスさせられるように、前記キャッシュコントローラが構成される。 - 特許庁
  • The decompressed data stored in the cache memory 100 is transferred to the main memory 300 by a cache memory controller 150.
    キャッシュメモリ１００に格納された伸長データは、キャッシュメモリコントローラ１５０によりメインメモリ３００に移動される。 - 特許庁
  • CACHE MEMORY CONTROLLER, AND GAME DEVICE USING THE SAME
    キャッシュメモリ制御装置及びそれを利用したゲーム装置 - 特許庁
  • METHOD AND SYSTEM FOR RENEWING CACHE OF WEB DATA
    Ｗｅｂデータのキャッシュ更新方法およびキャッシュ更新システム - 特許庁
  • The multi-core CPU 4 has: a cache balance controller 13 for moving the information between the cache memories 7, 8 so as to average the cache use amount of each cache memory 7, 8 by referring to the balance information; and a cache write restoration controller 14 for restoring the circuit data stored in the cache memories 7, 8 into the DRAM 6 after the information is moved.
    マルチコアＣＰＵ４は、バランス情報を参照してキャッシュメモリ７，８のキャッシュ使用量を平均化するようにキャッシュメモリ７，８間で情報を移動させるキャッシュバランス制御部１３と、その情報の移動が行われた後に、キャッシュメモリ７，８に記憶されたキャッシュデータをＤＲＡＭ６に書き戻すキャッシュ書き戻し制御部１４とを有している。 - 特許庁
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