「Cache」を含む例文一覧(5775)

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  • The valid bits prevent the update or invalidation of plural storage in an already invalidated cache line.
    有効ビットは、すでに無効なキャッシュラインに対する複数の記憶の更新および無効化を防止する。 - 特許庁
  • To provide a cache system and a processing device with rapid operation speed while reducing consumption power.
    消費電力を削減するとともに、動作速度が速いキャッシュシステムおよび処理装置を提供すること。 - 特許庁
  • To cache a file registered in a file server from the initial stage of a registration.
    ファイルサーバに登録されるファイルをその登録の初期の段階からキャッシングすることができるようにする。 - 特許庁
  • The information cache server 4 stores the information acquisition conditions by clients 3.
    情報キャッシュサーバ４は、情報ごとに設定された情報取得条件をクライアント３ごとに記憶する。 - 特許庁
  • CACHE MEMORY CONTROLLER AND CONTROL METHOD, CENTRAL PROCESSOR AND PROCESSING METHOD, AND INFORMATION PROCESSOR
    キャッシュメモリ制御装置、キャッシュメモリ制御方法、中央処理装置、情報処理装置、中央処理方法。 - 特許庁
  • An application accesses data through a reference table to always freely read the data into a concentrated cache.
    アプリケーションは、参照テーブルを介してデータにアクセスして、常に自由に集中キャッシュ内のデータを読み込む。 - 特許庁
  • To cache data by appropriately combining a use frequency of a client and an update frequency on a server.
    クライアントの利用頻度とサーバ上の更新頻度を適切に組み合わせてデータをキャッシュできるようにする。 - 特許庁
  • A function for guaranteeing the coherency of cache memories 120 and 220 is added to a system bus-I/O bus bridge 300.
    キャッシュ１２０，２２０のコヒーレンシを保証する機能を、システム・バス−Ｉ／Ｏバス・ブリッジ３００に付加する。 - 特許庁
  • A system component connected with the bus mechanism is provided with a logic for specifying a cache coherence policy.
    バスメカニズムへ結合されているシステムコンポーネントはキャッシュコヒーレンスポリシィを特定する論理を有している。 - 特許庁
  • Upon the critical I/O request, a response uses cache-resident data 33 on the CM 130.
    クリティカルＩ/Ｏ要求時には、ＣＭ１３０上のキャッシュ常駐化データ３３を用いて応答する。 - 特許庁
  • To provide improved cache buffer control for a storage device having a nonvolatile memory medium.
    不揮発性メモリ媒体を有する記憶装置に対して改善されたキャッシュ・バッファ制御を提供する。 - 特許庁
  • The NVM cache 208 is used by this computer when a network is temporarily unavailable or slow.
    ＮＶＭキャッシュ２０８は、ネットワークが一時的に利用できないときや遅いときに、コンピュータが使用する。 - 特許庁
  • Data input from a host is transferred to and stored in a prescribed area 3A of the cache memory 2.
    ホスト３から入力されたデータは、キャッシュメモリ２の所定領域３Ａに転送されて記憶される。 - 特許庁
  • A history of retrieval conditions is analyzed and indices providing the higher hit rate of a cache are selected and retained.
    検索条件の履歴を解析し、キャッシュのヒット率が高くなるインデックスを選択して保持する。 - 特許庁
  • Data read from an optical disk 10 and prefetched cache data are temporarily stored in a buffer memory 38.
    光ディスク１０から読み出したデータ及び先読みしたキャッシュデータをバッファメモリ３８に一時保存する。 - 特許庁
  • To improve performance by distributing the loads of a whole system while maintaining the cache hit rate of a storage device.
    ストレージ装置のキャッシュヒット率を保ちながら、システム全体の負荷を分散して性能を向上させる。 - 特許庁
  • The inconsistency detection part (25) detects inconsistency of a cache memory (22) at the timing of the occurrence of memory access.
    不一致検出部（２５）は、メモリアクセスの発生を契機としてキャッシュメモリ（２２）のデータ不一致を検出する。 - 特許庁
  • Nodes (100, 200, and 300) of a multi-node system include shared cache memories (104, 204, and 304).
    マルチノードシステムにおけるノード（１００、２００、３００）は、共有キャッシュメモリ（１０４、２０４、３０４）を含む。 - 特許庁
  • In a multi-processor system constituted of cards (#0)1 and (#1)2, a cache status PE(Pseudo-Exclusive) showing such a status that a cache line size write is ready while the data are invalid is newly added to a cache status MESI, and a protocol on the system interface for shifting to this status is decided.
    カード（＃０）１，（＃１）２からなるマルチプロセッサシステムでは、キャッシュステータスＭＥＳＩに、データは無効であるが、キャッシュラインサイズライトはいつでも実施できるという状態を示すキャッシュステータスＰＥ（Ｐｓｅｕｄｏ−Ｅｘｃｌｕｓｉｖｅ）を新たに加え、この状態に遷移させるためのシステムインタフェース上のプロトコルを取り決めている。 - 特許庁
  • To provide an image forming apparatus that easily deletes unnecessary cache information relating to web applications.
    ウェブアプリケーションに関する不要なキャッシュ情報を容易に削除できる画像形成装置を提供する。 - 特許庁
  • At the time of writing the contents of a core RAM in the core cache 100, when it is indicated that the entry for debug of the core ROM is already held in the entry for holding the contents of the core RAM of the core cache 100 by the core debug information array 7, the writing of the contents of the core RAM in the core cache 100 is suppressed.
    コアキャッシュ１００にコアＲＡＭの内容を書き込む場合に、コアデバック情報アレイ７により、コアキャッシュ１００のコアＲＡＭの内容を保持させるエントリには既にコアＲＯＭのデバッグ用エントリが保持されていることが示されるとコアＲＡＭ内容のコアキャッシュ１００への書込みを抑止する。 - 特許庁
  • Then, sound data is read out from a disk and the sound data is transferred to the recording area for non-compressed data of the HD via a cache memory 12A and also it is transferred from the cache memory 12A to a compression expansion engine 13 where it is compressed and the compressed sound data is transferred to the recording area for compressed data via a compression cache memory 61.
    その後、ディスクから音声データが読み出され、キャッシュメモリ１２Ａを介してHDの非圧縮データ用記録領域に転送されるとともに、キャッシュメモリ１２Ａから音声データが圧縮伸長エンジン１３に転送され、そこで圧縮され、圧縮キャッシュメモリ６１を介してHDの圧縮データ用記録領域に転送される。 - 特許庁
  • Any memory that your programs do not actively allocate is used within the FreeBSD kernel as disk cache.
    プログラムが確保しているメモリ以外のすべてのメモリは、 FreeBSDカーネル内でディスクキャッシュとして利用されます。 - FreeBSD
  • The complexity of remote filesystems lies in maintaining cache consistency between the server and its many clients.
    リモートファイルシステムの複雑さは、サーバと多くのクライアントの間のキャッシュの一貫性を維持することにあります。 - FreeBSD
  • Spoofed packet attacks may also be used to overload the kernel route cache.
    偽造パケット攻撃は、カーネルの経路情報キャッシュに過負荷を生じさせるために用いられることもあります。 - FreeBSD
  • creates the necessary links and cache to the most recent shared libraries found in the directories specified on the command line, in the file /etc/ld,
    は最新の共有ライブラリに対して必要なリンクを作成したり、ライブラリをキャッシュしたりする。 - JM
  • PORTAL SERVER AND CACHE SERVER IN CONTENT DISTRIBUTION SYSTEM, AND CONTENT DISTRIBUTION METHOD AND CONTENT DISTRIBUTION PROGRAM
    コンテンツ配信システムにおけるポータルサーバおよびキャッシュサーバ、ならびにコンテンツ配信方法、コンテンツ配信プログラム - 特許庁
  • The shift register 6 retains the results 18 of cache accesses sequentially inputted in synchronism with clock signals 1.
    シフトレジスタ６は、クロック信号１と同期して順次入力されるキャッシュアクセスの結果１８を保持する。 - 特許庁
  • A cache flash device 100 sends a read request concerning modified data only to a processor bus 10.
    キャッシュフラッシュ装置１００は、モディファイドデータについてのリード要求をプロセッサバス１０だけに対して送る。 - 特許庁
  • A peripheral read cache macro 106 monitors access from a CPU 101 to peripheral registers 151.
    周辺リードキャッシュマクロ１０６は、ＣＰＵ１０１による周辺レジスタ１５１に対するアクセスを監視する。 - 特許庁
  • To effectively suppress any influence of cache miss, in a processor for simultaneously executing a plurality of programs.
    複数のプログラムを同時に実行するプロセッサにおいて、キャッシュミスによる影響をより効果的に抑える。 - 特許庁
  • PREDICTION TYPE CACHE METHOD FOR CACHING INFORMATION HAVING HIGH POSSIBILITY OF BEING USED, AND ITS SYSTEM AND ITS PROGRAM
    利用される可能性の高い情報をキャッシュする予測型キャッシュ方法、そのシステム及びそのプログラム - 特許庁
  • A main controller 125a writes data transferred from a data transfer circuit into a cache memory 124-1.
    主コントローラ１２５ａは、データ転送回路から転送されたデータをキャッシュメモリ１２４−１に書き込む。 - 特許庁
  • A cache memory 3 temporarily stores the write data transmitted to a storage 5 by a unit of page from a host device.
    キャッシュメモリ３はホスト装置からページ単位でストレージ５に送られるライトデータを一時的に格納する。 - 特許庁
  • To cache data without overflows in a portable telephone set on which a browser is loaded.
    ブラウザを搭載した携帯電話機において、オーバーフローすることなくデータをキャッシュすることを可能にする。 - 特許庁
  • To provide a method for executing a real time task by a digital signal processing processor using a cache memory.
    キャッシュメモリを使用するデジタル信号処理プロセッサにより、リアルタイムタスクを実行する方法を提供する。 - 特許庁
  • Also, when a power source abnormality signal is input, all data in the cache are rewritten in the external memory.
    また、電源異常信号が入力されると、キャッシュ中の全てのデータを外部メモリに書き戻す。 - 特許庁
  • To validly utilize the resources of a limited L2 cache, and to eliminate the rewrite of unnecessary data.
    限られたＬ２キャッシュ１３ａの資源を有効に活用し、不必要なデータの書き戻しをなくすこと。 - 特許庁
  • ROUTE DECIDING DEVICE FOR ROUTER HAVING CACHE AND MACHINE READABLE RECORDING MEDIUM WITH PROGRAM
    キャッシュを有するルータの方路決定装置及びプログラムを記録した機械読み取り可能な記録媒体 - 特許庁
  • To sufficiently validly use cache resources for improving the processing speed of a program.
    プログラムの処理速度が向上させるために、キャッシュ資源を十分有効に使用するできるようにする。 - 特許庁
  • To provide a cache controller for improving latency caused by access to a remote memory.
    リモートメモリに対するアクセスで生じるレイテンシを改善することができるキャッシュ制御装置を提供する。 - 特許庁
  • The database in the storage unit 6 is sorted based on the time information of the contents (cache in information or the like).
    次に、ストア装置６内のデータベースをコンテンツの時間情報（キャッシュイン情報等）に基づいてソートする。 - 特許庁
  • A fragmentation detection part 1D detects the degree of fragmentation of data arrangement according to a cache hit ratio.
    断片化検出部１Ｄは、キャッシュヒット率に応じて、データ配置の断片化の程度を検出する。 - 特許庁
  • To provide an image processing device smoothly performing a data transfer from a cache memory to a main memory.
    キャッシュメモリからメインメモリへのスムーズなデータ転送を行うことができる画像処理装置を提供する。 - 特許庁
  • PROCESSING METHOD OF WWW SERVER USING DIFFERENCE CACHE AND WWW BROWER, AND PROGRAM THEREFOR
    差分キャッシュを用いたＷＷＷサーバとＷＷＷブラウザの処理方法、およびそのプログラム - 特許庁
  • An address decoder operates at the upper level cache in parallel and can satisfy plural simultaneous memory demands.
    アドレス・デコーダは上位レベルのキャッシュで並列に動作して、複数の同時メモリ要求を満たすことができる。 - 特許庁
  • The processors have volatile cache memories to be operated in a virtual address space larger than an actual address space.
    処理装置は、実アドレス空間より大きい仮想アドレス空間で動作する揮発性キャッシュ・メモリを有する。 - 特許庁
  • An arithmetic unit includes the partial coincidence/partial output cache for the computer arithmetic operation.
    本発明による演算装置はコンピュータ算術演算のための部分一致部分出力キャッシュを含む。 - 特許庁
  • The router device manages the IPv6 addresses of the subscriber terminals and the link layer address using the neighbor cache.
    ルータ装置は、加入者端末のＩＰｖ６アドレス及びリンク層アドレスを近隣キャッシュを用いて管理する。 - 特許庁
  • A scheduler 15 executes the scheduling by utilizing the queue state information stored in the cache memory 14.
    スケジューラ１５は、キャッシュメモリ１４に格納されているキュー状態情報を利用してスケジューリングを行う。 - 特許庁
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