「Control Memory」を含む例文一覧(13716)

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  • A post-processing circuit 24 executes post-processing in synchronization with a clock frequency of 125 MHz to the raw image data extracted by the memory control circuit 20a.
    後処理回路24は、125MHzのクロック周波数に同期した後処理をメモリ制御回路20aによって抽出された生画像データに対して実行する。 - 特許庁
  • The cache memory control section 20 compares contents of the key value register 40 with contents of the privacy protection attribute storage sections 25a to 25d to perform identity discrimination processing of the execution codes and the data.
    キャッシュメモリ制御部20は、鍵値レジスタ40と秘密保護属性保持部25a〜25dを比較することにより実行コード及びデータの同一判定処理を行う。 - 特許庁
  • To provide a multi-path accessible semiconductor memory device having mailbox area for embodying and controlling a mailbox access path, and a mailbox access control method conforming thereto.
    メールボックスアクセスパスを具現及び制御するためのメールボックス領域を有するマルチパスアクセス可能な半導体メモリ装置及びそれに従うメールボックスアクセス制御方法を提供する。 - 特許庁
  • PRINTING CONTROL APPARATUS AND DATA-PROCESSING APPARATUS AND METHOD FOR CONTROLLING PRINTING AND METHOD FOR DISPLAYING PRINTER INFORMATION AND MEMORY MEDIUM STORING COMPUTER READABLE PROGRAM
    印刷制御装置およびデータ処理装置および印刷制御方法およびプリンタ情報表示方法およびコンピュータが読み出し可能なプログラムを格納した記憶媒体 - 特許庁
  • Two or more picture patterns 51 to 56, sprite pictures in a background and the coordinates of respective apexes A, B, C and D of a reel display window 6 are stored in a memory of a picture display control part.
    複数の絵柄51〜56や背景のスプライト画像、およびリール表示窓6の各頂点A、B,C,Dの座標を、画像表示制御部のメモリに保存しておく。 - 特許庁
  • A main control part 202 of a server 2 delivers a java applet 204a stored in an applet memory 204 to a requester according to the access request from the client system 3.
    サーバ2の主制御部202は、クライアントシステム3からのアクセス要求に応じアプレット記憶部204に記憶されているJavaアプレット204aを要求元に配信する。 - 特許庁
  • A nonvolatile semiconductor memory device comprises a gate stack which has a tunnel oxide film, a floating gate, an interlayer insulating film, and a control gate sequentially formed on a semiconductor substrate.
    半導体基板上にトンネル酸化膜、フローティングゲート、層間絶縁膜及びコントロールゲートが順次に形成されたゲートスタックを含む不揮発性半導体メモリ素子である。 - 特許庁
  • A precache control part 110 automatically downloads a Web page of the Web site previously associated to a spot matched with a prescribed condition to a page cache memory 111.
    プリキャッシュ制御部110は、所定の条件にマッチする地点と予め関係づけられているWebサイトのWebページを自動的にページキャッシュメモリ111にダウンロードする。 - 特許庁
  • The image processing apparatus having a system control board 30 for performing image processing comprises an image memory 4 for storing data processed by the system board 30.
    画像処理を行うシステム制御ボード30を有する画像処理装置であって、システム制御ボード30による処理されるデータを格納する画像メモリ4を備える。 - 特許庁
  • A data bus control circuit 13 is provided to switch a data transmission circuit in the data bus coupled to the memory cell array on the basis of the result of the address decoder.
    上記アドレスデコーダのデコード結果に基づいて、上記メモリセルアレイに結合されたデータバスにおけるデータ伝達路の切り替えを可能とするデータバス制御回路(13)を設ける。 - 特許庁
  • This turbine engine stator assembly body 18 includes a shroud 20 movable in the radial direction and a gap control member 28 made of at least one shape memory alloy (SMA).
    本タービンエンジンステータ組立体(18)は、半径方向に可動のシュラウド(20)と、少なくとも1つの形状記憶合金(SMA)で作られたギャップ制御部材(28)とを含む。 - 特許庁
  • The CPU 25 updates software stored in the nonvolatile memory 23, to the received update software file only when the control information shows the identification information.
    CPU25は、制御情報が識別情報を示す場合のみ、不揮発性メモリ23に格納されているソフトウェアを、その受け付けられた更新ソフトウェアファイルに更新する。 - 特許庁
  • The memory 113 has a storing area for a program for performing a crank call control incoming processing in addition to a programs for performing each function of the terminal.
    メモリ113には端末の各機能を実行するためのプログラムのほか、迷惑電話制御着信処理を実行するプログラムのための記憶エリアが設けられている。 - 特許庁
  • This non-volatile semiconductor memory is provided with a boosting circuit 2 generating boosting voltage Vr, a control circuit 3 controlling the boosting circuit 2, and a comparator 4.
    本発明の不揮発性半導体メモリは、昇圧電圧Vrを生成する昇圧回路2と、昇圧回路2を制御する制御回路3と、コンパレータ4とを備える。 - 特許庁
  • This non-volatile memory element has a plurality of first semiconductor layers, a plurality of second semiconductor layers, a plurality of first storage nodes and a plurality of first control gate electrodes.
    本発明の不揮発性メモリ素子は、複数の第1半導体層、複数の第2半導体層、複数の第1ストレージノード、及び複数の第1制御ゲート電極を備える。 - 特許庁
  • The nonvolatile memory comprises a tunnel insulation film pattern 116, a charge storage film, an upper insulation film and a control gate electrode 175 formed sequentially on a semiconductor substrate 100.
    この装置は、半導体基板100の上部に順次に積層されたトンネル絶縁膜パターン116、電荷貯蔵膜、上部絶縁膜及び制御ゲート電極175を含む。 - 特許庁
  • This semiconductor memory has an initial stage circuit, a timing control circuit a synchronizing circuit, and an internal signal generating circuit generating an internal clock FICLK and ICLK.
    本発明の半導体記憶装置は、初段回路、タイミング制御回路、及び同期回路を有し内部クロックFICLK及びICLKを生成する内部信号生成回路を有する。 - 特許庁
  • A user process 10b being the destination of transmission receives the message identifier from the communication control process 28, and reads the message corresponding to the message identifier from the shared memory.
    送信先のユーザプロセス10bは、通信制御プロセスからメッセージ識別子を受信すると、このメッセージ識別子に対応するメッセージを共有メモリから読み出す。 - 特許庁
  • A switch control circuit controls an operation of the precharge switches and sets a cutoff function that turns off connection switches in a standby period in which no access operation of the memory cells is performed.
    スイッチ制御回路は、プリチャージスイッチの動作を制御するとともに、メモリセルのアクセス動作が実行されないスタンバイ期間に、接続スイッチをオフする遮断機能を設定する。 - 特許庁
  • The system to control the semiconductor memory is required to surely specify predetermined bits and the command to set up the mode register to generate soft reset signals.
    本発明では、ソフトリセット信号を生成するために、半導体メモリを制御するシステムは、モードレジスタの設定コマンドとともに所定のビットを必ず指定する必要がある。 - 特許庁
  • The clock control circuit 20 outputs any one of a plurality of clock signals CLK1 to CLKn as an operation clock signal SCLK of a DDR memory 1.
    クロック制御回路20は、複数のクロック信号CLK1〜CLKnのうちいずれか1つをDDRメモリ1の動作クロック信号SCLKとして出力する。 - 特許庁
  • When a user sets the image quality priority mode, the control part 10 waits for printing or processing for transmission/reception of FAX until the hardware resource of the page memory part 13 is secured.
    ユーザが「画質優先モード」を設定している場合、制御部10は、ページメモリ部13のハードウェアリソースが確保されるまで印刷あるいはFAX送受信の処理を待つ。 - 特許庁
  • Data are temporarily kept in a line memory in a video data storage portion provided to the video data control circuit before the data are converted into digital video data for displaying in a prescribed digital gray scale.
    所定のデジタル階調で表現するデジタルビデオデータに変換する前にビデオデータ制御回路に設けられたビデオデータ格納部のラインメモリに一旦データを保持する。 - 特許庁
  • To perform refresh operation without being watched from the outside in a semiconductor integrated circuit having a memory cell consisting of capacitors and its control method.
    本発明は、キャパシタからなるメモリセルを有する半導体集積回路およびその制御方法に関し、リフレッシュ動作を外部から見えることなく実行することを目的とする。 - 特許庁
  • Specifically, when threshold control ions are implanted in a channel region, impurities having concentration different from a memory cell or impurities having different conductivity types are ion implanted.
    具体的には、チャネル領域へのしきい値制御用イオン注入を行なう際に、メモリセルと異なる不純物濃度に、又は異なる導電型の不純物をイオン注入する。 - 特許庁
  • A download device 49 reads the camera classification information from the non-contract IC memory 31, and specifies a control program to be downloaded based on the classification information.
    ダウンロード装置49は、非接触型ICメモリ31から前記カメラ種別情報を読み取り、この種別情報に基づいてダウンロードすべき制御プログラムを特定する。 - 特許庁
  • The system 12 is equipped with a passive type operator-specifying device 32 having a first security code and a theft control unit 22 including a memory 29 to store a second security code.
    セキュリティ・システム22は更に、第1セキュリティ・コードを持つ受動形操作者特定装置32及び、第2セキュリティ・コードを記憶するメモリー29を含む盗難制御ユニット22を、含む。 - 特許庁
  • To provide a controller, such as PC to which an image pickup module having an image recording memory is connectable and to provide a control method for the image pickup module in the controller.
    画像記録用メモリーを有する撮像モジュールを接続可能なPC等の制御装置、及び制御装置における撮像モジュールの制御方法を提供すること。 - 特許庁
  • The electronic equipment 200 is provided with a voice signal generator 210 for generating a voice signal; a memory 220 for storing first volume specifications; and a volume control device 230.
    電子機器200は、音声信号を生成させる音声信号発生器210と、第1の音量規格を記憶させるメモリ220と、音量制御装置230とを有する。 - 特許庁
  • To provide a communication control apparatus and method whereby the parallel processing capability of hardware can be developed, the memory management method can be simplified, and transmission data can be outputted as frames at a high speed.
    ハードウェアが持つ並列処理能力を発揮でき、メモリ管理方法も単純化され、高速に送信データをフレームとして出力することを課題とする。 - 特許庁
  • A control unit is configured to copy laser process conditions stored in a memory unit, and to display a list of the laser process conditions on a display screen 41 for each of set data.
    制御部は、記憶装置に記憶されたレーザ加工条件を複製するとともに、レーザ加工条件を設定データ毎に表示画面41に一覧表示するようにした。 - 特許庁
  • The control part 6 controls a video recording and reproduction part 4 to record video compressed data to be reproduced that the large-capacity memory 3 stores on a recording medium.
    また、制御部6は、映像記録再生部4を制御し、大容量メモリ3が記憶している再生対象の映像圧縮データを記録媒体に記録する。 - 特許庁
  • To provide a Win control system of TCP which suppresses surplus traffic, requires irreducible necessary memory capacity, and has a small CPU load even when applied to an apparatus having small resources.
    低資源の装置であっても、余剰なトラフィックを抑制し、必要最小限のメモリ量で、CPU負荷の少ないTCPのWin制御方式を実現すること。 - 特許庁
  • To provide a control device for a variable valve train, capable of properly determining whether the displacement of the variable valve train stored in a volatile memory disappears or not.
    揮発性メモリに記憶される可変動弁機構の変位量が消失したか否かを適切に判定することのできる可変動弁機構の制御装置を提供する。 - 特許庁
  • A BHT 1 is mainly constituted of a terminal control circuit 6 and comprises an optical reader 7, a wireless LAN communication section 10, an infrared communication section 11, a memory 12 and the like.
    BHT1には、端末制御回路6を主体として光学読取部7、無線LAN通信部10、赤外線通信部11、メモリ12などが設けられる。 - 特許庁
  • The extracted amplitude value is once stored in the memory in the control circuit and then, approximate cubic curve is determined on the basis of a well-known method of least square (S4).
    抽出された振幅値は一旦制御回路内のメモリに記憶され、続いて公知の最小二乗法に基づいて近似する3次曲線を決定する(S4)。 - 特許庁
  • To provide a control computer without requiring an external memory means such as a hard disk, facilitating to extend the length of a connection cable.
    ハードディスク等のような記憶手段を必要とせず、また、接続ケーブルを長くすることが容易な制御用コンピュータを提案することを目的としてなされたものである。 - 特許庁
  • Then, in the prize management device 5, regarding such a prize, a control part 50 performs exchange processing on the basis of the combination prize information stored in the memory part 52.
    そして、景品管理装置5では、このような景品については、制御部50が、メモリ部52に記憶された組み合わせ景品情報に基づいて交換処理を行う。 - 特許庁
  • The telephone system comprises: an information processing control section 1a; an entry section 2; a microphone 3; a speaker 4; a display apparatus 5; a communication section 6; a toll station number data storage section 7; and a memory 8.
    電話装置は、情報処理制御部1a、入力部2、マイク3、スピーカ4、ディスプレイ5、通信部6と、市外局番データ記憶部7、メモリ8とから構成される。 - 特許庁
  • An electric current control means 28 corrects the basic assist electric current by adding the electric current correction quantity memorized in the electric current correction quantity memory means 37 to the basic assist electric current.
    電流制御手段28は、電流補正量記憶手段37に記憶されている電流補正量を基本アシスト電流に付加して基本アシスト電流を補正する。 - 特許庁
  • By control of a CPU 5, a division code to be executed is sent to the information processing apparatus 1, and the code processed by the information processing apparatus 1 is developed (loaded) in a memory 7.
    CPU5の制御により、実行される分割コードが情報処理装置1に送られ、情報処理装置1によって処理されたコードが、メモリ7に展開(ロード)される。 - 特許庁
  • The control device 19 collates the specific code signal from the key with a certified code stored in a certified code memory 20, and when both coincide with each other, an electric power source ON signal is made valid.
    制御装置は、キーからの特定コード信号を認証コードメモリ20に格納された認証コードと照合し、両者が一致したときに電源オン信号を有効化する。 - 特許庁
  • The station operation system in one embodiment includes an issuance part, a first memory part, a first distribution processing part, a second distribution processing part, a determination part and a passage control part.
    一実施形態に係る駅務システムは、発行部と、第1の記憶部と、第1の配信処理部と、第2の配信処理部と、判定部と、通行制御部とを備える。 - 特許庁
  • A recording and reproducing device includes read/write control means for performing a writing process of information concerning contents transmitted from a higher-level CPU section 2 into an optical disk 24 and a nonvolatile memory 23.
    上位CPU部2から送信されるコンテンツに関する情報を光ディスク24に書き込む処理を行うリードライト制御手段と、不揮発性メモリ23を備えている。 - 特許庁
  • The color parts stored in the memory are allocated at a print position on a recording paper, based on data written in the copy control table (step 318), and the color parts are collectively copied (step 320).
    コピー制御テーブルに書込まれたデータをもとに、メモリに記憶されたカラー部を記録紙上の印刷位置に割当て(ステップ318)、カラー部をまとめてコピーする(ステップ320)。 - 特許庁
  • To provide a control unit for a vehicle for enhancing reliability in rewriting a program in nonvolatile memory, and increasing the flexibility of process settings in a manufacturing line and a maintenance line.
    この発明は、不揮発性メモリのプログラムの書換え時の信頼性を向上し、製造ラインや整備ラインでの工程設定の自由度を増すことを目的とする。 - 特許庁
  • A read position control section 30 controls an address of a read image from a memory section 12 based on the obtained hand shake vector to reproduce image data shifted by the hand shake vector.
    得られた手振れベクトルに基づいて、読み出し位置制御部30でメモリ部12からの画像読み出しアドレスを制御して、手振れベクトル分ずれた画像データを再生する。 - 特許庁
  • The control part 40 issues a command to a processing part 30 and an OSD memory 36 to output to a driving circuit 32 a signal for projecting a cross marker for focusing.
    制御部40は、処理部30およびOSDメモリ36に指令を出して、焦点調節用のクロスマーカを投射させる信号を駆動回路32へ出力させる。 - 特許庁
  • To provide a receiver that can record video information adopting an inter-frame encoding system without the need for addition of a memory with a large capacity and imposing a greater load on a control section.
    大容量のメモリ追加や、制御部に大きな負荷を生じることなく、フレーム間符号化方式の映像情報を記録することが可能な受信装置を提供する。 - 特許庁
  • The sensor A is composed of a computing part, a memory part, a sensor controlling part, a built-in sensor, an external sensor connecting connector, a modulating and demodulating part, a control part, an antenna part, and a battery charger.
    埋め込みセンサーAは、演算部、メモリー部、センサー制御部、内蔵センサー、外装センサー接続コネクター、変復調部、制御部、アンテナ部、充電池で構成する。 - 特許庁
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