Select the Hierarchical Layout button on the Diagram toolbar and click Yes in the Layout warning dialog box.
図ツールバーの「階層型レイアウト」ボタン を選択し、レイアウトの警告ダイアログで「はい」をクリックします。 - NetBeans
From the Layout section of the Palette, drag and drop a Layout Panel component onto the header div in the Visual Designer.
パレットの「レイアウト」セクションから、「レイアウトパネル」コンポーネントをビジュアルデザイナ内の header div にドラッグ&ドロップします。 - NetBeans
This style is called 'the layout of Daian-ji Temple style.'
「大安寺式伽藍配置」と称されている。 - Wikipedia日英京都関連文書対訳コーパス
SEMICONDUCTOR INTEGRATED CIRCUIT LAYOUT DESIGN APPARATUS, SEMICONDUCTOR INTEGRATED CIRCUIT LAYOUT DESIGN METHOD AND PROGRAM 半導体集積回路レイアウト設計装置、半導体集積回路レイアウト設計方法及びプログラム - 特許庁
LAYOUT CHANGING METHOD FOR SEMICONDUCTOR INTEGRATED CIRCUIT, LAYOUT APPARATUS, AND SEMICONDUCTOR INTEGRATED CIRCUIT 半導体集積回路のレイアウト変更方法および、レイアウト装置及び半導体集積回路 - 特許庁
The neighboring Horin-ji Temple (Ikaruga-cho) has the same garan layout, which is called the "Horyu-ji-temple-style garan layout."
近隣の法輪寺(斑鳩町)も同様の伽藍配置で、これを「法隆寺式伽藍配置」という。 - Wikipedia日英京都関連文書対訳コーパス
LAYOUT DESIGN FOR HIGH POWER, GALLIUM NITRIDE BASED FET ハイパワーGaNベースFET用のレイアウトデザイン - 特許庁
METHOD, DEVICE AND PROGRAM FOR PATTERN LAYOUT パターンレイアウト方法、その装置およびそのプログラム - 特許庁
The calculated layout of each roof member defines the layout of each basic roof truss. そして、計算結果による各屋根要素の配置によって基本屋根組の配置が規定される。 - 特許庁
First, the layout after the wiring process is referred to. まず、配線工程後のレイアウトを参照する。 - 特許庁
INTRA-PAGE LAYOUT PROCESSOR FOR INNER BOUND MAGAZINE 中綴式雑誌の頁内割付処理装置 - 特許庁
MOTOR LAYOUT STRUCTURE OF VEHICULAR MIRROR DRIVING DEVICE 車両用ミラー駆動装置のモータ配置構造 - 特許庁
METHOD AND APPARATUS FOR VERIFYING LAYOUT レイアウト検証方法及びレイアウト検証装置 - 特許庁
LAYOUT MODELLING SYSTEM FOR PHYSICAL DISTRIBUTION CONVEYANCE SYSTEM 物流搬送システムのためのレイアウトモデリングシステム - 特許庁
IMAGE LAYOUT DEVICE AND METHOD AND PROGRAM 画像レイアウト装置および方法並びにプログラム - 特許庁
METHOD FOR REUSING DESIGN ASSET OF OPERATIONAL AMPLIFIER, APPARATUS FOR GENERATING LAYOUT, AND PROGRAM FOR GENERATING LAYOUT 演算増幅器の設計資産の再利用方法、レイアウト作成装置およびレイアウト作成プログラム - 特許庁
LAYOUT STRUCTURE OF OUTSIDE AIR INLET DUCT FOR CAR 自動車用外気導入ダクトの配設構造 - 特許庁
To provide a flash memory device having an improved bit-line layout, and a layout method for the flash memory device. ビットラインレイアウトの構造を改善したフラッシュメモリ装置及びそのレイアウト方法を提供する。 - 特許庁
IMAGE LAYOUT APPARATUS AND METHOD, AND PROGRAM 画像レイアウト装置および方法並びにプログラム - 特許庁
To provide a layout analysis program, a layout analysis device and a layout analysis method, in which a text block can be accurately extracted even from a color image. カラー画像であっても高精度でテキストブロックを抽出するレイアウト解析プログラム、レイアウト解析装置、レイアウト解析方法を提供する。 - 特許庁
LAYOUT PLAN CREATION DEVICE AND CREATION METHOD 配置図面作成装置及びその作成方法 - 特許庁
To provide an image layout forming device by which a layout of images can be formed flexibly. 画像のレイアウトをフレキシブルに生成することが可能な画像レイアウト生成装置を提供する。 - 特許庁
To provide a document layout system that is suitable to realize a readable and presentable layout. 読みやすくかつ見栄えのよいレイアウトを実現するのに好適な文書レイアウトシステムを提供する。 - 特許庁
LAYOUT OF DRESSER AND DRESSING ROOM 洗面化粧台及び洗面化粧室のレイアウト - 特許庁
PRINT CONTROL UNIT IN AUTOMATIC LAYOUT PRINTING 自動レイアウト印刷における印刷制御装置 - 特許庁
Specifically, dummy layout hierarchy blocks (representing areas of layout hierarchy blocks at the top level floor planning) are set in place of layout hierarchy blocks. 但し、レイアウト階層ブロックの代わりに、擬似レイアウト階層ブロック(トップレベルのフロアプラン時のレイアウト階層ブロックの領域を示すもの)を設定する。 - 特許庁
LAYOUT SECURITY MANAGEMENT DEVICE AND METHOD, PROGRAM, AND MEDIUM レイアウトセキュリティ管理装置、方法、プログラム、媒体 - 特許庁
A layout and wiring means 2 produces layout data 12 for manufacturing processes based on the net list 11. 配置配線手段2は、ネットリスト11に基づき製造工程用のレイアウトデータ12を生成する。 - 特許庁
Then a layout part 36 lays out the key image and the selected image in the layout area. そして、レイアウト部36が、キー画像および選択された画像をレイアウト領域にレイアウトする。 - 特許庁
GATE ARRAY INTEGRATED CIRCUIT AND ITS LAYOUT METHOD ゲートアレイ集積回路およびそのレイアウト方法 - 特許庁
METHOD FOR PREPARING LAYOUT OF SEMICONDUCTOR INTEGRATED CIRCUIT 半導体集積回路のレイアウト作成方法 - 特許庁
INTEGRATED CIRCUIT DEVICE AND ITS LAYOUT DESIGNING METHOD 集積回路装置とそのレイアウト設計方法 - 特許庁
IMAGING APPARATUS, LAYOUT EDITING METHOD AND PROGRAM 撮像装置、レイアウト編集方法およびプログラム - 特許庁
To provide a layout system with ordering function suitable for improving the efficiency of a series of operations from the layout preparation to the order of a layout. レイアウトの作成からレイアウトの発注までの一連の作業効率を向上するのに好適な発注機能付きレイアウトシステムを提供する。 - 特許庁
DISPLAY DEVICE AND LAYOUT METHOD OF PIXEL CIRCUIT 表示装置および画素回路のレイアウト方法 - 特許庁
The layout of the document can be changed by making the contents group 110 have correspondence to another layout group. レイアウトを変更する場合は、コンテンツグループ110を別のレイアウトグループに対応づければよい。 - 特許庁
PATTERN LAYOUT DEVICE, ITS METHOD AND STORAGE MEDIUM READABLE VIA COMPUTER AND STORING PATTERN LAYOUT PROGRAM パターンレイアウト装置、その方法およびパターンレイアウトプログラムを記録したコンピュータ読取可能な記憶媒体 - 特許庁
Thereafter, a result of the dynamic layout is combined with the partially discarded static layout result. その後、該動的レイアウトした結果を、前記部分的に破棄された静的レイアウト結果に結合させる。 - 特許庁
LAYOUT MODIFICATION METHOD FOR SEMICONDUCTOR INTEGRATED CIRCUIT 半導体集積回路のレイアウト修正方法 - 特許庁
CHECKER BOARD TYPE HIGH-VOLTAGE VERTICAL TRANSISTOR LAYOUT チェッカーボード型高電圧垂直トランジスタレイアウト - 特許庁
The work layout data storage device 101 stores the work layout data, which is the information on the shape, layout or the like of work. 施工物レイアウトデータ格納装置101は、施工物の形状又は配置などに関する情報である施工物レイアウトデータを格納する。 - 特許庁
The library has a plurality of layout patterns and a plurality of mosaic patterns resulting from forming each of the layout patterns into mosaic. ライブラリは、複数のレイアウトパターンとその各々をモザイク化した複数のモザイクパターンとを有する。 - 特許庁
SEMICONDUCTOR DEVICE AND LAYOUT DESIGNING METHOD THEREOF 半導体装置およびそのレイアウト設計方法 - 特許庁
AUTOMATIC LAYOUT METHOD OF SEMICONDUCTOR INTEGRATED CIRCUIT AND AUTOMATIC LAYOUT PROGRAM THEREFOR 半導体集積回路の自動レイアウト方法、及び半導体集積回路の自動レイアウトプログラム - 特許庁
LAYOUT DESIGNING METHOD FOR SEMICONDUCTOR INTEGRATED CIRCUIT 半導体集積回路のレイアウト設計方法 - 特許庁
SEMICONDUCTOR DEVICE AND ITS LAYOUT DESIGNING METHOD 半導体装置及びそのレイアウト設計方法 - 特許庁
To provide a page space layout device capable of performing layout correction concerning any arbitrary area inside a layout page space without mode change. モード変更を行うことなく、レイアウト紙面内の任意領域についてレイアウト修正を行うことができる紙面レイアウト装置を提供する。 - 特許庁
To provide a layout panel storage case capable of storing three or more layout panels. 3枚以上のレイアウトパネルを収納できるレイアウトパネル収納ケースを提供することを課題とする。 - 特許庁
LAYOUT STRUCTURE OF STANDARD CELL, STANDARD CELL LIBRARY AND LAYOUT STRUCTURE OF SEMICONDUCTOR INTEGRATED CIRCUIT 標準セルのレイアウト構造、標準セルライブラリ、及び半導体集積回路のレイアウト構造 - 特許庁