「data buffer」を含む例文一覧(6933)

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  • To provide a buffer which supplies an accurate output voltage irrelevantly to the threshold voltage of a transistor, a data driving circuit using the same, and a light emitting display.
    トランジスターのしきい値電圧と無関係に正確な出力電圧を供給するようにしたバッファー及びこれを利用したデータ駆動回路と発光表示装置を提供する。 - 特許庁
  • In the case that the byte at a present position is not registered in the cache buffer, a RAW command and raw data of 8 bits equal to the byte at the present position following it are outputted (S28).
    現在の位置のバイトがキャッシュバッファに登録されていない場合、ＲＡＷコマンドとそれに後続する現在の位置のバイトに等しい８ビットの生データを出力する（Ｓ２８）。 - 特許庁
  • Further, the control of the select terminal of the buffer circuit 207 is made to be controlled by the output terminal Q of the flip-flop 106 for latching the data switching signal from the SCAN_NT terminal.
    また、そのバッファ回路２０７のセレクト端子の制御が、ＳＣＡＮ＿ＮＴ端子からのデータ切換信号をラッチするフリップフロップ１０６の出力端子Ｑから制御されるよう構成した。 - 特許庁
  • The image processing system includes a camera module for photographing a subject, a CPU for receiving image frame data obtained by photographing, and a frame buffer memory connected to the CPU.
    被写体を撮影するカメラモジュールと、撮影によって得られた画像のフレームデータを受信するＣＰＵと、ＣＰＵに接続されたフレームバッファメモリと、が画像処理システムに設けられている。 - 特許庁
  • Audio sample interpolation processing is executed (step S24), and the interpolated audio sample is output (step 26), until the amount of accumulated data inside the jitter buffer reaches a second jitter threshold.
    このとき、ジッタバッファ内でのデータ蓄積量が第２ジッタ閾値に達するまでの間は、オーディオサンプル内挿処理を実行し（ステップＳ２４）、内挿したオーディオサンプルを出力する（ステップＳ２６）。 - 特許庁
  • Also, the transfer of the data between the encoding/decoding circuit 16 and the 1st error correction circuit 14 or the buffer controller 11 is carried out by a prescribed handshake through a bus.
    また、符号化／復号化回路１６と、第１誤り訂正回路１４やバッファコントローラ１１との間のデータの転送は、バスを介して所定のハンドシェイクにより行うようにした。 - 特許庁
  • A map drawing part 14 reads out height information indicating a height sequence between roads, when high level roads exist passing at positions higher than the running road of driver's own vehicle from a data buffer 10.
    地図描画部１４は、自車の走行道路よりも高い位置を通る高架道路が存在する場合に、各道路の上下関係を示す高さ情報をデータバッファ１０から読み出す。 - 特許庁
  • The tape drive includes: a write control that transfers data from the buffer to the tape medium; and a command queuing function to asynchronously process a plurality of commands issued in succession from the host device.
    バッファから前記テープ媒体へデータを記録する書込み制御と、上位装置からの連続して発行される複数のコマンドを非同期処理するコマンドキューイング機能とを含む。 - 特許庁
  • To provide an image processing apparatus and image processing method capable of suppressing buffer capacity required for rotating image data at any arbitrary angle.
    イメージデータを任意の角度に回転するときの必要とされるバッファの容量を抑えることができる画像処理装置及びその画像処理方法を提供することを目的とする。 - 特許庁
  • A recovery part 103 and a Null packet process 104 temporary store alternative data in the missing packet part in the TTS buffer 105 when the missing packet is detected.
    復元部１０３とＮｕｌｌパケット処理１０４は、欠落したパケットを検出したとき、一時的にＴＴＳバッファ１０５内の欠落したパケット部分に代替データを記憶する。 - 特許庁
  • When the user depresses the shutter key or when 30 seconds elapses after moving picture photographing is started, moving picture data stored in the buffer memory is recorded in the memory card 12.
    そして、ユーザによりシャッターボタンが押下された場合、又は、動画撮影を開始してから３０秒経過した場合には、バッファメモリに記憶されている動画データをメモリ・カード１２に記録する。 - 特許庁
  • By this arrangement, the sorting of ADPCM monaural voice data can be carried out without mounting a large- scale buffer circuit for work needed in the past in a voice processing device.
    このようにすることで、従来必要であった音声処理装置における大規模な作業用のバッファ回路を搭載することなくADPCM モノラル音声データの並べ替えの実行ができる。 - 特許庁
  • When reproducing and displaying images on the device 3, the VGA image is displayed on the device 3, the image data are read into a buffer memory 207 during displaying of the VGA image.
    表示装置３に画像を再生表示する際には、ＶＧＡ画像を表示装置３に表示し、その表示の最中に本画像データをバッファメモリ２０７に読み込むようにした。 - 特許庁
  • The distortion correcting part 2 includes an interpolation relation generating part 12 for performing an interpolation arithmetic operation by using interpolation relations corresponding to density data stored in an input line buffer 8.
    歪補正部２には、入力ラインバッファ８に格納された濃度データに対応する補間関係を用いることにより補間演算する補間関係生成部１２が設けられている。 - 特許庁
  • Then when a system clock 606 is supplied, vertical shift registers 602 and 603 sequentially select columns of pixels to be read through a timing generator 607 and data are sequentially set in an output buffer 604.
    次に、システムクロック606を与えると、タイミングジェネレータ607によって、垂直方向シフトレジスタ602および603は読みだす画素の列を順次選択して出力バッファ604にデータを順次セットする。 - 特許庁
  • A correlation detector 44 continuously generates a correlation coefficient in real time, by correlating the received signal data from the circulation buffer 42 and from the discrete Fourier circuit 46.
    相関検出器４４は、循環バッファ４２及び離散フーリエ回路４６からの受信信号データを基準信号データに相関させて、実時間で相関係数を連続的に発生する。 - 特許庁
  • When following code data are EOB(end of block) codes, by clearing the counter and the tag register, the EOB codes held in the second buffer are selectively outputted from a multiplexer 22.
    続く符号データがＥＯＢ符号の場合、カウンタをクリアしてタグレジスタをクリアすることにより、マルチプレクサから、第２のバッファに保持されているＥＯＢ符号を選択的に出力する。 - 特許庁
  • The printer control part 100 includes a plurality of buffers 10-30 for storing bitmaps as uncompressed data and a buffer manager 1 for managing an allocation of the buffers to the bitmaps.
    プリンタ制御部１００は、非圧縮データであるビットマップを格納する複数のバッファ１０−３０と、ビットマップに対するバッファの割り当てを管理するバッファマネジャ１とを備えている。 - 特許庁
  • To reduce a required buffer amount and to reduce the scale of whole equipment when processing for sharing the same transmission band is performed by plural types of communication data.
    複数種類の通信データで同一の伝送帯域を共有する処理を行う場合に、必要とするバッファ量を削減することができ、これによって装置全体の規模を小さくすること。 - 特許庁
  • To provide a nonvolatile semiconductor memory device permitting program verifying readout by a wired-OR system and capable of efficiently blocking data transmission from a page buffer related to a defect.
    ワイヤードオア方式によるプログラム確認読出しが可能であり、欠陷と関連したページバッファーからのデータ伝送を効率よく遮断できる不揮発性半導体メモリ装置を提供する。 - 特許庁
  • Strictly speaking, ``to marshal'' means to convert some data from internal to external form (in an RPC buffer for instance) and ``unmarshalling'' for the reverse process.
    厳密に言えば、``整列させる (to marshal)'' とは、あるデータを(例えば RPC バッファのように) 内部表現形式から外部表現形式に変換することを意味し、``非整列化 (unmarshalling)'' とはその逆を意味します。 - Python
  • When the CPU receives an output operation request from a printing section (S4: YES), the image string data already written into the line buffer memory is read to be outputted to the printing section (S7).
    そして、ＣＰＵは、印刷部から出力処理要求を受けた際（Ｓ４：ＹＥＳ）、ラインバッファメモリに既に書き込み完了された画像列データを読み出して印刷部へと出力させる（Ｓ７）。 - 特許庁
  • In addition, the data processing part 21 extracts a row of the bit location coinciding in the buffer 23 for detection as contents of the protocol message for each bit length of the particular pattern after detecting the particular pattern.
    更に、データ処理部２１は、特定パターン検出後にプロトコルメッセージの内容として検出用バッファ２３内で一致したビット位置の列を特定パターンのビット長分毎に抽出する。 - 特許庁
  • Also the packet data received under the establishing process temporarily are held in the receiving order onto the buffer 3, and are output after renumbered as the converted packet headers which are read out to be generated after establishment.
    また、確立処理中に受信したパケットデータは、バッファ３に受信順に一時待避し、確立後に読み出して生成された変換パケットヘッダに付け替えて出力する。 - 特許庁
  • When the reproducing start of a track consisting of plural parts dispersedly stored in a mini-disk is instructed, the data are read out successively from a top part to be stored in a semiconductor memory being a read-out buffer memory.
    ミニディスクに分散して記憶された複数のパートからなるトラックの再生開始指示を受けると、先頭のパートから順次データを読み出しバッファメモリである半導体メモリに記憶する。 - 特許庁
  • The buffer memory 106 is a shared memory that is composed of a DRAM, for example, and exchanges (delivers) data between the arithmetic coding/decoding unit 102 and the variable length coding/decoding unit 112.
    バッファメモリ１０６は、例えばＤＲＡＭで構成されていて、算術符号復号部１０２及び可変長符号復号部１１２の間でデータの授受（受け渡し）を行う共有のメモリである。 - 特許庁
  • Thus, the need of executing complex calculation for estimating the size of the processed data block is eliminated, and the overflow of the buffer memory is prevented, and almost all memories are used effectively.
    これにより、処理後のデータ・ブロックのサイズを予測するための複雑な計算を実行する必要がなく、バッファのオーバフローを防止する一方、ほぼ全てのメモリを有効利用できる。 - 特許庁
  • After the imaging past the recording time is elapsed, the data is transferred to the recording medium 30 from the buffer memory 24, by supplying power to the drive system of the recording medium 30.
    記録時間を経過して，撮像を終了した後に、記録媒体３０の駆動系を電力供給状態にして、バッファメモリ２４から記録媒体３０にデータを転送する。 - 特許庁
  • A host computer 10 having an SDRAM I/F and a first data buffer and an SDRAM 12 are connected to a system bus 11, and a NAND flash memory 13 is connected to the system bus 11 through a NAND memory controller 20.
    SDRAM I/F および第１のデータバッファを有するホストコンピュータ１０、SDRAM １２がシステムバス１１に接続され、システムバスにはNANDメモリコントローラ２０を介してNANDフラッシュメモリ１３が接続されている。 - 特許庁
  • To provide an attitude data filter device that does not have singular segments which allows unsuitable smoothing result to be derived, and being capable of enhancing smoothing strength, even if using a small number of buffer stages.
    不適切な平滑化結果が導出される特異区間がなく、また、バッファの段数が少なくても平滑化強度を高めることのできる姿勢データフィルタ装置を提供する。 - 特許庁
  • If the shutter key is continuously depressed, a loop from S104 to S106 is executed a plurality of times, and a plurality of still image data which are consecutive in time are temporarily stored in a buffer memory 11.
    シャッターキーの押下を継続すると、Ｓ１０４〜Ｓ１０６のループが複数回実行され、時間的に連続した複数枚の静止画データがバッファメモリ１１に一時保存される。 - 特許庁
  • In a facsimile equipment 1, reception picture data are decoded by an encoding/decoding part 13 and expanded on a page memory of a buffer memory 16 and is transferred to a plotter 4 and is recorded out by a plotter 4.
    ファクシミリ装置１は、受信画像データを符号化・復号化部１３で復号化してバッファメモリ１６のページメモリに展開した後、プロッタ４に転送してプロッタ４で記録出力する。 - 特許庁
  • When recursively circulating and storing data with respect to the ring buffer, by alternately carrying out a round of storing data from the top address, and a round of storing data from an address position shifted predetermined bytes from the top address of the ring address, newly buffered data is shifted and stored with respect to previously buffered data, and the loss position is grasped by a corrective operation result of the stored data.
    リングバッファに対してデータを再帰的に循環させて格納する際に、リングバッファの先頭アドレスよりデータを格納する周回と、リングバッファの先頭アドレスを所定のバイト分シフトしたアドレス位置からデータを格納する周回と、を交互に実行することで、前回バッファリングしたデータに対して新たにバッファリングしたデータをずらして格納し、該格納されたデータの訂正演算結果により、消失位置を把握する構成とした。 - 特許庁
  • The PCM format speech data is accumulated in an input buffer 1a and an input message queue 1b, and is processed and composited in a speech data processing/compositing section 1c according to output speech edition information, and is then outputted through an output section 1f.
    ＰＣＭフォーマット音声データを入力バッファ１ａ、入力メッセージキュー１ｂに蓄積し、 出力音声編集情報に基づいて音声データ加工・合成部１ｃにて加工及び合成した後、出力部１ｆを介して出力する。 - 特許庁
  • An extraction part extracts the required data by searching in the range determined by the search range determination part out of an entire range of the ring buffer 23 and copies the extracted required data to the area of the work memory 24 secured by the area securing part.
    抽出部は、リングバッファ２３の全範囲のうち検索範囲決定部により決定された範囲を検索して所要のデータを抽出し、この抽出した所要のデータを領域確保部により確保された作業メモリ２４の領域にコピーする。 - 特許庁
  • When receiving the distribution amount control notification from the recorder 30 at a communication control unit 22, the hub 20 adjusts the accumulation amount of video data to be accumulated in a buffer 24 in accordance with the distribution amount control notification to lower the distribution rate of video data to the recorder 30.
    ハブ２０は、通信制御部２２にてレコーダ３０からの配信量制御通知を受けると、この配信量制御通知に応じてバッファ２４に蓄積する映像データの蓄積量を調整し、レコーダ３０への映像データの配信レートを下げる。 - 特許庁
  • Whether or not new data can be recorded in the recording buffer is judged based on the present recording position shown by the printing counter 305, the recording speed of the recording head 304, the new data drawing position and the time needed for its drawing operation.
    そして、印字カウンタ３０５によって示される現時点の記録位置と、記録ヘッド３０４の記録スピードと、新たなデータの描画位置とその描画所要時間とに基づいて、該新たなデータの記録バッファへの記録が可能か否かを判断する。 - 特許庁
  • Therefore, the image data in the same address of a layer below it are read out, it is checked whether or not there is a mask bit in the specified column address of a mask bit buffer 222 and when the mask bit is written, the data in the column address are not read out.
    従って、その下層のレイヤーの同じアドレスの画像データを読み出す際、マスクビットバッファ２２２の所定の列アドレスのマスクビットの有無を調べ、マスクビットが既に書き込まれていれば、その列アドレスのデータを読み出さないように構成している。 - 特許庁
  • First, serial digital video data inputted to SD I/Fs 20_1, 20_2,...20_(n-1) in inputting parts 12_1, 12_2,...12_(n-1) are supplied to buffer memories 23_1, 23_2,...23_(n-1) through data formatters 21_1, 21_2,...21_(n-1).
    そして、入力部１２_１，１２_２・・・１２_（ｎ−１）において、先ず、ＳＤＩ／Ｆ２０_１，２０_２・・・２０_（ｎ−１）に入力されたシリアルディジタルの映像データは、データフォーマッター２１_１，２１_２・・・２１_（_ｎ−１）を介してバッファメモリ２３_１，２３_２・・・２３_（ｎ−１）に供給される。 - 特許庁
  • Further, the memory controller includes a comparator 4 for comparing the data values stored in the at least two FIFO buffer parts and a control circuit 3 for controlling the delay time of the data strobe signals by using the delay circuit 3 on the basis of the compared result 10 of the comparator 4.
    更に、少なくとも２つのＦＩＦＯバッファ部に格納されたデータ値を比較する比較器４と、比較器４の比較結果１０に基づき、遅延回路３を用いてデータストローブ信号の遅延時間を制御する制御回路３を有する。 - 特許庁
  • To solve the problem that when one-image data are needed for rotation processing, an input buffer for reading in image data by one image or nearly one image is needed and then a memory with enormous capacity is eventually needed.
    回転処理に１枚分の画像データが必要であると、出力バッファのライン数に関わらず、画像データを１枚分またはほぼ１枚分読み込むための入力バッファが必要となり、結果的に、膨大な容量のメモリが必要になる。 - 特許庁
  • In a readout cycle of data from peripheral equipment 300 by a CPU 100, not only an address for specifying the peripheral equipment 300 but also write data to be written in a buffer 303 of the peripheral equipment 300 are transmitted via an address bus 201.
    ＣＰＵ１００による周辺装置３００からのデータの読み出しサイクルにおいて、周辺装置３００を特定するためのアドレスに加えて周辺装置３００のバッファ３０３に書き込む書き込みデータを、アドレスバス２０１を介して送信する。 - 特許庁
  • Then the DSIT generation section 45 generates the DSIT including the information which specifies a corresponding data set in the spare area and the next read start position, and the buffer management section 42 adds the DSIT to the data set and overwrites it using a new format.
    その後、ＤＳＩＴ生成部４５が、余裕領域における対応するデータセットを特定する情報と次の読出し開始位置とを含むＤＳＩＴを生成し、バッファ管理部４２が、データセットにこのＤＳＩＴを付加して新フォーマットで上書きする。 - 特許庁
  • Thus, the frequency of the read clock is changed with the unread data amount in the buffer memory 15 so as to keep the unread data amount nearly constant thereby coping with a very small frequency difference between the transmitter side and the receiver side.
    したがって、バッファメモリ１５における未読データ量に応じて読出しクロックの周波数が変化し、該未読データ量を略一定に維持することができ、送信側と受信側との微妙なクロック周波数の差に対応することができる。 - 特許庁
  • The frame buffer controller 105, the memory address generator 107 and a display data controller 108 operate the attribute value of an image positioned on a display position by operation using the parameter to compose a display image plane, and output display data.
    フレームバッファコントローラ１０５、メモリアドレスジェネレータ１０７および表示データコントローラ１０８は、前記パラメータを用いた演算により当該表示位置に位置する画像の属性値を演算して表示用画面を構成し、表示データを出力する。 - 特許庁
  • To provide a page buffer of a flash memory device capable of reducing program time, reducing the area of the device by omitting a data transmission circuit required for a data transmission process and lowering power consumption, and its program operation control method.
    プログラム時間を減らすことができ、データ伝送過程に必要なデータ伝送回路を省略して素子の面積を減らすことができるうえ、消費電力を低めることができる、フラッシュメモリ素子のページバッファおよびそのプログラム動作制御方法の提供。 - 特許庁
  • Upon receiving the interruption request signal 18a, the CPU 7 performs interruption processing once and transfers data corresponding to nozzles of lateral 8 bit × longitudinal 1 nozzle array from an image buffer 5C to the head data processing circuit 17 during the interruption processing.
    この割り込み要求信号１８ａを受けてＣＰＵ７は、１回の割り込み処理を行い、この１回の割り込み処理の中で、イメージバッファ５Ｃからヘッドデータ処理回路１７に、横８ビット×縦一ノズル列のノズル数分のデータをすべて転送する。 - 特許庁
  • The image forming apparatus includes four systems, each system including: a DMA processing part for obtaining image data; a smoothing processing part for resolution-converting the image data using a line buffer; and a PWM processing part outputting pulse signals to a printing engine.
    画像形成装置は、画像データを取得するＤＭＡ処理部と、ラインバッファーを用いて画像データを解像度変換するスムージング処理部と、印刷エンジンにパルス信号を出力するＰＷＭ処理部とを、それぞれ第１〜第４の４系統備える。 - 特許庁
  • This receiver executes error correction to data input to an IP network interface (11) to be stored in a buffer (13), thereafter sequentially transfers the data to a descrambler (14) and a demultiplexer (15), and executes audio output and video output.
    受信装置は、ＩＰネットワークインタフェース（１１）に入力されたデータに対してエラー訂正を行ってからバッファ（１３）に蓄積した後、デスクランブラ（１４）、デマルチプレクサ（１５）へと順次データを渡してゆき、音声出力及び映像出力を行う。 - 特許庁
  • The image processor sets the control data set in the first control register in the second control register in synchronization with a vertical synchronization signal, on condition that writing of the image data in the writing buffer in the plurality of the buffers is completed.
    複数のバッファーのうち書き込み用に指定された書き込み用バッファーに画像データの書き込みが終了したことを条件に、垂直同期信号に同期して、第１の制御レジスターに設定された制御データを第２の制御レジスターに設定する。 - 特許庁
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