「data buffer」を含む例文一覧(6933)
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トライステートバッファ１２がディスエーブルとなっても、主データバス１３の信号ラインを所定レベルにシフトすることにより、テストインターフェイス回路２０の内部での貫通電流やゲートレベルの不定を回避する。 - 特許庁 - The data transfer system is provided with a buffer for storing the request not capable of being outputted to the target slave, and performs an output of the request not capable of being outputted though permitting the output, to the target slave.
更に、対象スレーブへ出力不可能なリクエストを格納する為のバッファを設け、許可したにも関わらず出力不可なリクエストの対象スレーブへの出力をデータ転送システムが行う。 - 特許庁 - The deblocking filter buffer 203 stores the image data in the units of mutually adjacent configuration of 4×4 blocks arranged at least along one of the horizontal and perpendicular directions.
そして、デブロッキング・フィルタ用バッファ２０３を、４×４ブロックが水平方向、垂直方向の少なくとも一方向に沿って配置され、かつ互いに隣接する構成を単位にして画像データを保存する。 - 特許庁 - An apparatus includes the memory to store a first frame, a buffer to store at least one portion of a second frame previously stored in the memory, and first and second units to, respectively, store and fetch data.
第１フレームを格納するメモリと、メモリに先に格納されていた第２フレームの少なくとも一部を格納するバッファと、データをそれぞれに格納およびフェッチする第１ユニットおよび第２ユニットを含む。 - 特許庁 - Before storing consecutively photographed image data provided by continuous photographing into a buffer memory 25 and recording them on a memory card 22, a system controller 50 performs display processing for displaying a consecutively photographed multiple-screen.
システムコントローラ５０は、連続撮影により得られた連写画像データがバッファメモリ２５に格納されて、メモリカード２２に記録される前に、連写マルチ画面を表示する表示処理を実行する。 - 特許庁 - For example, a first band in a second page (P2 band 1) can be subjected to the rendering between a fifth band and a seventh band and a buffer for holding the image data subjected to the rendering can be attained.
例えば、第２ページの第１バンド（Ｐ２バンド１）は、第１ページの第５バンドと第７バンドとの間にレンダリングが可能であり、しかもレンダリングされたイメージデータを保持するバッファの確保できる。 - 特許庁 - With regard to data transmission, after a transmitting buffer is reconfigured, PDUs required to be transmitted through a previously established radio bearer are kept and gradually received by a receiver.
データの伝送に関しては、送信バッファが再構成された後、以前に確立された無線ベアラを通して伝送するように要求されたＰＤＵは保持され、受信器によって徐々に受信される。 - 特許庁 - To provide a symmetric multiprocessor data processing system (SMP) that implements a TLBI protocol, which enables multiple TLBI operations (for making a conversion index buffer TLB disabled) from multiple processors within a partition to complete concurrently.
パーティション内の複数のプロセッサからの複数のＴＬＢＩオペレーションのコンカレントな完了を可能にするＴＬＢＩプロトコルを具体化する、対称マルチプロセッサ・データ処理システム（ＳＭＰ）を提供する。 - 特許庁 - The temporary data replication control means 25 functions such that the master volume 21 and a buffer volume 22 established between the master volume 21 and a snapshot volume 23 maintain an identical volume image.
一時データ複製制御手段２５は、マスタ・ボリューム２１と、マスタ・ボリューム２１とスナップショット・ボリューム２３との間に構築したバッファ・ボリューム２２とが、同一のボリューム・イメージを維持するように機能する。 - 特許庁 - On the basis of the detected result, a word deciding logic circuit 20 determines the read timing of a RAM 12 and stores it in a length buffer 17 so that the continuity of data disordered by the clock difference can be recovered.
ワード判定論理回路２０はその検出結果を基にクロック差によって崩されたデータの連続性を元に戻すようにＲＡＭ１２の読出しタイミングを決めてレングスバッファ１７に格納する。 - 特許庁 - The three-dimensional graphics display part executes processing by the hardware based on whole transmitted triangle data, and plots the hidden-surface removed image in a frame buffer, and displays the projection drawing (S110).
３次元グラフィックス表示部は、伝送された全三角形データに基づいてハードウェアによる処理を実行し、その陰面消去した画像をフレームバッファへ描画しその投影図を表示する（Ｓ１１０）。 - 特許庁 - An HDD 1 decides whether to use a whole read buffer 241 or use a partial continuous area 411 in reading read data from a magnetic disk 11.
本発明の一実施形態に係るＨＤＤ１は、リード・データの磁気ディスク１１からの読み出しのために、リード・バッファ２４１を全体として使用するか、一部の連続領域４１１を使用するかを決定する。 - 特許庁 - The output pattern data D3 and D4 is outputted from an output buffer 25 as an A-phase pulse signal and a B-phase pulse signal for interpolating one pitch to become movement information, when the scale has moved.
この出力パターンデータＤ３，Ｄ４はスケールが移動したときの移動情報となる１ピッチを内挿するＡ相パルス信号とＢ相パルス信号として出力バッフア２５より出力される。 - 特許庁 - After that, when the release of temporary stoppage is instructed, reading of the video data VD from the buffer memory 119 is started and a video signal SV2 as a slave picture signal is outputted from a DA converter 120.
その後、一時停止解除の指示があるとき、バッファメモリ１１９から映像データＶＤを読み出すことを開始し、ＤＡコンバータ１２０より子画面信号としての映像信号ＳＶ２を出力する。 - 特許庁 - Detecting circuit 22 detects the amplitude of reception data signal outputed from the input buffer, and generates a feedback signal representing a detected amplitude which is fed back to a transmitter 10 side.
振幅検出回路２２は、入力バッファから出力される受信データ信号の振幅を検出し、検出した振幅を表わすフィードバック信号を生成し、トランスミッタ１０側に帰還させる。 - 特許庁 - To actualize a small computational complexity for each packet and small necessary buffer capacity (memory capacity), and to use a data transfer rate variation index indicative of a suitable value as traffic quality evaluation.
１パケット毎の計算量が少なく、かつ必要バッファ量（メモリ量）が少なく済ませることができるようにし、しかもトラヒック品質評価として適切な値を示すデータ転送レート変動指標を使用する。 - 特許庁 - To attain the output of readout data in a short time in a nonvolatile memory device on which a large capacity of buffer memory is loaded for controlling a nonvolatile memory large in write-in unit.
書き込み単位の大きな不揮発性メモリを制御するために容量の大きなバッファメモリを搭載した不揮発性記憶装置において、短時間での読み出しデータの出力を実現する。 - 特許庁 - The command list control circuit 108 perform control to perform processing for storing the object data in the section buffer 103 and comparison processing by the comparator 105 in parallel with processing in the control circuit 102.
コマンドリスト制御回路１０８は、制御回路１０２における処理と並行して、対象データをセクションバッファ１０３に格納する処理及び比較器１０５による比較処理を行うよう制御する。 - 特許庁 - Recorded material such as video is transmitted in compressed form to a receiver, which has a buffer for smoothing differences between the data rate received and that consumed by a decoder that follows.
ビデオのような記録されたマテリアルは、受信データレートと続くデコーダによって消費されるデータレートとの間の差異を平滑化するためのバッファを有する受信機に、圧縮形式で伝送される。 - 特許庁 - An encoded compressed video signal read from a buffer and an encoded compressed video signal extracted by an extraction controlling part on the basis of a detection output of a data analyzing part are recorded on storage media.
バッファから読み出した符号化圧縮映像信号を、データ解析部の検出出力に基づき、抜出制御部により抽出した符号化圧縮映像信号を、蓄積メディアに記録する。 - 特許庁 - To provide a data processor which attains equalization of load of parallel distributed processing and equalization of processing time and makes it possible to minimize capacity of buffer memory for absorbing difference of processing time.
並列分散処理の負荷の均等化及び処理時間の均等化を図り、処理時間の違いを吸収するためのバッファメモリの量を最小にすることを可能としたデータ処理装置を提供する。 - 特許庁 - An address register 11 is provided to generate successively column address signals Cab in one page when a page address signal is inputted to load successively data of one page bit by bit into the page buffer 2.
ページバッファ２に１ページ分のデータを１バイトずつ順次ロードするために、ページアドレス信号が入力されると１ページ内のカラムアドレス信号ＣＡｂを順次発生するアドレスレジスタ１１が設けられる。 - 特許庁 - The transmission time calculation part 2 sends a data transmission request to a buffer control part 5 when an interval control signal sent by an interval counter 4 having counted cell intervals of the VC level is enabled.
送出時刻計算部２は、ＶＣレベルのセル間隔をカウントした間隔カウンタ４が送出する間隔制御信号がイネーブルのとき、バッファ制御部５に対してデータ送信要求を行う。 - 特許庁 - When the data remaining in the buffer memory become the predetermined volume or less, the disk motor speed suitable to set sound level (S8) is calculated to control the speed as calculated (S9).
バッファメモリのデータの残量が所定量以下になると、音声出力の設定レベルに対応したディスクモータの回転速度を算出（Ｓ８）し、算出した値にディスクモータの回転速度を制御（Ｓ９）する。 - 特許庁 - The data output buffer of this invention switches its operation mode even if a separate special mode selection signal is not provided, and can also be achieved with a markedly simple configuration.
本発明のデータ出力バッファでは、従来の技術のモード選択信号が別途に提供されなくても、周期に応じて動作モードが変換され、また、著しく簡単な構成で実現できる。 - 特許庁 - The respective thinning filters 9 perform a product-sum operation to the image data inputted from the line buffer 5 by using the sent filter coefficients for thinning, process the filter and output the image signals of R, G and B.
各補間フィルタ９はラインバッファ５から入力する画像データを送られた補間用フィルタ係数を使って積和演算を行いフィルタを処理しＲ，Ｇ，Ｂの画像信号を出力する。 - 特許庁 - To provide a DMA(direct memory access) controller which efficiently uses, especially a memory (receiving buffer), performs data transfer faster and also eliminates an overhead.
本発明はＤＭＡ（ダイレクト・メモリ・アクセス）制御装置に係り、特にメモリ（受信バッファ）を効率よく使用し、データ転送をより高速に行うと共に、オーバーヘッドをなくすＤＭＡ制御装置を提供するものである。 - 特許庁 - The pixel shader further carries out second texture look up within a vertex buffer, and operates so as to obtain vertex data corresponding to the vertex index value already obtained about the geometric primitive to be displayed.
ピクセルシェーダはまた、頂点バッファ内で第２のテクスチャルックアップを実行し、表示される幾何プリミティブについて既に取得された頂点インデックス値に対応する頂点データを取得するように動作する。 - 特許庁 - To prevent a leakage of confidential information included in image data stored in a buffer memory (hard disk) for smoothly performing high-speed image formation processing in an image forming device such as a compound machine.
複合機等の画像形成装置において、高速な画像形成処理を円滑に実行するためのバッファメモリ（ハードディスク）に記憶される画像データに含まれる機密情報の漏洩を防止する。 - 特許庁 - The tilt of the medium fed by a feeder is detected and the position of image data stored in a buffer memory is corrected in accordance with the tilt so as to obtain a correct (upright) image concerning the medium.
フィーダーにより供給される媒体の傾きを検出し、媒体に対し正確（まっすぐ）な画像となるように、バッファメモリに格納された画像データの位置をその傾きに合わせて修正する。 - 特許庁 - When the address signal ADR of a reading target is outputted from a CPU 11, a corresponding read data DR is read from the flash memory 12, and supplied to the CPU 11 and a 3-state buffer 16.
ＣＰＵ１１から読み出し対象のアドレス信号ＡＤＲが出力されると、フラッシュメモリ１２から対応する読出データＤＲが読み出され、ＣＰＵ１１と３ステートバッファ１６に与えられる。 - 特許庁 - Data received by the terminal 280 are temporarily stored in a buffer 153 of the base station 150 and when the mobile body 20 enters an area 5, the base station 150 makes communication with the base station 220 in the mobile body.
端末２８０への着信データは、基地局１５０のバッファ１５３に一時記憶され、移動体２０がエリア５に進入すると、基地局１５０と移動体内基地局２２０間で通信が行われる。 - 特許庁 - An action generation unit 36 determines an action to be executed based on the internal model data and the information stored in the action output buffer 39 and the recognition results that are output by the recognition unit 35.
行動生成器３６は、内部モデルデータ、行動出力バッファ３９に記憶されている情報、および認識器３５が出力する認識結果に基づいて、実行すべきアクションを決定する。 - 特許庁 - An interface processing part of the self-management system digital radio system asynchronously performs the operations of the communication line and the transmission line in the device by making a buffer for communication data between the communication line and the transmission line in the device into a plurality of surfaces and providing a switching mechanism.
通信回線と装置内伝送路の間の通信データ用バッファを複数面にし、切替機構を設けて、通信回線と装置内伝送路の動作を非同期に行う。 - 特許庁 - A raster writing part 12 sequentially writes pieces of line data in a plurality of colors in the buffer memory 3 along the vertical scanning direction by shifting addresses for offset corresponding to intervals of line sensors 1R, 1G, 1B, respectively.
ラスタ書込部１２は、複数色のラインデータをそれぞれ、ラインセンサ１Ｒ，１Ｇ，１Ｂの間隔に対応するオフセット分だけアドレスをシフトさせて、バッファメモリ３に副走査方向に沿って順番に書き込む。 - 特許庁 - A packet transfer unit monitors the average number of packets in a first buffer and when the average number exceeds a specified threshold value, the packet transfer unit transmits a signal for interrupting transmission of data packet to a source.
パケット転送装置は、第１バッファー内のパケットの平均数を監視し、前記平均数が所定閾値を超えると、パケット転送装置は送信元にデータパケットの送信を停止するように信号送信する。 - 特許庁 - To improve the processing speed or function of the whole device by reducing the plus duty factor of a memory and a bus line for the transfer processing of data to a buffer RAM and increasing the access efficiency of the memory.
バッファＲＡＭに対するデータの転送処理についてのメモリ及びバスラインの占有率を低くしてメモリのアクセス効率を高くし、装置全体の処理速度や機能の向上を図る。 - 特許庁 - An image read section 10 reads a digital code embedded into an original, a page buffer 21 stores image data of a read original, and a condition information detection section 22 detects condition information.
原稿に埋め込まれたディジタルコードを画像読取部１０で読み取り、読み取った原稿の画像データをページバッファ２１に格納するとともに条件情報検出部２２で条件情報を検出する。 - 特許庁 - A control switching buffer 34 switches connection of a VRAM 33 in which display data to be displayed on a display unit 31 is drawn between connection to the CPU of the operation section side and connection to the CPU of the main body side.
制御切替バッファ３４は、表示ユニット３１に表示する表示データが描画されるＶＲＡＭ３３を、操作部ＣＰＵ側に接続するか本体部ＣＰＵ側に接続するかを切り替える。 - 特許庁 - After a first release operation by a user, the imaging apparatus captures an image for a negative maximum wait time, and stores an image acquired by the capturing to a buffer memory 19, together with blur amount data.
ユーザによる１ｓｔレリーズ操作の後、マイナスの最大待ち時間の間キャプチャ動作を行い、このキャプチャ動作によって取得された画像をブレ量データとともにバッファメモリ１９に記憶させる。 - 特許庁 - Then, information indicating residual quantity of data which is received from the external equipment 20, accumulated in the buffer means 12a, 12b, and not yet output is informed to the external equipment 20.
この制御手段１１により、外部機器２０から受信してバッファ手段１２ａ，１２ｂに蓄積され未だ出力されていないデータの残量を指示する情報を外部機器２０に通知する。 - 特許庁 - If the voice part is present for less than 30 m/sec in the period T2, a part of the non-voice part is added to every voice part, and data for 30 m/sec are written into the output buffer.
期間Ｔ２で有音部分が３０ｍ秒分未満しか存在しないときには、有音部分の全てに無音部分の一部を付加して、３０ｍ秒分のデータを出力バッファに書き込む。 - 特許庁 - To provide a high-performance inexpensive memory control circuit capable of surely improving the memory band width without reducing the effective band width and without increasing a data buffer inside the memory control circuit.
実効バンド幅を低下させることがなく、かつメモリ制御回路内部のデータバッファを増加させることなく確実にメモリバンド幅を向上させ、高性能、安価となるメモリ制御回路を提供する。 - 特許庁 - When a buffer memory for storing picture data by an original reading operation approaches a memory full state in an image reader, the reading operation is stopped and the phase of a CCD line period signal on the stopped position is stored.
画像読取装置において、原稿読取動作で画像データを貯めるバッファメモリがメモリフル近くなったとき、読み取り動作を停止し、その位置でそのときのＣＣＤライン周期信号の位相を保持する。 - 特許庁 - The increase of the standby control circuit or buffer memory needed on the engine side is eliminated by generating a packet of a size according to a processing unit executed on the engine side to transmit image data.
エンジン側で実行する処理単位に応じたサイズのパケットを生成して画像データを送信することで、エンジン側に必要であった待機制御回路やバッファメモリの増大という問題を解決する。 - 特許庁 - Second and third image transfer parts 15, 16 buffer the pieces of image data simultaneously output from the pixel number conversion part 14 and transmit DREQs to a transfer control part 17 according to a buffering state.
第２及び第３の画像転送部１５、１６は、画素数変換部１４から同時出力された画像データをバッファリングし、バッファリングの状態に応じてDREQを転送制御部１７に送出する。 - 特許庁 - To prevent image data stored in a buffer from leaking and to judge that leakage is securely prevented without using processing which has a long processing time like ciphering.
暗号化のような処理時間の長くなる処理を用いることなく、バッファメモリに記憶された画像データの漏洩を防止すると共に、漏洩防止が確実に実行されたことの判断を可能にする。 - 特許庁 - A motion picture reproduction apparatus 1 performs qualification determination based on formulas from 23 to 28 and adjusts frame buffer volume and throughput in appropriate dimensions when stream data of motion picture is subjected to decoding processing.
動画像再生装置１は、（２３）〜（２８）式に基づく条件判定を行い、動画像のストリームデータをデコード処理する際のフレームバッファ量および処理能力を適切な範囲に調整する。 - 特許庁 - At the time of read-out in a normal mode, real data RD1 and RD2 given in parallel are transmitted to an output buffer circuit synchronizing with PS conversion control signals PSCLK 1, PSCLK2, respectively.
通常モードのリード時には、パラレルに与えられるリアル・データＲＤ１、ＲＤ２をそれぞれＰＳ変換制御信号ＰＳＣＬＫ１、ＰＳＣＬＫ２に同期させて出力バッファ回路に伝送する。 - 特許庁 - The frame analysis processing part 21 performs CRC verification of a frame received from a lower layer, and writes an analysis result in the analysis result data storing part 22 and writes a packet in the FIFO buffer memory 23.
フレーム解析処理部２１は、下位レイヤから受け取ったフレームのＣＲＣ検証等を行い、解析結果を解析結果データ格納部２２に書き込むとともに、パケットをＦＩＦＯバッファメモリ２３に書き込む。 - 特許庁
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