「output buffer」を含む例文一覧(2839)

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  • Further, an output memory control section 107 grasps the storage amount of encode data stored in an output buffer memory 106.
    また出力メモリ制御部１０７も、出力バッファメモリ１０６に保持されるエンコードデータの蓄積量を把握する。 - 特許庁
  • To provide an output buffer circuit for suppressing overshoot and undershoot of output voltage.
    本発明は、出力電圧のオーバーシュート及びアンダーシュートを抑制した出力バッファ回路を提供することを目的とする。 - 特許庁
  • To provide a semiconductor device capable of controlling the output current of an output buffer so that it lies within a fixed range.
    出力バッファの出力電流が一定の範囲内に収まるように制御できる半導体装置を提供する。 - 特許庁
  • An output buffer 150 drives a load based upon a digital signal output from the pulse-width modulating circuit 130.
    出力バッファ１５０は、パルス幅変調回路１３０から出力されるデジタル信号に基づいて負荷を駆動する。 - 特許庁
  • Then the output of the input buffer circuit 3 goes to a logic level 1 to set a voltage at an output terminal 94 to logic level 1.
    すると、入力バッファ回路３は論理”１“となり、出力端子９４における電圧を論理”１“とする。 - 特許庁
  • The state of the common connecting wiring 1 is maintained by a state maintaining circuit 5 and output through an output buffer 6.
    共通接続配線１の状態は状態保持回路５により保持され、出力バッファ６を介して出力される。 - 特許庁
  • An input buffer 12 outputs an output of the phase comparing circuit to a data output terminal in a test mode.
    入出力バッファ１２はテストモードにおいて位相比較回路１８の出力をデータ出力端子に出力する。 - 特許庁
  • The output buffer part sends the data to an output port if it receives no hold signal from an OR circuit.
    出力バッファ部は、ＯＲ回路からのホールド信号を受領していない場合は、データを出力ポートへ送出する。 - 特許庁
  • An output buffer amplifier 171 amplifies a signal input from the variable gain amplification section 140 for output.
    出力緩衝増幅器１７１は、可変利得増幅部１４０から入力された信号を増幅し出力を行う。 - 特許庁
  • This output buffer circuit is provided with plural output steps 1 and 2 for driving a symmetric transmission line RT.
    本発明による出力バッファ回路は対称伝送線路（ＲＴ）を駆動する複数の出力段（１，２）を含んでいる。 - 特許庁
  • Thus, a transport stream (TS) smoothing an OFDM demodulation output signal is output from a buffer memory 11.
    これにより、ＯＦＤＭ復調出力信号をスムージングしたトランスポートストリーム（ＴＳ）をバッファメモリ１１から出力する。 - 特許庁
  • To perform a level test of an input/output buffer of a semiconductor device without bringing a probe into contact with each input/output pad.
    半導体装置の入出力バッファのレベルテストを、各入出力パッドにプローブを接触させることなく行う。 - 特許庁
  • To provide an output buffer with improved output deviation and a source driver for flat panel display having the same.
    出力偏差の改善された出力バッファ及びこれを備えた平板表示装置用のソースドライバを提供する。 - 特許庁
  • An output buffer temporarily stores and then outputs the first and second gamma voltages output from the converter.
    出力バッファは、コンバータから出力された第１及び第２ガンマ電圧を一時的に格納した後、出力する。 - 特許庁
  • The output buffer circuit B1-B3 adjusts output impedance, respectively, on the basis of the count value held respectively.
    出力バッファ回路Ｂ１〜Ｂ３は、それぞれ保持されたカウント値に基づいてそれぞれ出力インピーダンスを調整する。 - 特許庁
  • An output buffer 332 buffers the signal subjected to filter processing by the SCF circuit 330 to output the signal to the outside.
    出力バッファ３３２は、ＳＣＦ回路３３０によりフィルター処理された信号をバッファリングして外部に出力する。 - 特許庁
  • To guarantee the operation of an output register (flip-flop) connected with the output buffer of a semiconductor integrated circuit surely.
    半導体集積回路の出力バッファに接続された出力レジスタ（フリップフロップ）の動作保証を確実にする。 - 特許庁
  • A format conversion processing part 3 is provided with a first input buffer 10 for storing input data ID: an output buffer 14 for storing output data OD; a conversion processing part 12 connected between the first input buffer 10 and the output buffer 14; and a register 13 which can be referred by the conversion processing part 12.
    フォーマット変換処理部３は、入力データＩＤを格納可能な第１入力バッファ１０と、出力データＯＤを格納可能な出力バッファ１４と、第１入力バッファ１０と出力バッファ１４との間に接続された変換処理部１２と、変換処理部１２が参照可能なレジスタ１３とを備える。 - 特許庁
  • To provide a semiconductor device capable of measuring an impedance adjustment term of an output buffer.
    出力バッファのインピーダンス調整期間を測定できる半導体装置を提供する。 - 特許庁
  • The source driving apparatus includes a latch 271, an additional-data generator 272, an output controller 273 and a buffer 275.
    ソース駆動装置はラッチ部、付加データ生成部、出力制御部及びバッファ部を含む。 - 特許庁
  • To provide an output buffer circuit that suppresses the generation of an inflow current.
    流入電流の発生を抑制することができる出力バッファ回路を提供する。 - 特許庁
  • A balanced bridge hybrid is connected between a buffer output terminal and an internal node.
    平衡型ブリッジハイブリッドがバッファ出力端と内部ノードとの間に接続されている。 - 特許庁
  • The first buffer gate generates a first output signal based on the digital signal.
    第１のバッファゲートは、前記デジタル信号に基づいて第１の出力信号を生成する。 - 特許庁
  • A signal line 21 is output from the buffer register 7 and connected to the 1c of the RAM1.
    また、バッファレジスタ７から信号線２１を出力してＲＭＡ１の１ｃに接続した。 - 特許庁
  • To make the frame of a panel narrow while securing the capability of an output buffer of a driving section.
    駆動部の出力バッファの能力を確保しつつ、パネルの狭額縁化を図る。 - 特許庁
  • To provide an output buffer circuit having switchable driving capabilities and having high ESD resistance.
    駆動能力が切替可能であると共に、ＥＳＤ耐性が高い出力バッファ回路。 - 特許庁
  • The transmitter 10A includes a transmission data generation part 11 and an output buffer part 12A.
    送信装置１０Ａは、送信データ生成部１１および出力バッファ部１２Ａを備える。 - 特許庁
  • To output an MPEG transport packet to a decoder so that a video buffering verifier VBV buffer is not failed.
    VBVバッファが破綻しないようにMPEGトランスポートパケットをデコーダに出力するようにする。 - 特許庁
  • To provide a semiconductor memory provided with an output buffer having small layout area.
    レイアウト面積が小さな出力バッファを備えた半導体記憶装置を提供する。 - 特許庁
  • To prevent feedbacking from an input/output pad to an input buffer in read mode.
    読取りモード時に入出力パッドから入力バッファへフィードバックされないようにする。 - 特許庁
  • The second buffer gate generates a second output signal based on the low-level signal.
    第２のバッファゲートは、前記低下信号に基づいて第２の出力信号を生成する。 - 特許庁
  • To suppress a consumption current by reducing an average current value of an output buffer in a memory.
    メモリの出力バッファの平均電流値を低減し、消費電流を抑制すること。 - 特許庁
  • To highly accurately perform a calibration operation for adjusting impedance of an output buffer.
    出力バッファのインピーダンスを調整するためのキャリブレーション動作を高精度に行う。 - 特許庁
  • To provide an output buffer circuit that optimizes its current drive capability and reduces production of a noise.
    出力バッファ回路の電流駆動能力を最適化し、ノイズの発生を低減する。 - 特許庁
  • The clock buffer B1 uses the capacitive element for an auxiliary power supply to provide an output of the L level.
    クロックバッファＢ１は、容量素子を補助電源としてＬレベルを出力する。 - 特許庁
  • A back buffer 103 stores the data packets D1, ... output by the packet relay device.
    バックバッファ１０３は、パケット中継装置が出力するデータパケットＤ１、…を格納する。 - 特許庁
  • The clock buffer B1 uses the capacitive element C2 for an auxiliary power supply to provide an output of the H level.
    クロックバッファＢ１は、容量素子Ｃ２を補助電源としてＨレベルを出力する。 - 特許庁
  • Any lines in the buffer are deleted before the output of command is read.
    r commandの出力が読み込まれる前に、バッファ内に存在した行はすべて消去されます。 - JM
  • The output buffer part 12A includes a data transmission part 13 and a clock transmission part 14A.
    出力バッファ部１２Ａは、データ送信部１３およびクロック送信部１４Ａを含む。 - 特許庁
  • This device comprises a fail bit detecting block, a fail bit counter, a latch block, and a data output buffer block.
    フェイルビット検出ブロック、フェイルビットカウンタ及びラッチブロック、データ出力バッファブロックを含む。 - 特許庁
  • To provide a storage device which can use a hard disk as a buffer member to output to a printer, etc.
    プリンタ等に出力するバッファメモリとしてハードディスクを使用可能とする記憶装置。 - 特許庁
  • In a semiconductor device 3, input/output buffer circuits BF convert a voltage level.
    半導体装置３において、入出力バッファ回路ＢＦは電圧レベルの変換を行なう。 - 特許庁
  • OUTPUT BUFFER CIRCUIT, AND MASTER SLICE TYPE SEMICONDUCTOR DEVICE AND ELECTRONIC DEVICE USING THE CIRCUIT
    出力バッファ回路並びにそれを用いたマスタースライス型半導体装置及び電子機器 - 特許庁
  • This semiconductor device is provided with latch circuits 2 and 3 near output buffer circuits 8 and 9.
    この半導体装置は、出力バッファ回路８，９の近傍にラッチ回路２，３を備える。 - 特許庁
  • CONTROL METHOD FOR INPUT BUFFER SWITCH FABRIC COMMUNICATION DEVICE HAVING VIRTUAL OUTPUT QUEUING
    仮想出力キューイングを有する入力バッファ型スイッチファブリック通信装置の制御手法 - 特許庁
  • Each IO decoder block has a data-in register that receives output signals of the differential buffer.
    各ＩＯデコーダ・ブロックは、差動バッファの出力信号を受け取るデータイン・レジスタを有する。 - 特許庁
  • A print spooler holds print output in a buffer and sends it to the printer when it is ready.
    プリントスプーラーは, 印字出力をバッファーにため, プリンターの準備ができたらそれを送る - 研究社 英和コンピューター用語辞典
  • If the event you requested is not available, XCheckWindowEvent returns False, and the output buffer will have been flushed.
    要求したイベントが利用できない場合、XCheckWindowEventはFalseを返し、出力バッファはフラッシュされる。 - XFree86
  • If the event you requested is not available, XCheckMaskEventreturns False, and the output buffer will have been flushed.
    要求したイベントが利用できない場合、XCheckMaskEventはFalseを返し、出力バッファはフラッシュされる。 - XFree86
  • Furthermore, the value which is set to the timer output compare register TCO1 is stored in the buffer area BUF (S59).
    また、タイマアウトプットコンペアレジスタＴＣＯ１に設定した値をバッファエリアＢＵＦに保存する。 - 特許庁
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