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データ記録部１に記録保持された音響信号のうち、処理開始位置Ｐより（最大ピッチ周期×2）サンプルの入力音響信号s1が読み出され、ローパスフィルタ７において高域成分が抑圧された後、間引き処理部８により適当にダウンサンプリングされ、信号バッファ部９に読み込まれる。 - 特許庁 - A data processor comprises a QoS selector 50A for setting an order flag to an ATM cell inputted from respective paths P1-P5 for storing at buffers 41-44 for each QoS class, and a read section 60 for disposing a cell when the replacement of cell order is detected at that time when the cell is read from the buffer in a QoS order.
各方路Ｐ１〜Ｐ５から入力したＡＴＭセルに順序フラグを付してＱｏＳクラス毎にバッファ４１〜４４に格納するＱｏＳ選択部５０Ａと、バッファからＱｏＳ順にセルを読出し、その際、セル順序の入れ替えが検出された場合にはセルを廃棄する読出部６０とよりなる構成である。 - 特許庁 - A control signal is generated in a wobble detector circuit to control the gain of the variable gain amplifiers 3 and 4 by using a comparator 10, a low-pass filter, and a control buffer 17 based on each of the rectified signal of the reproduced optical disk signals 1 and 2 which are the output data of the variable gain amplifiers 3 and 4.
ウォブル検出回路において、可変利得器３及び４の出力である光ディスク再生信号１及び２の整流信号に基づいて、それぞれ一つの比較器１０、低域通過フィルタ及び制御バッファ１７を用いて可変利得器３及び４の利得制御を行う制御信号を生成する。 - 特許庁 - Only when a scanner input image (A4) is magnified (A3) and then exceeds a main scanning width (e.g., A3 portrait size) determined as a capacity of a line buffer of an image processing means 25, data is output through a first route shown in Fig.12(A) wherein image is rotated by an image rotating means (1)26 prior to image processing.
スキャナ入力画像（Ａ４）が変倍後（Ａ３）に、画像処理手段２５のラインバッファの容量として決められている主走査幅（例えば、Ａ３縦）を超える場合にのみ、画像回転手段（１）２６画像処理前に画像回転を行う図１２（Ａ）の第一の経路で出力データ処理を行う。 - 特許庁 - A driving circuit integrated type active matrix display device is equipped with a display panel, a controller IC 102 having a display memory 111, an output buffer 12 reading data out of the display memory and outputting them to a display panel part, and a controller 113 communicating with a host device and performing control.
駆動回路一体型のアクティブマトリクス型表示装置において、表示パネル部の外に、表示メモリ１１１と、表示メモリからデータを読み出し表示パネル部へ出力する出力バッファ１１２と、上位装置との通信並びに制御を司るコントローラ１１３と、を有するコントローラＩＣ１０２を備える。 - 特許庁 - Since data inputted into the terminal 1 of the input/output circuit 10 is outputted from the terminal 2 via an output circuit 223 from an input buffer 13 and a gate control part 22 of an input/output circuit 20, the input/output circuits 10 and 20 can be tested through program processing without going through the internal bus B.
そして、入出力回路１０の端子１に入力されたデータが入力バッファ１３および入出力回路２０のゲートコントロール部２２のセレクタ２２２から出力回路２２３を介して端子２から出力されるので、プログラム処理による内部バスＢを介することなく入出力回路１０，２０のテストが可能になる。 - 特許庁 - A host computer (PC)1 comprises a conversion module 14 for converting application data into a print job described by page description language, a writing module 15 performing rasterization of the print job, and a transmission buffer 16 for storing the print job described by page description language and transfers the stored print job to a printer 4.
ホストコンピュータ（ＰＣ）１は、アプリケーションデータをページ記述言語で記述した印刷ジョブに変換する変換モジュール１４、該印刷ジョブのラスタライズ処理を行う描画モジュール１５、前記ページ記述言語で記述された印刷ジョブを記憶する送信バッファ１６を有し、該記憶した印刷ジョブをプリンタ４へ転送する。 - 特許庁 - A reception protocol processing part 52 performs the reception protocol processing to a received frame received by the network interface part 51, acquires control information, stores the control information including it at least in a control information queue 55, and when data are included in the received frame, stores them in a reception buffer 54.
受信プロトコル処理部５２は、ネットワークインタフェース部５１が受信した受信フレームに対して受信プロトコル処理を行い、制御情報を取得しこれを少なくとも含む制御情報を制御情報キュー５５に記憶させ、受信フレームにデータが含まれていればこれを受信バッファ５４に記憶させる。 - 特許庁 - The transmission system changeover control section 111 controls a transmission frame generating section 102, a modulation section 103, a transmission wireless section 104 and an antenna multicoupler section 105 to instruct a buffer 101 to output transmission data for re-transmission when the revision of the transmission system is required according to the instruction from the transmission system changeover discrimination section 110.
送信方式切り替え制御部１１１は、送信方式切り替え部１１０からの指示に従い、送信方式の変更が必要な場合に送信フレーム作成部１０２、変調部１０３、送信無線部１０４、アンテナ共用部１０５を制御し、バッファ１０１に再送する送信データの出力を指示する。 - 特許庁 - In the system, a memory update history preservation control part 1 makes a response to a read transaction issued on a processor bus 400 and allows a before-image buffer 2 to preserve data of a main memory 310 and its address, as update history information, outputted from a memory control part 300 onto a process bus 400.
この発明のシステムでは、メモリ更新履歴保存制御部１が、プロセッサバス４００上に発行されたリードトランザクションに応答して、メモリ制御部３００によりプロセッサバス４００上に出力された主メモリ３１０のデータとそのアドレスとを更新履歴情報としてビフォアイメージバッファ２に保存する。 - 特許庁 - To reduce the load on a CPU, detect and correct the error using hardware in a tone generator, and replace the page undergoing the error by a new page, in a tone generation apparatus in which waveform data is stored in an NAND flash memory and is read out to a waveform memory via a buffer and simultaneously reproduced.
ＮＡＮＤ型フラッシュメモリに波形データを格納し、波形データをバッファ経由で波形メモリに読出しつつ再生を行う楽音生成装置において、ＣＰＵの負荷を軽減し、エラー検出と訂正を楽音生成部内のハードウェアを利用して実現し、またエラーが発生したページを新たなページで代替できるようにする。 - 特許庁 - The latch circuit 14 latches data only when it receives the identical pulse 13, and transmits it to an output circuit 9, while the buffer circuit 15 connects the output circuit 9 electrically with a relay contact 10 to an object to be controlled only when it has received the signal from the AND circuit 5, and performs a control output.
ラッチ回路１４は照合一致パルス１３を受信した時のみデータをラッチして出力回路９に送信し、バッファ回路１５は上記ＡＮＤ回路５からの信号を受信した時のみ出力回路９と制御対象へのリレー接点１０とを電気的に接続して制御出力を行う。 - 特許庁 - When recording the recording data stored temporarily in the buffer memory 25 on a magnetic disk 5 by ZLW (zero latency write), the number of sectors whose recording is completed is counted with a counter WBCTR in a nZLW region, and the number of sectors whose recording is completed is counted with a counter WBCTRZ in a ZLW region.
バッファメモリ２５に一時記憶された記録データをＺＬＷ（ZeroLatency Write）により磁気ディスク５に記録する際に、ｎＺＬＷ領域で記録が完了したセクタ数をカウンタＷＢＣＴＲによりカウントするとともに、ＺＬＷ領域で記録が完了したセクタ数をカウンタＷＢＣＴＲＺによってカウントする。 - 特許庁 - In a processing of adding a disk device 24 and changing the RAID level of a disk array 2, a control device 1 searches valid logical addresses according to a copy 35 of an address conversion table at a point of starting to change the RAID level and packs and collects data of the searched valid logical addresses in a read buffer 31 after a reconstruction.
制御装置１は、ディスク装置２４を追加してディスクアレイ２のレイドレベルを変更する処理で、レイドレベル変更開始時点のアドレス変換テーブル３２のコピー３５に従って有効な論理アドレスを検索し、その検索した有効な論理アドレスのデータを再構築後の書き込みバッファ３１に詰めて蓄積する。 - 特許庁 - To make it possible to highly precisely read image data with a simple configuration even when the scanner temporarily stops reading according to the capacity of a buffer in a scanner system comprising the scanner and a host device connected to the scanner.
本発明は、スキャナ装置とそのスキャナ装置に接続されるホスト装置とで構成されるスキャナシステムにおいて、スキャナ装置がバッファの容量の関係で一時的に読み取り動作を停止するときにも、簡略な構成に従いつつ高精度の画像データの読み取りを実現できるようにすることを目的とする。 - 特許庁 - An address comparing part 160 compares the address of the coherency request and a command with the tag address read from the copy tag 300 and the state, judges whether it is necessary to update the copy tag and outputs the address to be written and the state to a data output buffer 170 when the copy tag 300 has to be updated.
アドレス比較部１６０は、コヒーレンシリクエストのアドレスおよびコマンドとコピータグ３００からリードしたタグアドレスおよびステートとを比較してコピータグ３００の更新が必要かどうかを判断し、コピータグ３００の更新が必要な場合にライトするタグアドレスおよびステートをデータ出力バッファ１７０に出力する。 - 特許庁 - To provide an image decoding apparatus capable of performing arithmetic coding/decoding processing, performing a plurality of different decoding processes following the arithmetic coding/decoding processing through pipeline processing for a predetermined data unit, and further performing image decoding processing with a little buffer memory capacity without rupture.
算術符号復号化処理を行えると共に、算術符号復号化処理後に続く複数の別の復号化処理を所定のデータ単位でパイプライン処理することができ、しかも少ないバッファメモリ容量にて画像の復号化処理を破綻させることなく行える画像復号化装置を提供することである。 - 特許庁 - The control circuit of a display unit equipped above a slot machine counts the number of medals dispensed every time winning a hit and stores the number in a buffer memory and initializes the stored data every time an out signal is inputted.
スロットマシンの上方に設けれらた表示ユニットの制御回路は、スロットマシンから大当たり信号が入力される前の状態では、通常処理ルーチンＡ２において、当たりが発生する毎に払い出されるメダル数を計数してバッファメモリに記憶すると共に、その記憶データをアウト信号の入力毎に初期化する動作を行う。 - 特許庁 - It is monitored whether the limit performance is exceeded by calculating and recording a normal data storage amount of the buffer memory for temporary storage, calculating statistics showing that the storage amount tended to increase in the past, and an increase rate of the storage amount is plus, previously specifying a threshold as an upper-limit use rate.
限界性能超過の監視には、一時蓄積用バッファメモリの通常時のデータ蓄積量を算出して記録しておき、この蓄積量が過去には上昇傾向にあるのかどうかの統計量を算出し、この蓄積量の上昇率がプラスであり、上限使用率となるしきい値をあらかじめ指定しておく。 - 特許庁 - Afterward, the destination information in the temporary memory is transmitted, the SCU is communicably connected by a network control unit 6 to a facsimile device of the destination, and transmitted by fax to the facsimile device of the destination by putting the image data in the transmission buffer memory 3 through an encoding decoding part 4, a modem 5, and the network control unit 6.
その後、一時メモリ内の送信先情報を発信して、網制御部６によって送信先のファクシミリ装置と通信可能に接続し、送信用バッファメモリ３内の画像データを符号化復号化部４，モデム５，網制御部６を通すことにより、送信先のファクシミリ装置へＦＡＸ送信する。 - 特許庁 - When temporary stop is commanded during normal playback, a control part 10 controls a playback control part 16 to make the playback control part 16 temporarily stop the playback, and controls a video recording control part 13 to make the video recording control part 13 start to store (start video recording for time-shift playback) program data of a scene to be subsequently played back in a buffer 15.
制御部１０は、通常再生中にその一時停止が指令されると、再生制御部１６を制御して、その再生を一時停止させるとともに、録画制御部１３を制御して、それ以降に再生されるべき場面の番組データの、バッファ１５への記憶を開始させる（追っかけ再生用の録画を開始させる）。 - 特許庁 - When the non-activation control signal is inputted to the pad 30 for activation/ deactivation control, the source electrode and the drain electrode of a transistor 61 are made conductive, a signal inputted from the pad 7 for data input/output control is not inputted to an internal circuit 44 arranged at more inner part than an input buffer circuit 60.
非活性制御信号が活性／非活性制御用パッド３０に入力されると、トランジスタ６１のソース電極とドレイン電極とが導通して、データ入力出力制御用パッド７から入力される信号が、入力バッファ回路６０よりも内部にある内部回路４４に入力されないようになる。 - 特許庁 - This electronic camera is provided with a release switch 31 instructing the photographing of an image and makes the color processing part 211 of an image processing part 21 perform color processing of single image data photographed according to an instruction by the switch 31 and stored in a buffer memory 20 several times under a different color processing condition each time.
画像の撮影を指示するレリーズスイッチ３１を備え、システムコントローラ２８による制御の下で、レリーズスイッチ３１による指示により撮影されてバッファメモリ２０に記憶された単一の画像データに対し、画像処理部２１の色処理部２１１により各回ごとに異なる色処理条件で複数回の色処理を施させる。 - 特許庁 - Control is thus performed to properly vary the frequency of a reception-side decoding clock DCK even when the line uses a network where the variance in packet delay is always large and the data amount does not show a normal distribution, thereby evading an overflow and an underflow of the reception-side buffer 114.
このように制御することで、パケット遅延のばらつきが常時大きくてデータ量が正規分布を示さないネットワークを利用する回線の場合であっても、受信側の復号クロックＤＣＫの周波数を適切に変化させることができ、受信側のバッファ１１４におけるオーバーフローやアンダーフローが回避される。 - 特許庁 - Specific pattern detecting means 4 and 8 monitor whether data outputted from a compressor 3 and a read buffer 2 match the specific pattern and when they match the specific pattern, specific bit inserting means 5 and 9 insert specific bits showing that the pattern is not the specific pattern having special meaning under the control of the control circuit 1.
特定パターン検出手段４，８は、圧縮器３，リード・バッファ２から出力されるデータが特定パターンに一致するどうかを監視し、一致する場合には、制御回路１からの制御により、特定ビット挿入手段５，９は、これが特別な意味を持つ特定パターンでないことを示す特定ビットを挿入する。 - 特許庁 - A coder 101 at a transmitter side distributed a transmission signal to plurality of hieralchies for every cell and applies coding processing so as to detect an error for every hieralchy, stores the signal to a data buffer 102, and a hierarchy modulator 103 applies hierarchical modulation to the signals so that they have different quality and transmits the resulting signal.
送信側で、符号化器１０１にて、送信信号をセル毎に複数の階層に振り分け、階層毎に誤り検出できるように符号化処理を行い、データバッファ１０２に蓄えた後、階層変調器１０３にて、それぞれが異なる品質になるような階層変調を施して送信する。 - 特許庁 - When shift is made to an inactivated state, an animation object 30 erases a frame number in the last plotting timing, and erases decoded data stored in a Pixel Buffer 17, and when shift is made to an activated state again, the animation object 30 initializes a parameter used for calculating the frame number with the last plotting timing.
アニメーションオブジェクト３０は、非活性化状態に遷移する際に、最後の描画タイミングにおけるフレーム番号を削除すると共に、Pixel Buffer１７に記憶されている復号化データを削除し、再び活性化状態に遷移する際に、最後の描画タイミングにおけるフレーム番号を算出するために使用したパラメータを初期化する。 - 特許庁 - To provide recording and reproducing technology by an interleave system by which the capacity of a buffer memory incorporated into the magnetic disk can be reduced, a circuit scale of a substrate can be made small, and a manufacturing cost can be reduced, in a magnetic disk device such as an HDD reading/writing continuous single large data for the magnetic disk.
連続した単一の大きなデータを磁気ディスクへリード・ライトするＨＤＤなどのような磁気ディスク装置において、この磁気ディスク装置に搭載されるバッファメモリの容量を削減でき、また基板の回路規模のコンパクト化とコストの削減が可能なインターリーブ方式による記録再生技術を提供する。 - 特許庁 - Whereupon, a CPU 1010 of the special pattern display device 100 executes an interruption, receives it through a data receiver circuit 1140 to buffer it in a RAM 1090, and controls the drive of an image processing LSI 1060 according to the command to thereby make a desired display on an LCD panel 1120.
すると、特別図柄表示装置１００のＣＰＵ１０２０は割り込み処理を実行し、データ受信回路１１４０を介してこれを受信しＲＡＭ１０９０にバッファリングすると共に、このコマンドにしたがって画像処理用ＬＳＩ１０６０を駆動制御してＬＣＤパネル１１２０に所望の表示を行わせる。 - 特許庁 - By setting the designated number of bits to a small number, the display of large size is achieved when reading still picture data from the display memory 20 and displaying a still picture on the display panel 140, while part of a plurality of buffer circuits in a gradation voltage generation circuit 36 is controlled to be in a non-active state.
指定ビット数を小さなビット数とすることによって、表示メモリ２０から静止画データを読み出して表示パネル１４０に静止画を表示する際に、大きなサイズの表示を可能とする一方、階調電圧生成回路３６の複数のバッファ回路の一部を非活性状態に制御する。 - 特許庁 - The output signal of a color picture frame buffer 2 is inputted to a color/monochrome picture signal converting circuit 3 to be disassembled into three routes of 8-bit digital picture signals and vertical and horozontal syncbronizing signals and picture signals from frame memories 11, 12 among them are inputted to a LUT(line unit) 17 to be converted into 8-bit picture data.
カラー画像フレームバッファ２の出力信号はカラー／モノクローム画像信号変換回路３に入力されて３系統の８ビットディジタル画像信号と垂直、水平同期信号に分解され、このうちフレームメモリ１１と１２からの画像信号がＬＵＴ１７に入力され、８ビットの画像データに変換される。 - 特許庁 - In this image formation device having a controller part 1 that processes image data from a host 28 and carrys out a sequence control and a plurality of expansion slots 6-8 connected to the same system bus as the code ROM 4 that stores the program for the controller part 1, all the expansion slots 6-8 are connected through one buffer 10.
ホスト２８からの画像データ処理、シーケンス制御を行うコントローラ部１を有し、該コントローラ部１のプログラムを格納するコードＲＯＭ４と同一システムバスに接続される複数の拡張スロット６〜８を有する画像形成装置において、全ての拡張スロット６〜８を１つのバッファ１０を介して接続する。 - 特許庁 - The bridge device 12 is provided with a busy flag register 23 for setting a busy flag, while a local busy signal LB is received from at least one I/O device 13a or 13b, while having untransmitted transfer data in a bus buffer 21, and while carrying out write access to the I/O devices 13a and 13b.
ブリッジデバイス１２は、少なくとも１つのＩ／Ｏデバイス１３ａ、１３ｂからローカルビジー信号ＬＢを受信している間、バスバッファ２１に未送信の転送データを有している間、及びＩ／Ｏデバイス１３ａ、１３ｂにライトアクセスを行っている間、ビジーフラグを設定するビジーフラグレジスタ２３とを備える。 - 特許庁 - A text receiving buffer 5 is provided to a communication terminal 2a, having no bind start right that periodically requests transition to the bind state to a communication opposite party in a timing other than that of normal data transmission, and a specified interval communication start function is provided to a communication terminal 2b having a shake-hand start right.
通常のデータ送信時以外のタイミングでも周期的にバインド状態への遷移を通信相手に要求するバインド開始権限がない側の通信端末２ａに、電文受信バッファ５を設け、さらに、シェイクハンド開始権限がある側の通信端末２ｂには、一定間隔通信開始機能を設ける。 - 特許庁 - The video distribution service system is equipped with an input means for designating an image in streaming data in real time, a means for storing identification information of the image designated by the input means, and a means for transferring the identification information to a server side in place of providing a memory except a buffer for streaming reproduction in a receiver terminal.
受信端末にストリーミング再生のためのバッファ以外のメモリを設けず、その代わりに、ストリーミングデータ中の画像をリアルタイムに指定する入力手段と、その入力手段により指定された画像の識別情報を格納する手段と、該識別情報をサーバ側に転送する手段とを設ける。 - 特許庁 - The output buffer circuit 1 is provided with a first level converter circuit 21 for outputting a signal B with a ground and an external output interface power supply potential VDH, defined as amplitude range on the basis of a data input signal A with the ground and a power supply potential VDL, at a semiconductor chip core side defined as an amplitude range.
出力バッファ回路１は、グランドと半導体チップコア側の電源電位ＶＤＬとを振幅範囲とするデータ入力信号Ａに基づいて、グランドと外部出力インターフェース電源電位ＶＤＨとを振幅範囲とする信号Ｂを出力する第１レベルコンバータ回路２１を備えた。 - 特許庁 - When drawing graphics on a frame buffer 22 on which picture data of the background is developed, the half tone between the color of a first pixel of a portion of the background contacting the outline of the graphic and the color of a second pixel of the outline portion of the graphic contacting the first pixel is calculated and stored in a halftone storing region 25.
背景の画像データが展開されたフレームバッファ２２上に図形を描画するとき、図形の輪郭に接する背景の部分の第１のピクセルの色と、この第１のピクセルに接する図形の輪郭部分の第２のピクセルの色との中間色を計算して中間色保持領域２５に保持する。 - 特許庁 - In a device which makes sequential printing to the continuous paper by the image forming devices provided upstream and downstream, when stopping is instructed, as shown in Fig.6 (a), conveyance of the continuous paper 101 is stopped at the end of image forming using print data in an upstream machine print buffer 180 for the continuous paper 101.
上流と下流に設けられた画像形成装置によって連続紙に順次プリントを行う装置において、停止が指示されると、図６（ａ）に示すように、連続紙１０１に対する上流機プリントバッファ１８０内のプリントデータを用いた画像形成が終了した時点で、連続紙１０１の搬送を停止する。 - 特許庁 - To provide the information recording method capable of suppressing the heat generation of a motor for rotationally driving a disk-like recording medium or the increase of power consumption by realizing the simultaneous recording/reproducing operation with respect to the disk-like recording medium by the comparatively smaller buffer capacity and the comparatively lower recording/reproducing data rate.
比較的小さいバッファ容量、かつ比較的低い記録及び再生データレートでディスク状記録媒体に対する同時記録再生動作を実現し、ディスク状記録媒体を回転駆動するモータの発熱や消費電力の増大を抑制することを可能とする情報記録方法を提供する。 - 特許庁 - This data recorder 1 allocates a ring buffer area 7 of specific size to the entire recording area 6 of the recording medium 2 and a subordinate recording area is reallocated to the whole or part of the storage area 7 on the recording medium 2 for a specific period or in specific timing.
記録媒体２上の全記録領域６に、所定の大きさのリングバッファ領域７を割り当てるデータ記録装置１であって、前記記録媒体２上の記憶領域７の全部または一部に対し、所定の期間またはタイミングに基づき前記副記録領域を割り当て直すことを特徴とするデータ記録装置１。 - 特許庁 - At the start of TS reproduction from the recording medium or during switching between the special reproduction and normal reproduction, a reproduction system which outputs a stream in timing similar to input timing during recording and a reproduction system which monitors the amount of data stored in the buffer of the decoder and controls the stream output accordingly are properly and discriminatingly used.
記録媒体からのTS再生開始時、および特殊再生と通常再生を切り換える際に、記録時の入力タイミングと同様なタイミングでストリーム出力を行う再生方式と、デコーダのバッファに蓄積されたデータ量を監視し、それに合わせてストリーム出力を制御する再生方式とを適宜使い分ける。 - 特許庁 - The threshold for deciding whether the terminal device reports the quality of a reception signal to the base station is varied based upon the transmission state (the transmission rate, the amount of data in a buffer, the number of terminal devices connected to the base station, etc.) between the base station and terminal device and a transmission state expected between a peripheral base station and the terminal device.
端末装置が基地局に受信信号の品質を報告するか否かを判定する閾値を、基地局と端末装置間の伝送状況（伝送速度、バッファ内データ量、基地局に接続されている端末装置数等）と、周辺基地局と端末装置間にて期待される伝送状況に基づいて変更する。 - 特許庁 - An analog detection signal A0 is amplified by a buffer amplifier 21, subsequently amplified by a small signal amplifier 22 having a large gain for a small signal and by a large signal amplifier 22 having a small gain for a large signal, and converted to digital data by a small A/D 24 and by a large A/D 25, respectively.
アナログ検出信号Ａ０を、バッファアンプ２１で増幅した後、小信号用の大きな利得を有する小信号用アンプ２２と、大信号用の小さな利得を有する大信号用アンプ２３とで増幅し、小信号用Ａ／Ｄ２４、大信号用Ａ／Ｄ２５でそれぞれディジタルデータに変換する。 - 特許庁 - Through the clock cannot be stopped for holding these stored contents in conventional devices, the data used also after recovery from the sleep mode such as the TOC are transferred in this device from the buffer RAM 7 to the SRAM 16 mounted on a digital signal processing part 5 through a microcomputer interface 33 and a memory control part 31, and backed up.
従来この記憶内容を保持するためにクロックを停止する事が出来なかったが、ＴＯＣのような、スリープモードから復帰したあとも使用するデータは、バッファＲＡＭ７からマイコンインターフェイス３３、メモリ制御部３１を介してデジタル信号処理部５に搭載されたＳＲＡＭ１６に転送され、バックアップされる。 - 特許庁 - This three-dimensional curve-forming system 100 includes: an existing curve storage part 22 associating and previously storing Z buffer values and position data of points constituting a curve in the three-dimensional space; and an input reception means 11 receiving an input curve that is the curve in the two-dimensional space input to a display plane by the user.
三次元曲線化システム１００は、三次元空間の曲線を構成する点の位置データと、Ｚバッファ値とを対応付けて予め記憶する既存曲線記憶部２２と、ユーザによって表示平面に入力された二次元空間の曲線である入力曲線を受け付ける入力受付手段１１とを備える。 - 特許庁 - By a delay (a'+b'+c'+d' or e') given to the feedback clock signal by an input buffer 112 and a DLL delay circuit 113 installed in a feedback path, a delay (a+b+c+d or e) given to a data strobe signal DSQ inputted to the memory control LSI 1 is compensated.
引き戻し経路に配設された入力バッファ１１２およびＤＬＬ遅延回路１１３によって引き戻しクロック信号に与えられる遅延（ａ’＋ｂ’＋ｃ’＋ｄ’またはｅ’）により、メモリ制御ＬＳＩ１に入力されるデータストローブ信号ＤＱＳに与えられる遅延（ａ＋ｂ＋ｃ＋ｄまたはｅ）が補償される。 - 特許庁 - After processings up to this step S27 are finished, in the frame buffer, by the synthesis accompanied with shifting in the step S25 and the synthesis accompanied with shifting in this step S27, the image part with high brightness becomes to higher brightness and in the surroundings, the image data with a distribution in accordance with the synthesis accompanied with the shift and high brightness are formed.
このステップＳ２７までの処理を終了すると、フレームバッファには、ステップＳ２５でのずらしを伴う合成と、このステップＳ２７でのずらしを伴う合成とにより、明度が高い画像部分はより明度が高くなるとともに、その周囲もずらしを伴う合成に応じた分布で明度の高い画像データが生成される。 - 特許庁 - When the detected amount of data is equal to a predetermined amount or larger, the stream output control part 205A determines recording to the 1st recording device as abnormal, and changes the recording destination to a separate 2nd recording device 107, and records the digital signal read from the temporary write buffer 204 to the 2nd recording device 107.
ストリーム出力制御部２０５Ａは、前記検出したデータ量が所定量以上である場合、第１の記録装置１０５への書込みが正常でないと判定して、記録先を別の第２の記録装置１０７へ振り替え、一時書込みバッファ２０４から読み出したデジタル信号を第２の記録装置１０７に記録する。 - 特許庁 - When video signals are input to a coding section 1, the video signals are rearranged in the order of coding by an image rearranging section 11, DCT coding is performed thereon by a DCT section 13, and the video signals are quantized by a quantizing section 14, variable-length-coded by a variable length coding section 15 and output as coded data via a buffer memory 16.
ビデオ信号が符号化部１に入力すると、画像並び替え部１１にて符号化順に並び替えられ、ＤＣＴ部１３によりＤＣＴ符号化され、量子化部１４にて量子化され、可変長符号化部１５にて可変長符号化され、バッファメモリ１６を介し符号化データとして出力される。 - 特許庁 - In the processing of expanding the storage capacity of a disk array 2 by adding a disk device 24, a control device 1 searches valid logical address in response to a copy 35 of an address translation table 32 at the start time of the storage capacity expansion and accumulates the searched valid logical address data by packing into a write buffer 31 following a restructuring.
制御装置１は、ディスク装置２４を追加してディスクアレイ２の記憶容量を拡張する処理で、記憶容量拡張開始時点のアドレス変換テーブル３２のコピー３５に従って有効な論理アドレスを検索し、その検索した有効な論理アドレスのデータを再構築後の書き込みバッファ３１に詰めて蓄積する。 - 特許庁
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