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入力した画像信号を間引く信号間引きデバイス１４と、間引かれた画像信号にキーストーン補正処理をするキーストーン補正デバイス１５と、前記キーストーン補正処理を施する際に一時的に映像信号が記憶されるバッファ１６と、キーストーン補正処理が施された画像信号に補間処理をする信号補間デバイス１７とを備えたものである。 - 特許庁 - Buffer Patterns 206 and 208 are formed of the same material as a lower metal wiring 202, corresponding to crossing portions of the metal wirings that mutually intersect while being configured on different layers; especially, while extending from the lower metal wiring 202 and formed of an alternative pattern that is located so as to come close to/separate from the lower metal wiring 202.
本発明におけるバッファパターン２０６、２０８は、相互に異なる層に構成され交差するメタル配線の交差部に対応して下部のメタル配線２０２と同一な物質で形成されて、特に、下部のメタル配線２０２から延長して形成したり、下部のメタル配線２０２と近接離隔して位置する別途のパターンで形成することを特徴とする。 - 特許庁 - A DTS(digital theafter system) generator 17 generates the decoding time stamp information showing the timing of reading a compressed data within a decoding- side input buffer according to the quantity of the predictively coded data for each channel, and a format formation circuit 19 formats it to a packet header including the decoding time stamp information and a packet having the user data including the compressed data.
ＤＴＳ生成器１７はチャネル毎の予測符号化データ量に応じて、復号側の入力バッファ２２ａ内の圧縮データを読み出すタイミングを示すデコーディング・タイム・スタンプ情報を生成し、フォーマット化回路１９はデコーディング・タイム・スタンプ情報を含むパケットヘッダと、圧縮データを含むユーザデータを有するパケットにフォーマット化する。 - 特許庁 - A clock generating circuit 1 is a buffer circuit consisting of a plurality of inverters, which is a circuit generating a clock CPCLK3 with an amplitude of VDD, and an inverted clock XCPCLK3 with the clock CPCLK3 inverted, based on an input clock CLK, and is used in common for the positive voltage power generating circuit 2 and the negative voltage power generating circuit 3.
クロック発生回路１は、複数のインバータで構成されたバッファ回路であり、入力クロックＣＬＫに基づいて、ＶＤＤの振幅を有するクロックＣＰＣＬＫ３と、クロックＣＰＣＬＫ３が反転された反転クロックＸＣＰＣＬＫ３を発生する回路であり、正電源発生回路２と負電源発生回路３に共用されている。 - 特許庁 - An error detection section 110 applies error detection (cyclic redundancy check) to an output signal from the error correction decoding section 109, outputs the NACK signal when detecting an error, deletes the signal stored in the buffer 108 when detecting no error, closes a switch 111 and outputs an ACK signal.
誤り検出部１１０は、誤り訂正復号部１０９の出力信号に対して誤り検出（ＣＲＣ判定）を行い、誤りが検出された場合にＮＡＣＫ信号を出力し、誤りが検出されなかった場合にバッファ１０８に保存されている信号を消去し、スイッチ１１１を接続し、ＡＣＫ信号を出力する。 - 特許庁 - A source driver circuit comprises: a sample hold circuit 22 which sequentially samples the analog video signals as pixel shades and holds two or more sampled values in parallel; and an output buffer circuit 23 which amplifies the two or more sample values held by this sample hold circuit 22 to a pixel voltage suitable for a display panel and outputs it to two or more source lines X.
ソースドライバ回路はアナログ映像信号を画素階調として順次サンプリングして複数のサンプル値を並列的に保持するサンプルホールド回路２２と、このサンプルホールド回路２２に保持された複数のサンプル値をそれぞれ表示パネルに適合する画素電圧に増幅して複数のソース線Ｘに出力する出力バッファ回路２３とを備える。 - 特許庁 - The airless tire includes: a cylindrical ground contact part coming into contact with the ground; a rotating shaft fixation part forming a circle smaller than that of the ground contact part and located on the inner side of the ground contact part; and the spoke buffer part in the auxetic form performing the buffering action by interconnecting the ground contact part and the rotating shaft fixation part.
本発明は、地面に接触する円筒形の地面接触部と、地面接触部よりも小さい円周を形成し、地面接触部の内側に位置する回転軸固定部と、地面接触部と回転軸固定部を連結して緩衝作用をするオーゼティック形態のスポーク緩衝部と、を有するエアレスタイヤを特徴とする。 - 特許庁 - This enzyme reaction method is characterized by carrying out an enzyme reaction using an immobilized enzyme containing a water content of more than 10 wt.% as an enzyme and using an organic solvent not substantially miscible with water as a reaction solvent under the condition consisting of a homogeneous system the solution phase of which is saturated with water or an aqueous buffer solution but the phase is not separated.
酵素として、水分含量１０重量％以上の固定化酵素を用い、反応溶媒として、水と実質的に混和しない有機溶媒を用いて、溶液相が水又は水性緩衝液で飽和されているが相分離しない均一系となる条件で酵素反応を行うことを特徴とする酵素反応方法。 - 特許庁 - A bottom clip PD amplifier has a current voltage converter 100 to take out the current detected by a photo diode(PD) 1 and convert it into a voltage signal, a clip circuit 200 to clip the laser-off section of the output signal of this current voltage converter 100, and a buffer circuit 300 to output the signal from the clip circuit after converting the impedance.
ボトムクリップ型ＰＤアンプは、フォトダイオード（ＰＤ）１の検出電流を取り出して電圧信号に変換する電流電圧変換部１００と、この電流電圧変換部１００の出力信号のレーザオフ部をクリップするクリップ回路部２００と、このクリップ回路部２００からの信号をインピーダンス変換して出力するバッファ回路部３００とを有する。 - 特許庁 - This device is a semiconductor memory consisting of a plurality of memory cells arranged along a row and a column, word lines connected to all rows are pre-charged (standby state) based on specification of a row address externally specified, that is, activation of address buffer output, simultaneously, redundancy discrimination operation and address decoding operation are started in parallel.
本発明の半導体記憶装置は、行及び列に沿って配列された複数のメモリセルからなる半導体記憶装置であり、外部から指定される行アドレスの指定、即ちアドレスバッファ出力の活性化を契機として、全ての行に接続されるワード線をプリチャージ（待機状態）し、同時に冗長判定動作とアドレスデコード動作を並行して開始する。 - 特許庁 - A clustering unit 42 obtains a distance between a local motion vector LMV obtained per block of a predetermined size and a representative motion vector for each of clusters stored in a delay buffer 44, classifies the local motion vector LMV as a cluster to which the motion vector having the shortest distance belongs, and outputs the information of the classified clusters and the local motion vectors LMV.
クラスタリング部４２は、所定のサイズのブロック単位で求められるローカル動きベクトルLMVと、遅延バッファ４４に格納されている複数のクラスタ毎の代表となる動きベクトルとの距離を求め、距離が最小となる動きベクトルの属するクラスタに、ローカル動きベクトルLMVを分類し、分類したクラスタの情報とローカル動きベクトルLMVとを出力する。 - 特許庁 - The noise reduction circuit is configured such that a delay circuit is inserted to each bit of each semiconductor to individually shift an inversion timing of output data so as to deviate a peak timing of the transient current momentarily flowing through the output IO buffer thereby reducing a noise due to a sudden change in a power supply voltage and a GND voltage in the inside of each semiconductor.
半導体の出力の各ビット毎に遅延回路を挿入して出力データの反転のタイミングを個々にずらし、出力ＩＯバッファで瞬間的に流れる過渡電流のピークタイミングをずらすことにより、半導体内部の電源電圧およびＧＮＤ電圧の急変によるノイズを低減させるように構成する。 - 特許庁 - To provide a driving circuit for liquid crystal display device having a driving buffer which impresses video signal voltage, to which data for screen expression by a large area and high resolution liquid crystal display device is applied, to pixels via a transmission line and the one by improving described technology of Korean patent application number 10-2004-0048446.
大面積高解像度の液晶表示装置での画面表現のためのデータが適用された映像信号電圧を、伝送ラインを介して画素に印加するドライブバッファを備えた液晶表示装置の駆動回路であり、韓国特許公報１０−２００４−００４８４４６の記載技術を改善したものを提供すること。 - 特許庁 - For musical piece data S4 stored in a ring buffer 23, an end index EID according to music name data MND is detected and then a start index SID is calculated so that a user can listen to a musical piece corresponding to extracted music data MA which corresponds to the music name data MND with no lack.
本発明は、リングバッファ２３に記憶された楽曲データＳ４に対して、曲名データＭＮＤに応じた終了インデックスＥＩＤを検出し、開始インデックスＳＩＤを算出することによって、曲名データＭＮＤに対応する抽出楽曲データＭＡに対応した楽曲を全く欠けることなくユーザに聴取させることができる。 - 特許庁 - The trivalent chromium plating bath contains a trivalent chromium salt (chromium chloride), a first organic compound-based complexing agent (potassium formate), a second organic compound-based complexing agent (lactic acid), a buffer agent (boric acid), an electroconductive salt (potassium chloride), a corrosion inhibitor (potassium bromide), a surface controlling agent (polyethylene glycol 400) and a hardener (strontium chloride).
めっき浴中に、３価クロム塩（塩化クロム）と、有機化合物系の第１錯化剤（ギ酸カリウム）と、有機化合物系の第２錯化剤（乳酸）と、緩衝剤（ほう酸）と、電導塩（塩化カリウム）と、腐食抑制剤（臭化カリウム）と、表面調整剤（ポリエチレングリコール４００）と、硬化剤（塩化ストロンチウム）とを含有する３価クロムめっき浴によって、上記の課題が解決される。 - 特許庁 - According to the amount of predictive coding data in each channel, a DTS generator 17 generates decoding time stamp information, showing the timing for reading compressed data in an input buffer 22a of a decoding side, and a formatting circuit 19 formats it into a packet header with decoding time stamp information and a packet with user data containing the compressed data.
ＤＴＳ生成器１７はチャネル毎の予測符号化データ量に応じて、復号側の入力バッファ２２ａ内の圧縮データを読み出すタイミングを示すデコーディング・タイム・スタンプ情報を生成し、フォーマット化回路１９はデコーディング・タイム・スタンプ情報を含むパケットヘッダと、圧縮データを含むユーザデータを有するパケットにフォーマット化する。 - 特許庁 - The method for detecting the Mycobacterium tuberculosis TB and the nucleotide for nontuberculous mycobacteria NTM includes the steps of (a) amplifying sample DNA having a labeled primer, (b) mixing the amplified DNA product and a running buffer; (c) impregnating a test strip with the mixture, and (d) setting the mixture movable to the reaction zone of the strip.
更に、ヒト結核菌TBと非結核性抗酸菌のヌクレオチドNTMを検出する方法は、(a) 標識プライマーを有するサンプルDNAを増幅する工程と (b) 増幅したDNA産物とランニングバッファを混合する工程と、;(c) テストストリップを混合物に浸し塗りする工程と (d)混合物がストリップの反応領域に移動できるようにする工程と、からなる。 - 特許庁 - To provide a toner feeding device, and the toner replenishing vessel equipped therewith, being made possible to easily transport in a state of containing toner without using such as buffer material, possible to surely acknowledge that the toner is loosened at the time of mounting on the developing part, possible to be easily recovered after using the toner by folding or rolling, and possible to be re-used.
トナーを収納した状態で緩衝材等を使用せずに簡単に運搬でき、現像部に装着するときにトナーがほぐれたことを確実に確認できるとともに、トナーを使用した後には簡単に折畳んだり丸めて回収できるとともに再使用することができるトナー補給容器と、それを使用したトナー供給装置を提供する。 - 特許庁 - An access control unit 1426 determines whether to describe transmission of an acknowledgement response frame in an ACK signal frame to be transmitted based on an analysis result outputted from a frame header analysis unit 1425 and a storage status of a TCP/IP acknowledgement response packet transmission buffer 1423 and instructs the result to a frame transmission/reception processing unit 1424.
アクセス制御部１４２６は、フレームヘッダー解析部１４２５から出力される解析結果と、ＴＣＰ／ＩＰ確認応答パケット送信バッファ１４２３の記憶状況とに基づいて、送信するＡＣＫ信号フレームに確認応答フレームを送信する旨を記載するか否かを判断し、フレーム送受信処理部１４２４に指示する。 - 特許庁 - An n-InP buffer layer 54, GalnAsP group MQW56 of light- emission wavelength, 1,550 nm, p-InP upper-part clad layer 58, p-GalnAs intermediate layer 60, and p-AllnAs oxidized layer 62 are epitaxial-grown sequentially on an n-InP substrate 52 by through MOCVD method, etc., forming a laminated structure.
本作製方法は、ｎ−ＩｎＰ基板５２上に、ＭＯＣＶＤ法等によって、ｎ−ＩｎＰバッファー層５４、発光波長１５５０ｎｍのＧａｌｎＡｓＰ系ＭＱＷ５６、ｐ−ＩｎＰ上部クラッド層５８、ｐ−ＧａｌｎＡｓ中間層６０、及びｐ−ＡｌｌｎＡｓ被酸化層６２を、順次、エピタキシャル成長させて、積層構造を形成する。 - 特許庁 - The organic FET 1 has a gate electrode 2 formed on one side of a gate insulation film 4, an organic semiconductor layer 6 formed on the other side of the gate insulation film 4, source and drain electrodes 10, 12 formed above the layer 6 and disposed with a constant space between them, and a buffer layer 8 formed between both the electrodes 10, 12 and the organic semiconductor layer 6.
有機ＦＥＴ１は、ゲート絶縁膜４の一側にゲート電極２を有しており、ゲート絶縁膜４の他側には有機半導体層６、及びその上方に一定の間隔をおいて配置されたソース電極１０及びドレイン電極１２を有しており、さらに両電極１０，１２と有機半導体層６との間にバッファ層８が形成されている。 - 特許庁 - In this hydraulic buffer 10 for vehicle, a stretched spring 17 is interposed between a damper cylinder 11 and a piston rod 12 extensively inserted into the damper cylinder 11, a cylindrical extension net 40 for covering periphery of the stretched spring 17 is stretched between a fitting part 50 provided on a damper cylinder 11 side and a fitting part 60 provided on a piston rod 12 side.
ダンパシリンダ１１と、ダンパシリンダ１１に伸縮可能に挿入されるピストンロッド１２との間に、懸架スプリング１７を介装した車両用の油圧緩衝器１０において、懸架スプリング１７の外周を覆う筒状の伸縮性ネット４０を、ダンパシリンダ１１の側の取付部５０とピストンロッド１２の側の取付部６０との間に張架したもの。 - 特許庁 - Buffer circuits Q11, Q13 output signals in a semiconductor integrated circuit including a 1st transistor Q11 of which the source and drain are connected to a 1st power supply VSS and an output terminal OUT, respectively, and the gate is connected to an input terminal IN for an internal signal of a semiconductor to the outside of the semiconductor integrated circuit through the output terminal OUT.
バッファ回路Ｑ１１，Ｑ１３は、第１の電源ＶＳＳと出力端子ＯＵＴに各々ソースとドレインが接続され、ゲートが半導体の内部信号の入力端子ＩＮに接続された第１のトランジスタＱ１１を含む半導体集積回路内の信号を半導体集積回路外に力端子ＯＵＴを介して出力する。 - 特許庁 - The transponder body 1A is arranged between two beltlike metal plates 1D, 1E and the metal plate 1D or 1E is welded to the rim of the tire or bonded to the rim of the tire, due to metal plates 1F, 1G provided between two pieces of the beltlike metal plates 1D, 1E as buffer members.
トランスポンダ本体１Ａを２枚の帯状の金属板１Ｄ，１Ｅ間に挟設し、さらに前記２枚の金属板１Ｄ，１Ｅ間に金属板１Ｆ，１Ｇを緩衝部材として設けたため、金属板１Ｄ或いは１Ｅをタイヤのリムに溶接したり、タイヤのリムに接着することにより、既存のタイヤにも容易に装着することができる。 - 特許庁 - If empty capacitance of a buffer disk (disk 16a, 16c) extracted as a disk with largest empty capacitance is greater than capacitance of a file held in a blanked disk (disk 16b) extracted as a disk with largest data capacitance, a destination to move the extracted file is set to said extracted disk.
最も空き容量が大きいディスクとして抽出されたバッファディスク（ディスク１６ａ，１６ｃ）の空き容量が、最もデータ容量の大きいものとして抽出されたブランク化ディスク（ディスク１６ｂ）中に保持されているファイルの容量より大きいときに、この抽出されたファイルの移動先を上記抽出されたディスクに設定する。 - 特許庁 - When the trigger signal is inputted from an infrared detecting sensor 13, a CPU 21 (Fig. 2) prohibits writing of new image signals to the frame buffer 22 (Fig. 2) and searches whether anything matching a template image is included in a frame image F(t0) considered to have shot a product detected by the infrared detecting sensor 13.
ＣＰＵ２１(図２)は、赤外線検知センサ１３からトリガ信号が入力されると、フレームバッファ２２(図２)に対する新たな画像信号の書き込みを禁止するとともに、赤外線検知センサ１３で検出された製品を撮影したとみなせるフレーム画像Ｆ(ｔ０)にテンプレート画像と一致するものが含まれているかを検索する。 - 特許庁 - This device is provided with a stream parser 21 for detecting a Navigation Pack in parallel with a line for interconnecting inputs and outputs, an input pack counter 22 for counting input streams by the pack units of 2048 bytes, and a counter buffer 23 for holding the counter value of the input pack counter 22 when the Navigation Pack is detected by the stream parser 21.
入出力をつなぐラインに並行にＮａｖｉｇａｔｉｏｎ Ｐａｃｋを検出するためのストリームパーサ２１と、入力されるストリームを２０４８バイトのパック単位にカウントする入力パックカウンタ２２と、ストリームパーサ２１によりＮａｖｉｇａｔｉｏｎ Ｐａｃｋを検出した際に入力パックカウンタ２２のカウンタ値を保持するカウンタバッファ２３が設けられる。 - 特許庁 - The change of the adjacent address signal generated corresponding to a display data signal is detected and the ON resistance of a transistor of a pre-buffer constituting an output driver circuit is varied according to presence of the adjacent address signal change to control the change speed (the through rate of an output stage) of an output signal so that the transmission time becomes nearly constant.
表示データ信号に応じて形成される隣接アドレス信号の変化を検出し、出力ドライバ回路を構成するプリバッファのトランジスタのオン抵抗を、隣接アドレス信号の変化の有無に応じて変化させて遷移時間がほぼ一定になるように出力信号の変化速度（出力段のスルーレート）を制御するようにした。 - 特許庁 - A DTS (Digital Theater System) generator 17 generates decoding time stamp information showing timing for reading compressed data in an input buffer 22a at the decoding side according to a predictively encoded data quantity for each channel, and a formatting circuit 19 formats a packet having user data including a packet header with the decoding time stamp information included therein and the compressed data.
ＤＴＳ生成器１７はチャネル毎の予測符号化データ量に応じて、復号側の入力バッファ２２ａ内の圧縮データを読み出すタイミングを示すデコーディング・タイム・スタンプ情報を生成し、フォーマット化回路１９はデコーディング・タイム・スタンプ情報を含むパケットヘッダと、圧縮データを含むユーザデータを有するパケットにフォーマット化する。 - 特許庁 - A sense amplifier part 106 reads a first plurality of bit data or a second plurality of bit data having second bit numbers being twice of the first plurality of bit data from a page buffer device 105 in accordance with an internal control signal having a period being twice of an external control signal for each second bit number and holds temporarily them as holding data.
センスアンプ部１０６は、ページバッファ装置１０５から第１の複数ビットデータ又は当該第１の複数ビットデータの２倍の第２のビット数を有する複数の第２の複数ビットデータを前記第２のビット数ごと外部制御信号の２倍の周期を有する内部制御信号に応じて読み出して保持データとして一時的に保持する。 - 特許庁 - If a transmission indication of priority information is received from a poststage packet control apparatus 50, a prestage packet control apparatus 10 leads out the priority information 2 from a ratio of a band capable of using user apparatuses 1a1 to 1an to a minimum and from a storage situation in a buffer and transmits the priority information 2 to the poststage packet control apparatus 50.
前段パケット制御装置１０は、後段パケット制御装置５０から優先度情報の送信指示を受信すると、ユーザ装置１ａ１〜１ａｎが最低限使用できる帯域の比やバッファにおけるパケットの格納状況から優先度情報２を導出し、後段パケット制御装置５０に当該優先度情報２を送信する。 - 特許庁 - The mounting structure comprises: a plurality of members 2 including at least one of electronic members 7 connected to a wiring board 3 via a connection member 4; a buffer member 5 disposed between a plurality of members 2; and a sealing resin 6 disposed between the plurality of members 2 and between the wiring board 3 the electronic member 7.
接続部材４を介して配線基板３と接続する電子部品７を少なくとも１つ含む複数の部材２と、前記複数の部材２の間に設けられている緩衝部材５と、前記複数の部材２の間と、前記配線基板３と前記電子部品７との間に設けられた封止樹脂６とを有することを特徴とする。 - 特許庁 - The solid-state image sensor has a shunt wiring layer 7d comprising a refractory metal layer 13 to the transfer electrode of a charge transfer portion and has a connection between the transfer electrode or a buffer layer 11d and a shunt wiring layer 7d through an adhesion layer 14 comprising a silicon nitride film at the contact part of this shunt wiring layer 7d.
電荷転送部の転送電極に対して高融点金属層１３から成るシャント配線層７ｄを有し、このシャント配線層７ｄのコンタクト部において転送電極又は緩衝層１１ｄとシャント配線層７ｄとの間が窒化珪素膜から成る密着層１４を介して接続されている固体撮像素子を構成する。 - 特許庁 - The thin film-like photocatalyst composed of ZnS, ZnO or the like is formed by using a complexing agent and a buffer agent selectively and dipping the base material into the solution containing the chemical species (for example, Zn) becoming a precursor to proceed a heterogeneous reaction between the solution and the surface of the base material in the CBD method.
ＣＢＤ法において、錯化剤と緩衝剤を選択的に用いることにより、前駆体となる化学種（例えばＺｎ）を含む溶液に基材を浸し、溶液と基材表面との間で不均一反応を進行させることによって薄膜を基材上に選択的に析出させて、ＺｎＳやＺｎＯなどの薄膜状光触媒を作製する。 - 特許庁 - The retrieved packet is read at each packet unit and multiplexed on a time axis by a packet multiplex processor 3 after storage into a buffer memory 2 for packet multiplex at each HW, then inputted to a common part 11 consisting of a data link layer processor 4, a page divider 5, INF part 6 of data link layer processing and VOQ processor 8.
抽出されたパケットは、各ＨＷ毎にパケット多重用バッファメモリ部２に蓄積された後、パケット単位で読み出されてパケット多重処理部３により時間軸上にパケット多重されて、データリンクレイヤ処理部４、ｐａｇｅ分割部５、ネットワークレイヤ処理ＩＮＦ部６、ＶＯＱ処理部８からなる共通部１１へ入力される。 - 特許庁 - A luminance correcting circuit 5 which receives discriminating and correcting quantity information S4 corrects the luminance of the video signal S1 which is temporarily stored in a frame buffer 3, a contour correcting circuit 6 which receives the information S4 corrects the contour of the video signal S5 after luminance correction and outputs the video signal S6 after luminance and contour correction.
判別・補正量情報Ｓ４を受けた輝度補正回路５は、フレームバッファ３に一時的に蓄えておいた映像信号Ｓ１に輝度補正を施し、また、判別・補正量情報Ｓ４を受けた輪郭補正回路６は輝度補正済み映像信号Ｓ５に輪郭補正を施して、輝度・輪郭補正済み映像信号Ｓ６を出力する。 - 特許庁 - The cleaning material incorporates inorganic matters showing anion exchange performance into a sheet body or into a bag body, and also contains hydrophilic fiber at least as a portion of raw material constituting the sheet body or the bag body, and besides as the hydrophilic fiber, the fiber having ion exchange performance or pH buffer performance (which holds 3-7 pH) is used.
陰イオン交換能を示す無機物がシート体又は袋体に含有させてなる清浄材、及びシート体又は袋体を構成する素材の少なくとも一部には、親水性繊維が含まれている清浄材、更に親水性繊維にはイオン交換能を有する繊維又はｐＨ緩衝能（ｐＨ３〜７を保持）を有する繊維が使用されている清浄材。 - 特許庁 - An area is divided, the outermost side coordinates of a line connecting the length position for the numerical value of a timer of the diagonal of a divided area and the center position of the display area of a frame buffer are obtained and defined as offset coordinates 71 and 72, the divided four areas are respectively divided into two areas and the area indicated by a hatched line is specified.
領域を分割して分割領域の対角線のタイマの数値分の長さ位置とフレームバッファの表示領域の中心位置とを結んだ線の最外側座標を求めてオフセット座標７１、７２とし、分割された４領域をそれぞれ２つの領域に分け、右側の図７に斜線で示す領域を特定する。 - 特許庁 - A communication processing section 32 receives an IP packet storing transmitted IS packets in a segmented state and a control section 43 of a stream processing section 41 buffers the segmented TS packets being a payload of the IP packet to a buffer memory every time acquiring the IP packet, extracts buffered data by each size of the TS packets and outputs the data to a decoder 33.
通信処理部３２は、分断されたＴＳパケットを格納しているＩＰパケットを受信し、ストリーム処理部４１において、制御部４３はＩＰパケットが取得されるたびにそのペイロードである分断されたＴＳパケットをバッファメモリにバッファリングすると共に、バッファリングされたデータをＴＳパケットのサイズごとに取り出してデコーダ３３へ出力する。 - 特許庁 - A phase change memory may be replaced with a low-cost NAND flash because the phase change memory may have sufficiently low cost, and the phase change memory may be replaced with a static random access memory and/or a random access memory in buffer memory packaged in combination with a NAND flash memory because the phase change memory has sufficiently high performance.
相変化メモリは十分に低コストであることが可能であるため、低コストのＮＡＮＤフラッシュと置き換えることが可能であり、相変化メモリは十分高い性能を有するため、ＮＡＮＤフラッシュメモリを伴ってパッケージングされるバッファメモリにおいてスタティックランダムアクセスメモリ及び／又はランダムアクセスメモリと置き換えることが又できる。 - 特許庁 - When a free storage capacity of a reception data buffer 22 is a predetermined first storage capacity or below and the data reception section 21 receives part of the data blocks, the data transmission section 13 transmits the data blocks during transmission as they are and stops the transmission of the data blocks after the data block data transmitted next to the data blocks during the transmission.
受信データバッファ２２の空き記憶容量が予め定める第１の記憶容量以下の状態では、データ受信部２１がデータブロックの一部を受信した場合、データ送信部１３によって送信中のデータブロックはそのまま送信し、この送信中のデータブロックの次に送信するデータブロックデータ以降のデータブロックの送信を停止する。 - 特許庁 - The method for producing the particulate molding comprising protein comprises mixing a raw material containing powdery protein with water or a buffer solution to concentration of 0.00025-0.1 wt.% to prepare a raw material mixture and irradiating the prepared raw material mixture with an ionizing radiation at a dose of 100 Gy to below 200 kGy.
タンパク質からなる粒子状成形体の製造方法は、粉末状のタンパク質を含む原料と水又は緩衝液とを０．０００２５〜０．１重量％になるように混合することにより原料混合液を調製し、調製した原料混合液に電離性放射線を１００Ｇｙ以上２００ｋＧｙ未満の照射線量で照射する。 - 特許庁 - Accordingly, a creeping-round to the clock buffer 13 of the power-supply noises is inhibited not only when the power-supply noises are generated in other circuits 14 to 16 in the semiconductor integrated circuit SC but also when the potential is fluctuated at the power-supply voltage supplied to other circuits 14 to 16 in the semiconductor package SP.
従って、半導体集積回路ＳＣ内において、その他の回路１４〜１６に電源ノイズが発生した場合のみでなく、半導体パッケージＳＰ内において、その他の回路１４〜１６に供給される電源電圧に電位変動が生じた場合であっても、その電源ノイズがクロックバッファ１３に回り込むことが抑制される。 - 特許庁 - At that time, the transaction in the new software prepares exclusive information related with data to be inputted and outputted on the new software by using a mutual exclusive control part so that the transactions in the both software can operate the input and output of data without any contradiction, and the uniqueness of the data can be guaranteed by temporarily invalidating a data buffer part.
この時、新たなソフトウェア中のトランザクションは相互排他制御部を用いて新たなソフトウェア上にも入出力を行なうデータに関する排他情報を作成することで、両ソフトウェア中のトランザクションが矛盾の無いデータ入出力を行い、データバッファ部を一時的に無効とすることでデータの一意性を保証することが出来る。 - 特許庁 - A short SW43 is provided for short-circuiting between the input side and the output side of a booster circuit 42 boosting a power supply voltage VCC supplied from the positive electrode side of a battery cell Vc5 to a drive voltage VCC1 for driving a MOS transistor in a buffer amplifier 30 in a saturation region to be supplied as a drive voltage.
電池セルＶｃ５の正極側から供給される電源電圧ＶＣＣをバッファアンプ３０内のＭＯＳトランジスタを飽和領域で駆動させることができる駆動電圧ＶＣＣ１に昇圧して駆動電圧として供給する昇圧回路４２の入力側と出力側とを短絡させるショートＳＷ４３を備える。 - 特許庁 - To provide a buffer tank capable of not only separating the bubbles from the liquid material but also preventing quality deterioration of a stored liquid material by promoting discharge of bubbles upon injecting the liquid material again at the time of completing a maintenance work, preventing introduction of bubbles into the liquid and improving the airtight property.
液体原料中から気泡を分離することができるのみならず、メンテナンス完了時における液体原料の再注入時に気泡の排出を促進することができると共に、気泡が液中に混入されることを防止し、更に気密性を高くして貯留されている液体原料の品質劣化を防止することが可能なバッファタンクを提供する。 - 特許庁 - The metamorphic buffer layer 20 on a base body 1 has its extension area 20R formed outside a formation part for a semiconductor element across an inter-element separation groove 41 to reduce a substantial step between the semiconductor element and another part adjacent thereto, thereby improving reliability of an insulating layer, a wire, etc., against the stepping.
基体１上のメタモルフィックバッファ層２０を、素子間分離溝４１を挟んで半導体素子の形成部の外側に、メタモルフィックバッファ層２０の延在領域２０Ｒを形成して、半導体素子部と、これに隣接する他部との実質的段差の緩和を図って、この段差に基づく絶縁層、配線等の信頼性の向上を図るものである。 - 特許庁 - The organic light-emitting diode display includes a display panel assembly 50, a support member 70 supporting edges of the display panel assembly and including an opening 715 exposing a rear surface of the display panel assembly, and a buffer member 80 attached to the rear surface of the display panel assembly exposed through the opening of the support member.
本発明による有機発光表示装置は表示パネルアセンブリー５０と、前記表示パネルアセンブリーの周縁を支持すると共に、前記表示パネルアセンブリーの背面を露出する開口部７１５を有する支持部材７０と、前記支持部材の開口部を通して露出された前記表示パネルアセンブリーの背面に付着された緩衝部材８０と、を含む。 - 特許庁 - A nitride semiconductor element 40 includes a low-temperature deposition buffer layer 42 containing AlN on a substrate 41, a first nitride semiconductor single-crystal layer 43 containing the AlN with a first AlN molar fraction, and a second nitride semiconductor single-crystal layer 44 which contains the AlN with a second AlN molar fraction, and the second molar fraction is larger than the first one.
本発明の窒化物半導素子（４０）は、基板（４１）上にAlNを含む低温堆積緩衝層（４２）と第一のAlNモル分率でAlNを含む第一の窒化物半導体単結晶層（４３）と第二のAlNモル分率でAlNを含む第二の窒化物半導体単結晶層（４４）とを含み、第二のAlNモル分率が第一のAlNモル分率より大きい。 - 特許庁 - This circuit can be achieved by constituting each circuit (buffer, predecorder, maindecorder) of a decoding circuit of a semiconductor logic circuit in which the number of stages of cascade of transistors pulling down output nodes are less and true and complementary output signals having almost equal delay times are obtained, and shortening output pulse width of each circuit of the decoding circuit.
上記目的は、デコーダ回路の各回路（バッファ、プリデコーダ、メインデコーダ）を、入力数が多い場合でも出力ノードをプルダウンするトランジスタの縦積み段数が少なく、且つ、ほぼ同じ遅延時間の真及び相補出力信号が得られる半導体論理回路で構成し、該デコーダ回路の各回路の出力パルス幅を短縮することにより達成される。 - 特許庁
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