「data buffer」を含む例文一覧(6933)

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  • An output buffer circuit 110 is provided with an inverter 112, that inverts the output data from an internal circuit 20 and outputs the inverted data to an intermediate node ni, a gate connected to the intermediate node ni, and output transistors(TRs) QP1, QN1, QN2, QN3, that are connected in series between a power wire 80 and a ground wire 90.
    出力バッファ回路110は、内部回路20からの出力データを反転して中間ノードniに出力するインバータ112と、中間ノードniと接続されるゲートを有し、電源配線80と接地配線90との間に直列に接続される出力トランジスタQP1,QN1,QN2,QN3を備える。 - 特許庁
  • In an information processing device equipped with an inputting device such as a key board, a mouse and so on, data corresponding to operations of the inputting devices are obtained by referring to a key buffer or by an API, and the obtained data are periodically stored in a mobile-type nonvolatile storage medium such as a USB memory, an MO disk and so on.
    キーボードやマウス等の入力装置を備える情報処理装置において、前記入力装置の操作に対応するデータをキーバッファの参照やAPIにより取得し、取得した当該データを、USBメモリやMOディスク等の不揮発性の可搬型記憶媒体に時系列的に記憶する。 - 特許庁
  • To obtain an ink jet printer (IJP) buffer system in which the use configuration of the prescribed number of IJPs 81 and BSs can be flexibly set by devising buffering or the like capable of coping with storing a large number of print data different from each other as the prescribed numbers of data for IJPs respectively, high-speed transmission, communication errors, etc. with respect to the prescribed number of IJPs.
    所定台数のIJPに対し、各IJP用の所定件数分として夫々異なる多量の印字データの格納、高速伝送、通信エラー等に対応出来るバッファリング等の工夫を加え、所定台数のIJP81とBSの使用構成がフレキシブルに設定可能なインクジェット印刷装置バッファシステムを得る。 - 特許庁
  • The section 202 detects a predetermined synchronous signal of the transmitted stream (step 3 in Figure), writes the stream data into a buffer 203 from a predetermined position acquired from the information (step 4 in Figure), and notifies a decoder 204 that decoding processing should start after predetermined data quantity is buffered (step 5 in Figure).
    ストリームバッファリング部202は送られたストリームの所定の同期信号を検出し(図4のステップ3)、その情報から得られる所定の位置からバッファ203にストリームデータを書き込み(図4のステップ4)、所定のデータ量をバッファリングした後に復号処理を開始するようにデコード部204へ通知する(図4のステップ5)。 - 特許庁
  • The pipeline processes the Z-coordinate data of both of the images, decides which of the first and the second images is close to the view of the screen and stores the color data of the adjacent image in a frame buffer in preparation for rendering later onto the display screen based on the decision.
    パイプラインは、両方のイメージのZ座標データを処理して、合成されたイメージにおける各ピクセルに関して、第1または第2のイメージのどちらが画面の視点に近接しているかを決定し、その決定に基いて、表示画面上への後のレンダリングに備えて、近接している方のイメージのカラー・データをフレーム・バッファに記憶する。 - 特許庁
  • In the case of inputting a signal for requesting the transmission of new data, a transmission signal switching part 104 outputs the output signal of an error correction encoding part 102, and in the case of imputing a signal for requesting data retransmission, the transmission signal switching part 104 outputs a signal stored in a buffer 103 to a modulating part 106.
    送信信号切替え部104は、新規データ送信を要求する信号を入力した場合、誤り訂正符号化部102の出力信号を変調部106に出力し、データ再送を要求する信号を入力した場合、バッファ103に蓄積されている信号を変調部106に出力する。 - 特許庁
  • The readout position designation circuit 109 specifies, in a frame buffer 106, a first readout region including object data and a second readout region which includes the object data and is different from the first readout region, on the basis of positional information of a plane object in first and second images.
    読出位置指定回路109は、第1及び第2の画像における平面オブジェクトの位置情報に基づいて、オブジェクトデータを含む第1の読み出し領域と、当該オブジェクトデータを含み、第1の読み出し領域とは異なる領域である第2の読み出し領域と、をフレームバッファ106において指定する。 - 特許庁
  • A correlation value calculation section 25 calculates a correlation value between input waveform data and a specific code, based on an operation value obtained by multiplying a data value in a feature section stored in the accumulation value buffer 30 by a feature value, namely a first value or a second value, in the feature section for the specific code.
    相関値算出部25は、累算値バッファ30に格納された特徴区間のデータ値と、特定の符号についての特徴区間における、第1の値或いは第2の値の何れかである特徴値と、を乗算して得られた演算値に基づき、入力波形データと、特定の符号との間の相関値を算出する。 - 特許庁
  • A depth signal for use in expressing the depth is formed by the rendering part 34 of a signal processor 12 as a signal that matches depth data used when the process of hidden surface elimination is implemented using Z-buffer method on polygon data that express the display object three-dimensionally and geometrically.
    その奥行きを表現するために利用する奥行き信号は、信号処理装置12のレンダリング部34において、その表示対象を3次元的に幾何学的に表現するポリゴンデータに対して隠面消去処理をZバッファ法によって行う際に使用された奥行きデータに対応する信号とする。 - 特許庁
  • The holographic data area specifying device 1 is employed for specifying a holographic data area being an area occupied by a hologram from a holographic image input from a photodetector, and is equipped with a frame buffer memory 3, an edge detection means 5, a template comparison means 7, a template image accumulation means 9, and a center-of-gravity detection means 11.
    ホログラムデータ領域特定装置1は、光検出器から入力されたホログラム画像からホログラムが占めている領域であるホログラムデータ領域を特定するものであって、フレームバッファメモリ3と、エッジ検出手段5と、テンプレート比較手段7と、テンプレート画像蓄積手段9と、重心検出手段11と、を備えた。 - 特許庁
  • With regard to several different assignments of the buffer capacity of a printer, dummy data is generated from a host and transferred to the printer, pseudo recording operation is executed, total recording operation time including the data transfer time is measured, an optimal assignment of buffers is determined from the measured time and designated to the printer.
    プリンタ装置のバッファ容量のいくつかの異なる割り当て全てに関し、ホストからダミーデータを生成してこれをプリンタ装置に転送し、擬似的な記録動作を実行させ、データ転送時間も含めた全体的な記録動作の時間を測定し、その測定時間から最適なバッファ割り振りを決定し、これをプリンタ装置に指示する。 - 特許庁
  • A buffer part 21, on the other hand, outputs the sample data stored in the first storage area 200_1 to a DAC 601 and transfers the sample data stored in the second storage area 200_2 to the first storage area 200_1 according to a clock signal A output from a timer 501 in each sampling cycle.
    一方、バッファ部21は、サンプリング周期毎にタイマ501から出力されるクロック信号Aに従って、先頭の格納領域200_1に格納されているサンプルデータをDAC601へと出力し、2番目の格納領域200_2に格納されているサンプルデータを先頭の格納領域200_1に転送する。 - 特許庁
  • In rendering processing, an object to be drawn is a water surface object, new color data (VR', VG', VB') according to color parameters (αr, αg, αb) preset based on the property of water are generated from color data (VR, VG, VB) of an object such as terrain already written in a frame buffer.
    レンダリング処理において、描画対象のオブジェクトが水面オブジェクトである場合、フレームバッファに既に書き込まれている地形等のオブジェクトの色データ(VR,VG,VB)から、水の性質に基づいて予め設定された色パラメータ(αr,αg,αb)に応じた新たな色データ(VR’,VG’,VB’)が生成される。 - 特許庁
  • When the call of commodity sales data is instructed by this call instruction means, the commodity sales data having the terminal number of the other commodity sales registration terminal instructed for call and the latest transaction number is called out in batch, and stored the transaction buffer.
    この呼出指令手段により商品販売データの呼出が指令されると管理サーバのデータファイルに蓄積されているデータの中からその呼出指令された他の商品販売登録用端末の端末番号が付されかつ最新の取引番号が付された商品販売データを一括して呼び出して取引バッファに格納する。 - 特許庁
  • The packet communication equipment 103 directly reports the renewal of data in the case that the power source 104c of the information terminal is turned on and stores the packets in a data buffer 103a, turns on the power source of the information terminal 104 in a power source control part 103b and then transmits the database renewal information in the case that the power source is not turned on.
    パケット通信装置103は、情報端末の電源104cが入っている場合は直接データの更新を通知し、入っていない場合はデータバッファ103aにパケットを蓄積しておき、電源制御部103bで情報端末104の電源を立ち上げた後、データベース更新情報を伝達する。 - 特許庁
  • The CPU 110 performs image processing such as compression processing of imaged data temporarily obtained in the buffer memory 111, starts processing for storing the imaged data subjected to the image processing in the recording memory 113 in response to the end of the compression processing, or the like, and generates a start signal to be given to the camera module 101.
    CPU110は、一時的にバッファメモリ111に取り込まれた撮像データに対して、圧縮処理等の画像処理を行い、画像処理の終了に応答して、画像処理された撮像データを記録用メモリ113に記憶する処理を開始すると共に、カメラモジュール101に与える起動信号を生成する。 - 特許庁
  • In a processor module on the receiving side, a cache controller detects that the header is rewritten, reads communication data stored in the buffer corresponding to the address information stored in the header, stores the address information in a new cache tag, stores the communication data in a cache block, and then interrupts the processor.
    受信側のプロセッサモジュールでは、キャッシュコントローラが、ヘッダが書き換えられたことを検出して、ヘッダに格納されたアドレス情報に対応するバッファに格納されている通信データをリードし、アドレス情報を新たなキャッシュタグに格納するとともに、通信データをキャッシュブロックに格納した後、プロセッサに割込みをかける。 - 特許庁
  • Storage locations in the buffer 30 are associated with specified steps of evaluation cycles of the areas in a transmitting circuit and the receiving circuit, so that data writing and data reading are executed to the storage locations based on steps of present evaluations performed in each cycle in the transmitting and receiving circuits.
    バッファ内の記憶位置は、送信回路クロック領域および受信回路クロック領域の各々の評価サイクルの特定のステップと関連し、送信回路および受信回路のそれぞれの評価サイクル内で行われている現在評価ステップに基づいて、バッファ内の記憶位置に対してデータ書込みおよび読取りを行う。 - 特許庁
  • An area 215 for a unit frame for preparing drawing data by a VDP 183 is provided in the video RAM 204 of a display controller 83, and the prepared drawing data are transferred through a signal path SC1 for drawing signals to an image processing device 206 and stored in a buffer 214 for the device.
    表示制御装置83のビデオRAM204にはVDP183によって描画データが作成される単位フレーム用エリア215が設けられており、この作成された描画データは描画信号用の信号経路SC1を通じて画像処理デバイス206に転送されてデバイス用バッファ214に格納される。 - 特許庁
  • A communication circuit device comprises: a processing part performing radio communication processing; a host interface performing interface processing with a host; and a reception buffer to which reception data included by a packet received from a partner side communication circuit device is written, and from which the host reads out the received data through the host interface.
    通信回路装置は、無線通信処理を行う処理部と、ホストとの間のインターフェース処理を行うホストインターフェースと、相手側通信回路装置から受信したパケットに含まれる受信データが書き込まれ、ホストインターフェースを介して前記ホストにより受信データが読み出される受信バッファーを含む。 - 特許庁
  • A transmit signal switching part 104 outputs the output signal of an error correction encoding part 102 to a modulation part 106 when inputting a signal requesting new data transmission and outputs a signal accumulated in a buffer 103 to the modulation part 106 when inputting a signal requesting data resending.
    送信信号切替え部104は、新規データ送信を要求する信号を入力した場合、誤り訂正符号化部102の出力信号を変調部106に出力し、データ再送を要求する信号を入力した場合、バッファ103に蓄積されている信号を変調部106に出力する。 - 特許庁
  • A buffer memory 250 for catalog playback is provided, in order to provide a catalog function which allows free real-time browsing during playback of audio data, while keeping the compatibility with already determined standards, and contents of a catalog can be automatically reproduced, in matching with the reproducing state of audio data, when a user does not have another selection.
    また、既に定められた規格と互換性を維持し、オーディオを再生する間自由にリアルタイムで閲覧できるカタログ機能の提供のためにカタログ再生用バッファメモリ250を有しており、使用者の別の選択がない場合カタログの内容をオーディオデータの再生状態に合わせて自動に再生できる。 - 特許庁
  • The control part 1111 selects a queue for transferring data in a receiving packet from the multi-queue present in the memory 1103 based on information provided for the receiving packet present in the receiving buffer 1112, and divides the data in the packet to execute a process for transferring them to a predetermined storage location.
    マルチキューDMA制御部1111は、受信用バッファ1112内に存在する受信パケットが備える情報にもとづいて、メモリ1103内に存在するマルチキューの中から、当該パケット内のデータを転送するためのキューを選択して、パケット内のデータを分割して、所定の記憶場所に転送する処理を行う。 - 特許庁
  • The write control is configured to (a) store data, transferred according to a first write request, in the buffer and receive a write request for a data set following a first synchronization request, and (b) return a completion of processing of the first synchronization request after receiving the write request by use of the queuing function.
    書込み制御は、(a)第1のWrite要求により転送されたデータをバッファに保管し、第1の同期要求に続くデータ群のWrite要求を受取り、(b)キューニング機能を利用しWrite要求を受取った後に、第1の同期要求の処理の完了を返す。 - 特許庁
  • A buffer 166A outputs successively sample data of audio data included in the sync-block making a sync-block corresponding top a scan number corresponding to the most sync-block out of sync-blocks stored in a memory space corresponding to ECC blocks of two pieces of the SDRAM163 for each channel and for each field as the sync-block to be used.
    バッファ166Aは、各フィールドについて、チャネル毎に、SDRAM163の2個のECCブロックに対応したメモリ空間に記憶されているシンクブロックのうち、最も多くのシンクブロックが該当するスキャン番号に対応したシンクブロックを使用するシンクブロックとし、そのシンクブロックに含まれるオーディオデータのサンプルデータを、順に出力する。 - 特許庁
  • This disk drive reads data from a disk at an initial rotation speed to store in a temporary buffer memory (S2) when the reproduction of the disk is started, reads the sequential sound signal data to decode it (S3), applies digital processing by a DSP for adjusting volume, and sound quality (S4), and outputs it to the audio output circuit (S5).
    デリスクの再生が開始されると、初期設定の回転速度でディスクからデータを読み取って一時記憶用のバッファメモリに保存し(S2)、順次音声信号データを読み出してデコードし(S3)、DSPにより音量調整や音質調整その他のデジタル処理を施し(S4)、オーディオ出力回路に出力する(S5)。 - 特許庁
  • Concerning this information processor, data to be transmitted to a transmission buffer 5 are stored and while confirming the response (transmission disability/transmission permission) from a communication control IC 2 or PCMCIA interface 4 of communication system, the transmitting operation is performed by using a transmission data request (interruption signal) from the communication control IC 2 or PCMCIA interface 4.
    送信バッファ5に送信するデータを格納し、通信制御IC2あるいは通信系のPCMCIAインタフェース4からの応答(送信不可/送信許可)を確認しながら、通信制御IC2あるいはPCMCIAインタフェース4からの送信データ要求(割込信号)を使用して送信動作を行う。 - 特許庁
  • An inclination correction value calculating part 10 finds an inclination correction value to be found from the size of the error and the number of samples in the frame and a decoded data correcting part 11 corrects the error frame so as to continue it with the next frame by distributing the inclination correction value to the respective sample values in the error frame outputted from a decoded data output buffer.
    傾斜補正値算出部10はエラーの大きさとフレーム内サンプル数とにより求まる傾斜補正値を求め、復号データ補正部11は傾斜補正値を復号後データ出力バッファから出力されるエラーフレーム内の各サンプル値に配分してエラーフレームを次フレームと連続するように補正する。 - 特許庁
  • The nonvolatile semiconductor memory device has a memory cell array 1 using electrically rewritable NAND cells, a column decoder 4, a bit line control circuit 2, a word line control circuit 6, and a data input/output buffer 4, wherein previous writing and confirmation reading are performed after batch erasing of data to put erased memory cells into a desired threshold-value range.
    電気的書き換え可能なNAND型セルを用いたメモリセルアレイ1、カラムデコーダ4、ビット線制御回路2、ワード線制御回路6、データ入出力バッファ4を有し、データの一括消去後に事前書き込みと確認読み出しを行って消去されたメモリセルを、所望のしきい値範囲に追い込むようにした。 - 特許庁
  • Since a buffer controller 9 adds padding data to an MPEG stream outputted from a video encoder/decoder 8 as shown on the top stage of the figure according to GOP data amount adjustment processing as shown in the middle stage of the figure, the head of each GOP is recorded while the head of each GOP is surely made to coincide with the boundary of a cluster.
    GOPデータ量調整処理によれば、図10の上段に示すようにしてビデオエンコーダ/デコーダ8から出力されるMPEGストリームに対し、図10中段に示すように、バッファコントローラ9によりパディングデータが追加されるので、各GOPの先頭は、必ずクラスタの境界と一致して記録されることになる。 - 特許庁
  • The camera part 25 outputs the subject image data photographed at each prescribed time through a camera I/F 26 based on the successive photographing instruction, and the control part 20 temporarily stores the subject image data in the buffer memory of an RAM 20b, and updates the subject images at each prescribed time to display mirror images at a sub-display part 18.
    カメラ部25は、連続撮影命令に基づいて、所定時間毎に撮影した被写体画像データをカメラI/F26を経由して出力すると、制御部20はRAM20bのバッファーメモリに一旦格納し、サブ表示部18に被写体画像を所定時間毎に更新してミラー画像を表示する。 - 特許庁
  • Memories 34a to 34c which stores RGB data supplied in parallel from an image source (22) by respective color components, a multiplexer 36 which reads the RGB data stored in the memories out in series and supplies them to the liquid crystal element, a mode changeover switch 38, a D/A converter 39, and a buffer 40 are integrated in the same integrated circuit.
    画像ソース(22)からパラレルに与えられるRGBデータを各色成分毎に記憶するメモリ34a〜34cと、これらメモリに記憶したRGBデータをシリアルに読出して液晶表示素子に供給するマルチプレクサ36、モード切換スイッチ38、D/A変換器39及びバッファアンプ40とを同一集積回路内に具備する。 - 特許庁
  • Further, a frame position decision means 37 decides a frame position to be processed on the basis of the number of frame data acquired from the number of stored data detection means 36 and storable furthermore in the frame buffer 33, and a frame position update means 34 instructs the frame separate means 31 on the decided frame position to be processed next.
    また、データ蓄積数検出手段36から取得したフレームバッファに更に保持可能なフレームデータの数に基づいて次に処理するフレーム位置をフレーム位置決定手段37により決定し、フレーム位置更新手段34によりフレーム分離手段31に対して決定された次に処理するフレーム位置を指示する。 - 特許庁
  • The processing part 132 determines whether or not the acquired data are valid in byte unit, generates an identifier thereof, make an internal buffer memory 122 retain the both in association with each other, and provides a control signal for requesting an operation start to a word/byte transformation processing part 151 every processing of data in burst unit.
    識別子処理部132は、取得したデータが有効であるか否かをバイト単位で判定し、識別子を生成し、互いに関連付けて内部バッファメモリ122に保持させ、バースト単位のデータを処理する毎に、動作開始を要求する制御信号をワード/バイト変換処理部151に供給する。 - 特許庁
  • An area 215 for a unit frame for preparing drawing data by a VDP 183 is provided in a video RAM 204 of a display controller 83, and the prepared drawing data are transferred through a signal path SC1 for drawing signals to an image processing device 206 and stored in a buffer 214 for the device.
    表示制御装置83のビデオRAM204にはVDP183によって描画データが作成される単位フレーム用エリア215が設けられており、この作成された描画データは描画信号用の信号経路SC1を通じて画像処理デバイス206に転送されてデバイス用バッファ214に格納される。 - 特許庁
  • To provide an optical disk player which can output second data read from a second sector of an optical disk and recorded in a buffer memory when the second sector is designated after outputting first data read from a first sector of an optical disk to a processing circuit for reproducing information, and to provide a program.
    情報の再生を行う処理回路に対し、光ディスクの第1セクタから読み出される第1データを出力した後、第2セクタが指示された場合、バッファメモリに既に記録されている第2セクタから読み出された第2データを出力することが可能な光ディスク再生装置、プログラムを提供することを目的とする。 - 特許庁
  • When an intermediate code image data interpreting part 31 interprets the intermediate code image data to perform a rendering process, if the color designation on/off information is set to invalidate the color information, attribute information including the black information for the process of enhancing resolution is written into a band buffer 14 while no color information is written into it.
    中間コード画像データ解釈部31で中間コード画像データを解釈してレンダリング処理を行う際に、色指定有効/無効情報が色情報を無効とする設定の場合、高解像度化処理のための黒色の情報を含む属性情報をバンドバッファ14に書き込み、色情報については書き込まない。 - 特許庁
  • The sequence control system 1 is provided with a unit sequence 13 carrying out a series of operations from an operation start to an operation finish of a unit, and an operation scheduler 11 having the unit sequence 13 carry out operations so as to conform to completion conditions of the unit in accordance with operation schedule data stored in a data buffer 12x.
    シーケンス制御システム1は、ユニットの運転開始から運転終了までの一連の動作を実行するユニットシーケンス13と、データバッファ12xに記憶された運転スケジュールデータに従って、当該ユニットの完了条件に適合するようにユニットシーケンス13の動作を実行させる運転スケジューラ11とを備える。 - 特許庁
  • The drive ability of the tristate buffer 120 is set so as to provide a propagation delay time such that the scan test data outputted from the QT terminal is propagated to the scan test data input terminal DT of a scan test flip-flop circuit of the next stage and satisfactorily fetched and held therein as desired.
    このトライステートバッファ120の駆動能力は、QT端子から出力されるスキャンテスト用データが次段のスキャンテスト用フリップフロップ回路のスキャンテスト用データ入力端子DTに伝播されて所期通り良好に内部に取り込まれ、保持されるような伝播遅延時間となるような駆動能力に設定される。 - 特許庁
  • To provide a recording apparatus and a recording method for decreasing the capacity of a buffer memory even when a video data recorder having an interface with e.g., a computer adopts the recording apparatus and the recording method is configured to input/output the data to/from the computer so as to enhance the affinity with the computer.
    記録装置及び記録方法に関し、例えばコンピュータとの間のインターフェースを有するビデオデータの記録装置に適用して、コンピュータとの間でもデータを入出力できるように構成してコンピュータとの親和性を高める場合でも、バッファメモリの容量を小さくすることができるようにする。 - 特許庁
  • The print system 100 comprises a buffer memory 17 for storing print data temporarily in a host unit 1 and when the print data is transmitted to a printer 2, information indicative of the type of a sheet loaded in the printer 2 is requested.
    印刷システム100によれば、ホスト装置1に印刷データを一時的に格納するバッファメモリ17を備え、印刷データをプリンタ2に送信する際に、プリンタ2に装填されている用紙の種類を示す用紙種類情報を要求し、プリンタ2に装填されている用紙が印刷データに適合している場合、プリンタ2に印刷データを送信する。 - 特許庁
  • Also, the electronic apparatus includes an acquisition means for acquiring the management information of the broadcasting program, and a size change means for changing the size of the ring buffer to the size required for holding the content data of the entire broadcasting program, before or after starting to hold content data of a received broadcasting program by the management information.
    また、電子機器は、放送番組の管理情報を取得する取得手段と、管理情報を用いて、リングバッファのサイズを、受信された放送番組のコンテンツデータの保持の開始前又は開始後に、該放送番組全体のコンテンツデータを保持するのに必要なサイズに変更するサイズ変更手段と、を有する。 - 特許庁
  • When the processing speed of an encoding/decoding circuit 16 cannot follow that of an image sensor 10, image data obtained by the image sensor 10 is temporarily stored in a printer buffer 19, and this image data is successively read and encoded by the encoding the decoding circuit 16 and is stored in an image memory 6.
    符号化/復号化回路16の処理速度がイメージセンサ10の処理速度に追従できない場合、イメージセンサ10により得られた画データを一旦プリンタバッファ19に格納させ、順次前記画データを読出し符号化/復号化回路16に符号化させ画像メモリ6に格納させる制御を行う。 - 特許庁
  • If the recording medium that is composed of semiconductor devices, which has low access speed information, is mounted on an imaging device and the amount of buffer memory occupation of image data is equal or more than a prespecified value, the imaging device changes camera operation control to reduce the amount of data to be recorded and continuously perform imaging and recording operations.
    低速のアクセス速度情報を有する半導体素子よりなる記録媒体が装着された場合、バッファメモリの画像データによる占有量が予め定めた値以上となる場合には、カメラ動作の制御を変更することで、記録するデータ量を抑え、継続した撮影及び記録の動作を可能とされた撮像装置。 - 特許庁
  • The buffer circuit comprises a first flip flop for synchronously outputting an impedance code to a Pch driver circuit in a pre-driver circuit with externally fed data signals, and a second flip flop for outputting an impedance code to an Nch driver circuit, in the pre-driver circuit synchronously with externally fed data signals.
    外部から供給されるデータ信号に同期してインピーダンスコードをプリドライバ回路のPch駆動回路へ出力する第1のフリップフロップと、外部から供給されるデータ信号の同期してインピーダンスコードをプリドライバ回路のNch駆動回路へ出力する第2のフリップフロップとを有する構成とする。 - 特許庁
  • A jitter flow control 302 conducts recovery or scale revision processing and a decoder 304 reads voice data of a corresponding packet from the reception buffer 41 in the order of pointers of the jitter queue 303 in a read timing in response to the jitter amount, decodes the data and the recovered voice signal is sent to a reception signal line 305.
    ジッタ量制御302により再生又は定規変更処理がなされ、復号器304によりジッタ量に応じた読み出しタイミングでジッタキュー303のポインタの順に受信バッファ41から対応するパケットの音声データが読み出され、復号化され、再生された音声信号が受信信号線305に送出される。 - 特許庁
  • A development controller 412 in a DECU 41 sets the forwarding address individually to each word of developed recording data stored in a line buffer 281 so that a line of data is stored while being arranged in the longitudinal direction in the bit map area of a local memory 29, i.e. a DMA forwarding destination.
    DMA転送先であるローカルメモリ29のビットマップエリアにおいて、1ラインのデータが縦方向に配置されて格納されるように、DECU41内部の展開処理コントローラ412にて、ラインバッファ281に格納されている展開後の記録データに1ワード毎に、転送先アドレスを個別に設定する。 - 特許庁
  • Then the part 8 stores the designate one of shown abbreviated characters, converts the stored abbreviated character into the corresponding character string among those abbreviated characters included in the said directory data by referring to a dictionary 7 and then outputs the directory data from the buffer 5.
    出力制御部8は、表示部3に表示させた省略文字から指定された省略文字を記憶し、バッファ5に展開した住所録データに含まれる省略文字の内、前記記憶した省略文字を、辞書7を参照して、対応する文字列に変換した後、バッファ5の住所録データを出力する。 - 特許庁
  • An image storage processing part 10e takes out an image data written in a frame buffer 11b by executing an application by an application part 10d, in response to an indication for storing the screen shot image, converts the image data into a storage format, adds thereto the identification information recorded in the identification information memory 20, and stores the image.
    画像保存処理部10eは、スクリーンショット画像保存の指示に応じて、アプリケーション部10dによるアプリケーションの実行によりフレームバッファ11bに書き込まれた画像データを取り出し、この画像データを保存形式に変換すると共に、識別情報メモリ20に記録された識別情報を付加して保存する。 - 特許庁
  • An engine interface unit 15 incorporates a FIFO memory, for example, as an image buffer memory, the transfer state of image data is reported through this FIFO memory to a bus arbitrating circuit 16 and the bus arbitrating circuit 16 varies the priority concerning the bus use of a data transfer processing circuit provided in a device to become a bus master.
    エンジンインタフェースユニット15に画像バッファメモリとして、例えばFIFOメモリを内蔵させ、このFIFOメモリを介して画像データの転送状態をバス調停回路16に通知し、バス調停回路16が、バスマスタとなる装置が持つデータ転送処理回路のバス使用に関する優先度を可変とする。 - 特許庁
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