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パルスカウント入力の英語
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パルス入力回路におけるパルスカウント方式例文帳に追加
PULSE COUNT SYSTEM FOR PULSE INPUT CIRCUIT - 特許庁
CPU14は、搬送モータ11のFGパルスをパルスカウント回路18でカウントし、nパルス毎にイベントパルスを発生させ、これをCPU14のイベントパルスカウント回路19に入力する。例文帳に追加
In a CPU 14, an FG pulse of a carriage motor 11 is counted by a pulse count circuit 18, an event pulse is generated in each n-pulse, and the event pulse is inputted to an event pulse count circuit 19 of the CPU 14. - 特許庁
これにより入力信号がオン状態の継続時間に対応した正確なパルスカウント値を与えることができる。例文帳に追加
Thus, an accurate pulse count value corresponding to the duration of the on state of input signal is provided. - 特許庁
今、投入口6を真上の位置で停止させる停止指令を入力すると、現在のパルスカウント数が停止位置に対応するパルスカウント数に近付くと、ベクトルインバータ1の周波数を徐々に低下させ、円筒ドラム4を超低速回転にする。例文帳に追加
When a halt instruction to halt the insertion opening 6 at a directly upward position is inputted and the present pulse count number approaches a pulse count number corresponding to the halt position, the frequency of a vector inverter 1 is gradually lowered to rotate the cylindrical drum 4 at a very low speed. - 特許庁
周波数カウント部11は、入力信号15のN倍の自走クロック信号14とロードパルス信号17とを入力し、分周パルス信号18,19およびパルスカウント値21を出力する。例文帳に追加
A frequency count section 11 receives a self-running clock signal 14 whose frequency is a multiple of N of that of an input signal 15 and a load pulse signal 17 and outputs frequency division pulse signals 18, 19 and a pulse count 21. - 特許庁
ロードパルス生成部13は、分周パルス信号18,19およびパルスカウント値21と検出パルス信号20とを入力し、出力クロック信号16とロードパルス信号17とを出力する。例文帳に追加
A load pulse generating section 13 receives the frequency division pulse signals 18, 19, the pulse count 21 and the detection pulse signal 20 and outputs an output clock signal 16 and the load pulse signal 17. - 特許庁
演算手段は、回転数センサから入力されるパルス信号をカウントしたパルスカウント数を前記表示手段5に表示させる速度検出器チェックモードを行う。例文帳に追加
The operating means has a speed detector check mode for presenting the count of pulse signals received from the r.p.m. sensor on the display means 5. - 特許庁
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「パルスカウント入力」の部分一致の例文検索結果
該当件数 : 8件
上記課題を解決するために、本発明に係るパルスカウント検波回路1は、入力されたFM信号を所定の時間だけ遅延させる遅延回路2と、FM信号と遅延回路2から出力されるFM信号とからパルス信号を生成する演算回路3と、演算回路3から得られたパルス信号を音声信号に変換する音声信号変換回路4と、を備える。例文帳に追加
The pulse count detection circuit 1 for solving the task above is provided with: a delay circuit 2 for delaying a received FM signal by a prescribed time; an arithmetic circuit 3 for generating a pulse signal from the FM signal and a FM signal outputted from the delay circuit 2; and an audio signal conversion circuit 4 for converting the pulse signal obtained from the arithmetic circuit 3 into an audio signal. - 特許庁
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