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MULTI-PORT MEMORYとは 意味・読み方・使い方
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「MULTI-PORT MEMORY」の部分一致の例文検索結果
該当件数 : 61件
MULTI-PORT MEMORY AND ITS CONTROL METHOD例文帳に追加
マルチポートメモリおよびその制御方法 - 特許庁
ARBITER DEVICE FOR MULTI-PORT MEMORY, AND SEMICONDUCTOR DEVICE例文帳に追加
マルチポートメモリのアービタ装置及び半導体装置 - 特許庁
SCANNED MEMORY TESTING METHOD OF MULTI-PORT MEMORY ARRAY (MEMORY ARRAY, MEMORY ARRAY TESTING METHOD, AND MULTI-PORT FLOATING POINT REGISTER)例文帳に追加
マルチポート・メモリ・アレイの走査メモリ・テスト方法(メモリ・アレイ、メモリ・アレイのテスト法、及びマルチポート浮動小数点レジスタ) - 特許庁
MULTI-PORT SEMICONDUCTOR MEMORY DEVICE AND MEMORY CELL ARRANGING METHOD THEREFOR例文帳に追加
マルチポート半導体メモリ装置及びそのメモリセル配置法 - 特許庁
MULTI-PORT MEMORY DEVICE EQUIPPED WITH GLOBAL DATA BUS CONNECTION CIRCUIT例文帳に追加
グローバルデータバス接続回路を備えるマルチポートメモリ素子 - 特許庁
MULTI-PORT MEMORY ARCHITECTURE, DEVICE, SYSTEM, AND METHOD例文帳に追加
マルチポートメモリアーキテクチャ、装置、システム、および方法 - 特許庁
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「MULTI-PORT MEMORY」の部分一致の例文検索結果
該当件数 : 61件
The microprocessor writes image data in the multi-port memory from the first port.例文帳に追加
このマイクロプロセッサは、画像データを第1ポートからマルチポートメモリに書き込む。 - 特許庁
MULTI-PORT VOLATILE MEMORY DEVICE, LOW-SPEED MEMORY LINK TYPE HIGH-SPEED MEMORY DEVICE, DATA PROCESSING APPARATUS AND MULTI-CHIP SEMICONDUCTOR DEVICE例文帳に追加
マルチポート揮発性メモリ装置、低速メモリリンク型高速メモリ装置、データ処理装置及びマルチチップ半導体装置 - 特許庁
To simulate a multi-port memory using a memory having a small number of ports as a bank.例文帳に追加
低ポート数メモリーをバンクとして使用してマルチポートメモリーをシミュレートする。 - 特許庁
Multi-port memory architecture having a multilevel hierarchy typically has one-port memory cells in the lowermost hierarchical level.例文帳に追加
多重階層平面を有するマルチポートメモリアーキテクチャは、典型的には最下位階層平面において1ポートメモリセルを有している。 - 特許庁
MULTI-PORT SEMICONDUCTOR MEMORY DEVICE HAVING VARIABLE ACCESS PATHS, AND METHOD THEREFOR例文帳に追加
可変的アクセス経路を有するマルチポート半導体メモリ装置及びその方法 - 特許庁
MULTI-PORT STATIC RANDOM ACCESS MEMORY FOR COLUMN INTERLEAVED ARRAY例文帳に追加
列インタリ—ブド・アレイのためのマルチポ—ト・スタティック・ランダム・アクセス・メモリ - 特許庁
The multi-port memory architecture also has a circuit for handling access conflict.例文帳に追加
さらにこのマルチポートメモリアーキテクチャは、アクセスコンフリクトを処理するための回路を有している。 - 特許庁
To provide a multi-port semiconductor memory device having reduced bit line voltage offsets and a memory cell arranging method for reducing the bit line voltage offsets in the multi-port semiconductor memory device.例文帳に追加
減少したビットライン電圧オフセットを有するマルチポート半導体メモリ装置、及びマルチポート半導体メモリ装置にてビットライン電圧オフセットを減少させるためのメモリセル配置法を提供する。 - 特許庁
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