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該当件数 : 1件
To provide a device tester which enables security of pins of a number allottable in response to an increase in the number of DUTs and addition of functions, or efficient selection of inexpensive packages, by reducing the number of required pins of each FPGA.例文帳に追加
本発明は、ＦＰＧＡの必要ピン数の削減を図ることにより、ＤＵＴの増加や機能追加に対応して割り当て可能なピン数を確保し、あるいは安価なパッケージの効率的な選択を可能とするデバイステスタを提供することを目的としている。 - 特許庁
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