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Period address data 21 are set as 'm bits', and the constitution of period memories 13 and 14 is respectively set as '2n-1word*n bits', and period data are set as maximum '2n bits', and a counter 11 is set as a '2n bit' counter, and the period of a clock signal 22 is set as T.例文帳に追加
ピリオドアドレスデータ２１を“ｍビット”、ピリオドメモリ１３、１４の構成をそれぞれ“２^m-1ワード＊ｎビット”、ピリオドデータを最大“２ｎビット”、カウンタ１１を“２ｎビット”カウンタ、クロック信号２２の周期をＴとする。 - 特許庁
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