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意味・対訳 チップレベル


JST科学技術用語日英対訳辞書での「chip-level」の意味

chip level


「chip-level」の部分一致の例文検索結果

該当件数 : 454



例文

CONTAINER FOR BLOOD SUGAR LEVEL TEST CHIP例文帳に追加

血糖値検査チップ用容器 - 特許庁

LEVEL DETECTING ELECTRODE CHIP FOR ELECTRODE TYPE LEVEL GAUGE例文帳に追加

電極式液面計用液面検出電極チップ - 特許庁

When the update chip level signal and an old sync chip level signal are inputted and the sync chip level is lower than the pedestal level, the update chip level signal is outputted to a selector; and when the chip level is higher, the old sync chip level is outputted to the same.例文帳に追加

セレクタには、更新チップレベル信号と旧シンクチップレベル信号が入力されシンクチップレベルがペデスタルレベルより低い場合は、更新チップレベル信号、高い場合は旧シンクチップレベル信号を出力する。 - 特許庁

A wafer level chip scale package includes a semiconductor chip 410 having multiple edge pads.例文帳に追加

複数のエッジパッドが備えられた半導体チップ410を含む。 - 特許庁

The sync chip level detection circuit outputs an update chip level signal in a fixed cycle.例文帳に追加

シンクチップレベル検出回路は、一定の周期で更新チップレベル信号を出力する。 - 特許庁

RECEIVER HAVING CHIP-LEVEL EQUALIZATION例文帳に追加

チップ・レベルの等化を有する受信機 - 特許庁

例文

MANUFACTURING METHOD OF WAFER LEVEL CHIP SCALE PACKAGE例文帳に追加

ウェハーレベルチップスケールパッケージの製造方法 - 特許庁

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Weblio専門用語対訳辞書での「chip-level」の意味

chip-level~

Weblio専門用語対訳辞書はプログラムで機械的に意味や英語表現を生成しているため、不適切な項目が含まれていることもあります。ご了承くださいませ。

「chip-level」の部分一致の例文検索結果

該当件数 : 454



例文

WAFER LEVEL CHIP-SIZE PACKAGE AND MANUFACTURING METHOD THEREOF例文帳に追加

ウエハレベルチップサイズパッケージ及びその製造方法 - 特許庁

SENSOR CHIP REMOVAL APPARATUS IN BLOOD SUGAR LEVEL MEASURING DEVICE例文帳に追加

血糖測定器におけるセンサーチップ除去装置 - 特許庁

METHOD FOR MANUFACTURING WAFER LEVEL CHIP SIZE PACKAGE例文帳に追加

ウエハレベルチップサイズパッケージの製造方法 - 特許庁

CHIP-LEVEL PACKAGE OF LIGHT EMITTING DIODE例文帳に追加

発光ダイオードのチップレベルパッケージ - 特許庁

At the cell level and then in organs on a chip例文帳に追加

そして器官レベルでチップに記述して - 映画・海外ドラマ英語字幕翻訳辞書

vi 3. Design for DES Key Search Array Chip-Level Specification ..3-1発音を聞く 例文帳に追加

3. DES 鍵探索アレイの設計:チップレベルの仕様 ..3-1 - Electronic Frontier Foundation『DESのクラック:暗号研究と盗聴政策、チップ設計の秘密』

Design for DES Key Search Array Chip-Level Specification発音を聞く 例文帳に追加

DES 鍵探索アレイの設計:チップレベルの仕様 - Electronic Frontier Foundation『DESのクラック:暗号研究と盗聴政策、チップ設計の秘密』

例文

The synchronization determination level setting part 40 is provided with a sync chip level detection circuit, a comparison circuit, a chip level selection circuit, a sync chip level holding part, and an adder.例文帳に追加

同期判定レベル設定部は、シンクチップレベル検出回路、比較回路、チップレベル選択回路、シンクチップレベル保持部及び加算器を備える。 - 特許庁

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