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A pulse skip circuit of a logic circuit 3 outputs a skip signal and stops PWM signal output in a period when the PWM signal is not at Hi level after an output voltage VOUT rises and a voltage level of an error signal EAO of an error amplifier 8 falls below a voltage level of a triangular wave SLOPE.例文帳に追加
また、出力電圧ＶＯＵＴが上昇し、エラーアンプ８の誤差信号ＥＡＯの電圧レベルが低下して三角波ＳＬＯＰＥの電圧レベルよりも低くなり、ＰＷＭ信号がＨｉレベルとならない期間が発生すると、ロジック回路３のパルススキップ回路がスキップ信号を出力し、ＰＷＭ信号の出力を停止する。 - 特許庁
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