「bits」を含む例文一覧(6183)

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  • Just smart people moving bits. different rules.
    頭のいい人たちがビットを動かしている 別のルールがそこでは動いているのです - 映画・海外ドラマ英語字幕翻訳辞書
  • Well, we have all the tape and drill bits that we need.
    おかげで 僕らは必要なテープも穴あけドリルも 全部持ってて 不自由してない - 映画・海外ドラマ英語字幕翻訳辞書
  • Hiyashi Tanuki' (cold noodles with bits of tempura batter) and 'Hiyashi Kitsune' (cold noodles with fried tofu) typify Hiyashi-Udon.
    代表的なものとして「冷やしたぬき」「冷やしきつね」などが挙げられる。 - Wikipedia日英京都関連文書対訳コーパス
  • In the areas such as the Kanto region, Tanuki soba means a bowl of noodles in hot soup with tenkasu (crunchy bits of deep-fried tempura batter produced as a byproduct of cooking tempura) on top.
    関東などでは、天かす（揚げ玉）をのせたものを指す。 - Wikipedia日英京都関連文書対訳コーパス
  • The loop starting at NEXT BIT is repeated as many times as the number of bits in the field
    NEXT BITから始まるループは, このフィールドのビット数に達するまでくり返される - コンピューター用語辞典
  • ice in the sea that consists of bits of ice formed by excessive cooling, which stick together, called pack ice
    粗氷という,過冷却した氷滴が物に付着してできる氷 - EDR日英対訳辞書
  • a kind of food made of mashed bits of fish and boiled with sugar, vinegar and soy sauce
    もみほぐした魚肉を砂糖やみりん,しょうゆなどでいり煮した食べ物 - EDR日英対訳辞書
  • A right shift by n bits is equivalent to division by pow(2, n) without overflow check.
    n ビットの右シフトは、オーバフローチェックを行わないpow(2, n) による除算と等価です。 - Python
  • The AllPlanesmacro returns a value with all bits set to 1 suitable for use in a planeargument to a procedure.
    これはプレーンを引き数とする関数で、プレーンとして使える値になる。 - XFree86
  • This mask is the bitwise inclusive OR of the valid controlmask bits. values
    このマスクは有効な制御マスクビット値のビットごとの論理和を取ったものである。 - XFree86
  • To provide a semiconductor device capable of chip size reduction and multiple bits.
    チップサイズの縮小化や多ビット化に対応した半導体装置を提供する。 - 特許庁
  • If you want to make hydrogen, you can make it easily from bits of zinc, and sulphuric or muriatic acid.
    水素をつくりたければ、 亜鉛のかけらと硫酸か塩酸で作れます。 - Michael Faraday『ロウソクの科学』
  • Suppressing a DC component under limitation of k=7 or 8 is performed by using a encoding table in which an input data word in a unit of 4 bits can be converted to an input data word in a unit of 6 bits with (1, k) RLL rule without using redundant bits.
    冗長ビットを用いること無しに（１、ｋ）ＲＬＬ規則で、ｋ＝７あるいは８の制限下におけるＤＣ成分の抑圧を、４ビット単位の入力データ語を６ビット単位の入力データ語に変換可能な符号化テーブルを用いて行う。 - 特許庁
  • To provide an AIS (Alarm Indication Signal) detection circuit which has a small circuit scale and is flexibly applied to an optional AIS condition by detecting an AIS when m bits of an input signal are continuously "1" and permitting errors of n bits in the m bits.
    入力信号がｍビット連続して「１」であるとき、ＡＩＳ検出とし且つｍビット中ｎビットの誤りを許容する、回路規模が小さく且つ任意のＡＩＳ検出条件に柔軟に適用できるＡＩＳ検出回路を提供すること。 - 特許庁
  • The semiconductor integrated circuit has an external bus controller for controlling an external bus to which a plurality of external devices are commonly connected, including an external device whose number of input/ output bits is equal to the number of bits smaller than the number of bits of the external bus.
    本発明は、外部バスのビット数より少ないビット数を入出力ビット数とする外部デバイスを含めた複数の外部デバイスを共通に接続する外部バスをコントロールする外部バスコントローラを搭載した半導体集積回路に関する。 - 特許庁
  • When there is a received error in any block after second one, waiting time 51 until the transmission end of data blocks is calculated as (number of bits in bit synchronizing signal + number of bits in frame synchronizing signal 2 + number M of bits in data block) × (number of remaining non-received blocks).
    ２ブロックめ以降で受信誤りがあれば、データブロックが送信終了までの待ち時間５１は、（ビット同期信号のビット数＋フレーム同期信号２のビット数＋データブロックのビット数Ｍ）×（受信できなかった残りブロック数）と算出する。 - 特許庁
  • According to the degrees of effect on the sound quality, the error correction code to be added is adjusted with a relatively large ratio for code bits of high degrees of effect or higher-order bits, while the error correction code to be added is adjusted with a relatively small ratio for bits of low degrees of effect.
    音声品質への影響度に応じて、影響度の高い符号ビットや上位ビットに対しては相対的に多い割合で誤り訂正符号を付加し、低いものには相対的に少ない割合で誤り訂正符号を付加する。 - 特許庁
  • The tag can include pre-programmed memory bits (e.g., bits the value of which is programmed by printing), or alternatively, memory bits formed by conventional photolithography, but having connections made using printing technology to form the identifier.
    タグは、予めプログラムされたメモリビット（例えば、その値が印刷によってプログラムされたビット）、或いは、旧来のフォトリソグラフィによって形成され、識別子を形成するために印刷技術を用いて作られた接続を有するメモリビットを含むことが可能である。 - 特許庁
  • The tag storage part stores: refill bits (R) for indicating whether a line is being refilled; dirty bits (D0, D1, D2, and D3) indicating whether data for each word is dirty; and tag bits (Tag) indicating an address in a main storage for the data stored on a line.
    タグ格納部は、ラインがリフィル中であるか否かを示すリフィルビット(R)と、ワード毎にワードにおけるデータがダーティであるか否かを示すダーティビット(D0,D1,D2,D3)と、ラインに格納されたデータの主記憶におけるアドレスを示すタグビット(Tag)を格納している。 - 特許庁
  • In a 1st step 11, four bits as an element of a 16×16 matrix table specified with a row number which is the high-order four bits of an 8-bit input bit array and a column number which is the low-order four bits are outputted.
    第１ステップ１１においては、８ビットの入力ビット列の上位４ビットを行番号、下位４ビットを列番号として、これら行番号と列番号で指定される１６×１６行列テーブルの要素である４ビットを出力する。 - 特許庁
  • ID vectors as prescribed information representing the names, addresses, etc., of respective entities are generated as L-dimensional binary vectors and divided into J ID divided vectors Iej (j=1, 2,..., J) by block size M1 bits, M2 bits,..., and MJ bits.
    複数設けられた各センタ１は、各エンティティの特定情報（ＩＤ情報）を分割した分割ベクトルと、分割ベクトル内の各成分毎に相異ならせて設定した個人秘密乱数とを利用して、各エンティティ固有の秘密鍵を生成して配布する。 - 特許庁
  • In a writing part 20, the first output terminal 21a (16 bits) of a bus width converter 21 is connected in parallel with both of the first input terminal group 11a (lower 16 bits) and the second input terminal group 11b (upper 16 bits) of a frame memory 10.
    書き込み部２０においては、バス幅変換器２１の第１出力端子２１ａ（１６bit）は、フレームメモリ１０の第１入力端子群１１ａ（下位１６bit）と第２入力端子群１１ｂ（上位１６bit）との両方に、並列的に接続されている。 - 特許庁
  • An error diffusion processing circuit 3 switches the number of lower-order bits used for characteristic error diffusion, i.e., lower-order 4 bits for 12 bit inverse gamma compensation and lower-order 3 bits for 11 bit inverse gamma compensation by linking to the changeover of inverse gamma compensation characteristics.
    誤差拡散処理回路３は、逆ガンマ補正特性を切り換えるのに連動して、１２ビットの逆ガンマ補正では下位４ビット、１１ビットの逆ガンマ補正では下位３ビットのように、特性誤差拡散に用いる下位ビットのビット数を切り換える。 - 特許庁
  • For example, the video encoder or the video decoder uses an intermediate pixel values with a dynamic range (in the unit of bits) wider than a final range to calculate a pixel value at a sub-pixel sample position (e.g. an intermediate value of 16 bits and an output value in 8 bits).
    例えば、ビデオエンコーダまたはビデオデコーダは、最終的な値より広いダイナミックレンジ（ビット単位）を有する中間ピクセル値を使用して、サブピクセルサンプル位置のピクセル値を計算する（例えば、１６ビットの中間値および８ビットの出力値）。 - 特許庁
  • General data having 16 bit length and a high speed non-requirement instruction code are added with parity 5 bits, and a high speed requirement instruction code having 12 bit length is added with parity 9 bits in the form of "4+parity 3 bits"×3, and stored in a built-in memory 2.
    １６ビット長を持つ一般データおよび高速不要命令コードにはパリティ５ビットを付加し、１２ビット長を持つ高速要命令コードには「４＋パリティ３ビット」×３の形式で都合パリティ９ビットを付加して内蔵メモリ２に格納する。 - 特許庁
  • Transmission data composed of A+B-bits are a plurality of division data which have respectively A-C-bits or below, and identification information composed of C-bits or below is added to each of the plurality of division data to form input data of the PSC which is synchronized with the clock.
    Ａ＋Ｂビットからなる送信データを、それぞれがＡ−Ｃビット以下にされる複数の分割データとし、複数の分割データのそれぞれにＣビット以下からなる識別情報を付加してクロックに同期したＰＳＣの入力データを形成する。 - 特許庁
  • A soft decision Viterbi decoder 6 gathers state transitions corresponding to a plurality of code words by using the least common multiple of the number of bits of code words and the number of bits of sub symbols for the number of bits of the processing unit and uses amplitude information of the sub symbols to carry out soft decision Viterbi decoding.
    軟判定ビタビ復号器５で、符号語のビット数とサブシンボルのビット数の最小公倍数を処理単位ビット数として、複数符号語に対応する状態遷移をまとめて、サブシンボルの振幅情報を使って軟判定ビタビ復号する。 - 特許庁
  • The encoding apparatus converts an audio signal in the time domain to an audio signal in the frequency domain and quantizes the audio signal, counts the number of data bits to obtain the number of available bits per layer, and modifies the number of available bits per layer considering the size of ancillary information.
    符号化装置では、時間領域のオーディオ信号を周波数領域信号に変えて量子化してデータビット数をカウントし、階層当りの可用ビット数を求め、付加情報の大きさを考慮して階層当りの可用ビット数を修正する。 - 特許庁
  • A subcarrier to map parity bits among a systematic bit (S) and parity bits (P_1, P_2) created by encoding transmitted bits (encoding rate R=1/3) is defined as a transmission cancel candidate, and a subcarrier not to be transmitted is selected out of the candidates.
    送信ビットを符号化（符号化率Ｒ＝１／３）することによって作成されるシステマチックビット（Ｓ）とパリティビット（Ｐ_１、Ｐ_２）のうち、パリティビットがマッピングされるサブキャリアを送信キャンセル候補とし、それらの候補の中から送信を行わないサブキャリアを選択する。 - 特許庁
  • However, a symbol including a redundant bit is set so as to make a symbol value to be the maximum or minimum value among possible four values, and respective bits of the encoded sound data become a value "0" when the bits show the nonexistence of a component corresponding to the bits.
    ただし、冗長なビットを含むシンボルは、シンボル値が、とり得る４値の最大値又は最小値となるように設定され、また、符号化された音声データの各々のビットは、当該ビットに対応する成分の不存在を示すとき、値“０”をとる。 - 特許庁
  • The communication device 1 on the transmission side places data having a plurality of bits in one clock period, and transmits a plurality of data groups having at least continuous two bits among the plurality of bits as the same data to the communication device 4 on the reception side.
    送信側の通信装置１は、１クロック周期の中に複数ビットのデータを入れ込み、その際、前記複数ビットの内少なくとも連続する２ビットを同一データとして持つ複数のデータ群として前記受信側の通信装置４送信する。 - 特許庁
  • This method writes and reads a periodic pattern containing di-bits and isolated bits and a periodic pattern containing only isolated bits while synchronizing with the revolution of a magnetic disk, then frequency analyzes each reproduced wave shape by making their phases match each other to obtain odd harmonics components.
    ダイビットおよび孤立ビットを含む周期パターンと孤立ビットのみの周期パターンとを磁気ディスクの回転に同期して読み書きし、位相が一致した状態でそれぞれの再生波形を周波数解析し奇数次高調波成分を求める。 - 特許庁
  • To provide a computing element for detecting actually necessary bits for operation execution and performing operation only for the number of necessary bits, and to provide a communication apparatus which includes the computing element.
    演算実行時に実際に必要なビットを検出し、必要なビット数分のみの演算を行う演算器およびこの演算器を有する通信装置を提供すること。 - 特許庁
  • A predicted pixel value-forming section 12 forms a predicted pixel value with respect to high-order bits of a new input pixel, referring to high-order bits of past input pixel data.
    予測画素値生成部１２は過去の入力済み画素データの上位ビットを参照して新たな入力画素の上位ビットに対する予測画素値を生成する。 - 特許庁
  • In order to write and maintain multi-gradation data consisting of a plurality of weighted bits, at least one field is divided into a plurality of sub-fields corresponding to a plurality of the bits.
    重み付けされた複数ビットからなる多階調データを書き込み維持する為、複数ビットに対応して少くとも一フィールドを複数のサブフィールドに分割する。 - 特許庁
  • To provide a semiconductor storage device which is capable of 2 bits operation and is easy for miniaturizing.
    ２ビット動作が可能で、微細化が容易な半導体記憶装置を提供する。 - 特許庁
  • Test data of 8 bits given from an input pin 20 are extended into 32 bits in an extension part 21, and passed to an input terminal CI of a core part 10 via a selector 22.
    入力ピン２０から与えられた８ビットの試験データは、拡張部２１で３２ビットに拡張され、セレクタ２２を介してコア部１０の入力端子ＣＩに与えられる。 - 特許庁
  • The high-order one or more bits in the sub-overlay network ID also indicate the sub-overlay network ID of a sub-overlay network at the high hierarchical level corresponding to the number of the one or more bits.
    サブオーバーレイネットワークＩＤの上位ビットは、当該上位ビットのビット数に対応した上位の階層のサブオーバーレイネットワークのサブオーバーレイネットワークＩＤも示す。 - 特許庁
  • The attribute bits are used to check the memory state of an address used by the program.
    この属性ビットを用いてプログラムが使用するアドレスのメモリ状態をチェックする。 - 特許庁
  • A carry-in bit input to each adder is combined with the pseudo-noise sequence bits.
    加算器のキャリーインビット入力は、前記擬似ノイズシーケンスビットのビットと結合される。 - 特許庁
  • To make it possible to display a high definition image based on the image data of the number of bits exceeding a limited number of bits without increasing the frame memory capacity.
    フレームメモリの容量を増加させること無しに、制限ビット数を超えるビット数の画像データに基づいての高精細な画像の表示を行うことを可能とする。 - 特許庁
  • To enable speed conversion, even when M/N has a fractional part if the number of bits of an unconverted input signal is defined as M and the number of bits of a converted output signal is defined as N.
    変換前入力信号のビット数をＭ、変換後出力信号のビット数をＮとした時、Ｍ／Ｎが小数部を持つ場合でも速度変換をできるようにする。 - 特許庁
  • In the case of extending data 1 in m-bit into data 2 in n-bit (n>m), data in lower-order (n-m) bits of the data 2 are made equal to data in higher-order (n-m) bits of the data 1.
    ｍビットのデータ１をｎビット（ｎ＞ｍ）のデータ２に拡張する際に、データ２の下位ｎ−ｍビットのデータをデータ１の上位ｎ−ｍビットのデータと同じにする。 - 特許庁
  • METHOD AND APPARATUS FOR RECOVERY OF PARTICULAR BITS OF RECEIVED FRAME
    受信したフレームの特定ビットを正常な状態に戻すための方法及び装置 - 特許庁
  • The control information is convolutionally coded using either a single set of tail bits or by judiciously dispersing the tail bits among different portions of the encoded signaling information.
    制御情報は、１組のテールビットあるいはテールビットを符号化されたシグナリング情報の別々の部分の間に分散させることによりたたみ込み符号化される。 - 特許庁
  • Rotational position indicator bits are made to be related to each servo sector 30 so that the known bits of the prescribed bit pattern are related to the known positions of the magnetic storage medium 50.
    その所定ビットパターンの既知ビットが、磁気記憶媒体５０の既知位置に関連するように、回転位置インディケータビットがそれぞれのサーボセクタ３０に関連せしめられる。 - 特許庁
  • To conduct a digital-to-analog conversion of a high accuracy for an input digital signal of multiple bits.
    多ビットの入力デジタル信号に対し精度の高いＤ／Ａ変換を行う。 - 特許庁
  • Audio data are written to a data register 11 in order in units of a fixed number of bits.
    データレジスタ１１には、オーディオデータが一定ビット数単位で順次書き込まれる。 - 特許庁
  • To provide a method for solving the problem that a large number of bits are required for a row number selection means and that a high cost is required for signal wiring corresponding to the number of bits.
    行番号選択手段に必要とされるbit数が多く、そのbit数分の信号配線が必要でコスト高になるという問題を解消する方法を提供する。 - 特許庁
  • Data of upper 2 gradation bits B3, B2 among the 4 gradation bits B0 to B3 are stored respectively in memory areas 23, 22 as data having respectively the function of a control bit.
    ４つの階調ビットＢ０〜Ｂ３のうち、上位２つの階調ビットＢ３，Ｂ２のデータは、それぞれ制御ビットの機能を持ったデータとして、メモリ領域２３，２２に格納する。 - 特許庁
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