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timing designとは 意味・読み方・使い方
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「timing design」の部分一致の例文検索結果
該当件数 : 238件
TIMING DESIGN METHOD OF SEMICONDUCTOR INTEGRATED CIRCUIT例文帳に追加
半導体集積回路のタイミング設計方法 - 特許庁
To provide a technique relating to LSI design and development and capable of realizing, for example, reduction of inefficient timing measures in timing design.例文帳に追加
ＬＳＩ設計・開発に係わり、タイミング設計における非効率的なタイミング対策の削減などを実現できる技術を提供する。 - 特許庁
SEMICONDUCTOR DESIGN SUPPORT DEVICE, TIMING CONSTRAINT GENERATION METHOD, AND PROGRAM例文帳に追加
半導体設計支援装置、タイミング制約生成方法、およびプログラム - 特許庁
The timing limit is provided by a design budget (delay distribution) A6.例文帳に追加
タイミング制約は、デザインパジェット（遅延配分）Ａ６により得る。 - 特許庁
To provide a timing design facilitation method and a design device, facilitating controllability and estimation of wiring between gates important in a timing design without losing the whole optimality of a logic circuit layout design.例文帳に追加
論理回路レイアウト設計の全体最適性を失うことなく、タイミング設計で重要となるゲート間配線の見積もり、制御性を容易にするタイミング設計容易化方法および設計装置を提供する。 - 特許庁
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「timing design」の部分一致の例文検索結果
該当件数 : 238件
To provide a technique which performs a design and check including timing specifications and prevents re-design in a design downstream and can improve a design efficiency and quality in a system of a design and a verification of a circuit board.例文帳に追加
回路基板の設計及び検証のシステムにおいて、タイミング仕様を含む設計及びチェックを行い、設計下流工程での手戻りを未然に防止して設計効率・品質を向上できる技術を提供する。 - 特許庁
To reduce redoing at a downstream process, to shorten a design period and to improve design quality by timing distribution and timing verification in consideration of a floor plan at an upstream process regarding the timing distribution of an LSI and a PCB in system circuit design.例文帳に追加
システム回路設計に当たり、ＬＳＩやＰＣＢのタイミング配分に関し、上流工程においてフロアプランを考慮したタイミング配分及びタイミング検証により、下流工程の手戻りを削減するとともに、設計期間を短縮化及び高品質化できるようにする。 - 特許庁
The method also includes performing a first timing analysis of the design and the layout and updating the design and the layout.例文帳に追加
本方法はデザイン及びレイアウトの第１のタイミング分析を実行し、デザイン及びレイアウトを更新することも含む。 - 特許庁
To shorten a design required time by simplifying timing convergence for the design change(ECO) of a circuit after the layout of clock wiring.例文帳に追加
クロック配線のレイアウト後における回路の設計変更（ＥＣＯ）に対して、タイミング収束を容易にして設計所要時間を短縮する。 - 特許庁
To shorten the interval of a design by improving timing and suppressing the repetition of re-layout in a layout design of an LSI.例文帳に追加
ＬＳＩのレイアウト設計において，タイミング改善と再レイアウトの繰り返しを抑え，設計期間の短縮を図る。 - 特許庁
To reduce a load of timing closure on design side and a load of OPC and process verification on manufacture side, and to improve design efficiency.例文帳に追加
設計側のタイミングクロージャの負荷、更には製造側のＯＰＣ及びプロセス検証の負荷を軽減し、設計効率の向上をはかる。 - 特許庁
To provide a logic circuit that facilitates timing design of a clock system and reduces the design period in the logic circuit of a gated clock system.例文帳に追加
ゲーテットクロック方式の論理回路において、クロック系のタイミング設計を容易化し設計期間を短縮する論理回路の提供。 - 特許庁
To provide a delay circuit that can reduce a design period required for a timing adjustment while suppressing increase in the difficulty of the design itself.例文帳に追加
設計自体の困難度の増加を抑制しつつ、タイミング調整に要する設計期間を短縮することが可能な遅延回路を提供すること。 - 特許庁
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