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＜前へ 1 2 .... 451 452 453 454 455 456 457 458 459 .... 476 477 次へ＞- A high density Si-doped GaN buffer layer 2 having an Si concentration of 4×10^19cm^-3 or higher is epitaxially grown on a single crystal insulating substrate 1, and the nitride semiconductor layer 3, having a crystal structure of a single crystal is formed by an epitaxially growing method.
単結晶の絶縁性基板１上に、Ｓｉ濃度が４×１０^１９ｃｍ^−３以上である高濃度ＳｉドープＧａＮバッファ層２をエピタキシャル成長し、このＳｉドープＧａＮバッファ層２上に、エピタキシャル成長法により単結晶の結晶構造を有する窒化物半導体層３を形成する。 - 特許庁 - The input terminal 10a is connected with the photodiode PD, and this interface conversion device 10 inputs the electric current generated by the photodiode PD to the input terminal 10a, and outputs the signal of a frequency corresponding to the amplitude of the input electric current from the buffer amplifier 18 to the counting unit 19.
このＩ／Ｆ変換装置１０は、入力端１０ａがフォトダイオードＰＤと接続されており、フォトダイオードＰＤで発生した電流を入力端１０ａに入力して、その入力した電流の大きさに応じた周波数の信号をバッファアンプ１８から計数部１９へ出力する。 - 特許庁 - A memory section 11 of a buffer section 1 temporarily stores a received main signal by two cells, a retiming section 12 outputs only with retiming not through the memory section 11, and a select section 13 selects a path through which the received main signal passes through the memory section 11 or a path through which the received main signal passes through the retiming section 12.
バッファ部１のメモリ部１１は２セル分の入力主信号を一時蓄え、リタイミング部１２は入力主信号をメモリ部１１を通さずにリタイミングのみで出力させ、セレクト部１３は入力主信号がメモリ部１１を通るパスと入力主信号がリタイミング部１２を通るパスとのうちの一方を選択する。 - 特許庁 - An elastic body or buffer material is interposed in the gap formed in the axial direction between the rotary strike component and a body housing or case housing the rotary strike component.
回転打撃発生機構部のアンビルを回転打撃部品と先端工具部品とに分離し、回転打撃部品とこの先端工具装着部品の間にトルク伝達部を形成し、回転打撃部品とこの回転打撃部品を収納している本体ハウジング或いはケースの軸方向の隙間に弾性体もしくは緩衝材を介在させる。 - 特許庁 - An analog detection signal A0 is amplified by a buffer amplifier 21, subsequently amplified by a small signal amplifier 22 having a large gain for a small signal and by a large signal amplifier 22 having a small gain for a large signal, and converted to digital data by a small A/D 24 and by a large A/D 25, respectively.
アナログ検出信号Ａ０を、バッファアンプ２１で増幅した後、小信号用の大きな利得を有する小信号用アンプ２２と、大信号用の小さな利得を有する大信号用アンプ２３とで増幅し、小信号用Ａ／Ｄ２４、大信号用Ａ／Ｄ２５でそれぞれディジタルデータに変換する。 - 特許庁 - When the writing section B is informed to this effect, a connection shape/end shape writing means E does not perform writing of the end shape with final one of a series of line information delivered from the buffer C for storing line information but performs writing of the connection shape with line information being delivered next.
そして、前記描画処理部Ｂがその通知を受けたとき、接続形状／終端形状描画手段Ｅは、ライン情報格納用バッファＣから渡される一連のライン情報の最後のライン情報で終端形状の描画処理を行わず、次に渡されるライン情報とによって接続形状の描画処理を行う。 - 特許庁 - To obtain a CDV control system to constantly monitor a CDV(Cell Delay variation) value to be generated in an ATM(Asynchronous Transfermode) network and to control the quantity of cells to be stored inside a buffer for absorbing CDV by dynamically fluctuating it by the CDV value to be generated.
ＡＴＭ（Ａｓｙｎｃｈｒｏｎｏｕｓ Ｔｒａｎｓｆｅｒ Ｍｏｄｅ：非同期転送モード）ネットワークで発生するＣＤＶ（Ｃｅｌｌ Ｄｅｌａｙ Ｖａｒｉａｔｉｏｎ：セル遅延揺らぎ）値を常時モニタし、ＣＤＶ吸収用バッファ内部に蓄積するセルの量を、発生するＣＤＶ値によりダイナミックに変動させて制御するＣＤＶ制御方式を提供する。 - 特許庁 - On the other hand, a read control part 26 performs the rotating processing of image data by reading the image data out of the buffer memories 24 and 25 based on the rotating angle and outputs the image data while replacing one part with fixed value data stored in a fixed register 214 corresponding to the rotating angle and number of lines to be added.
一方、読み出し制御部２６は、バッファメモリ２４，２５からの画像データの読み出しを、回転角度に基づいて行うことによって画像データの回転処理を行うとともに、回転角度と付加ライン数に応じて、画像データの一部を固定レジスタ２１４に格納された固定値データと置換して出力する。 - 特許庁 - A switching means 301 to switch each signal of each detection amplifier 81 connected to each sected sensor 1-4 by interlocking with the main scanning position of exciting light L3, an addition means 302 to add a signal which passes the switching means 301, and the readout control circuit 300 having a buffer amplifier 303 are provided.
分割された各センサ１〜４と各別に接続された検出アンプ８１の各信号を励起光L3の主走査位置に連動して切り替える切替手段３０１、切替手段３０１を通過した信号を加算する加算手段３０２、およびバッファアンプ３０３を有する読出制御回路３００を設ける。 - 特許庁 - The display time data in the D pack are separated to display start time data and display end time data by a display time decoder 51 and impressed to a start comparator 52 and an end comparator 53, and the character data are converted to dot matrix character data for display by a character data decoder 54 and stored in a buffer 55.
Ｄパック内の表示時間データは表示時間デコーダ５１により表示開始時間データと表示終了時間データに分離されてスタートコンパレータ５２とエンドコンパレータ５３に印加され、文字データは文字データデコーダ５４により表示用のドットマトリクス文字データに変換されてバッファ５５に格納される。 - 特許庁 - A development controller 412 in a DECU 41 sets the forwarding address individually to each word of developed recording data stored in a line buffer 281 so that a line of data is stored while being arranged in the longitudinal direction in the bit map area of a local memory 29, i.e. a DMA forwarding destination.
ＤＭＡ転送先であるローカルメモリ２９のビットマップエリアにおいて、１ラインのデータが縦方向に配置されて格納されるように、ＤＥＣＵ４１内部の展開処理コントローラ４１２にて、ラインバッファ２８１に格納されている展開後の記録データに１ワード毎に、転送先アドレスを個別に設定する。 - 特許庁 - Then the part 8 stores the designate one of shown abbreviated characters, converts the stored abbreviated character into the corresponding character string among those abbreviated characters included in the said directory data by referring to a dictionary 7 and then outputs the directory data from the buffer 5.
出力制御部８は、表示部３に表示させた省略文字から指定された省略文字を記憶し、バッファ５に展開した住所録データに含まれる省略文字の内、前記記憶した省略文字を、辞書７を参照して、対応する文字列に変換した後、バッファ５の住所録データを出力する。 - 特許庁 - When one of the objects in one lower layer of the above-mentioned object is selected by the operation section 101, the main thread 103 does not access the server 152 at that timing, but reads the list of the object names in one lower layer of the corresponding object and the attribute information from the processing result buffer 122, and displays them on a display 102.
操作部１０１により、上述したオブジェクトの一下位層のいずれかのオブジェクトが選択されると、メインスレッド１０３は、そのタイミングでサーバ１５２にはアクセスせず、対応するオブジェクトの一下位層のオブジェクト名の一覧と属性情報を処理結果バッファ１２２より読み出してディスプレイ１０２表示する。 - 特許庁 - The display time data in the A-CONT pack are separated to display start time data and display end time data by a display time decoder 51 and applied to a start comparator 52 and an end comparator 53, and character data are converted to dot matrix character data for display by a character data decoder 54 and stored in a buffer 55.
Ａ−ＣＯＮＴパック内の表示時間データは表示時間デコーダ５１により表示開始時間データと表示終了時間データに分離されてスタートコンパレータ５２とエンドコンパレータ５３に印加され、文字データは文字データデコーダ５４により表示用のドットマトリクス文字データに変換されてバッファ５５に格納される。 - 特許庁 - Through the clock cannot be stopped for holding these stored contents in conventional devices, the data used also after recovery from the sleep mode such as the TOC are transferred in this device from the buffer RAM 7 to the SRAM 16 mounted on a digital signal processing part 5 through a microcomputer interface 33 and a memory control part 31, and backed up.
従来この記憶内容を保持するためにクロックを停止する事が出来なかったが、ＴＯＣのような、スリープモードから復帰したあとも使用するデータは、バッファＲＡＭ７からマイコンインターフェイス３３、メモリ制御部３１を介してデジタル信号処理部５に搭載されたＳＲＡＭ１６に転送され、バックアップされる。 - 特許庁 - To sufficiently secure a holding time by a buffer means of a recording medium in which an image is recorded by a printing means and to prevent cut off of image recording in the recording medium by the printing means, even when the image recording in the recording medium by the printing means is speeded up.
印刷手段による記録媒体に対する画像記録が高速化された場合でも、印刷手段により画像が記録された記録媒体のバッファ手段における保持時間を十分に確保すると共に、印刷手段による記録媒体に対する画像記録の中断が生じることを防止する。 - 特許庁 - In synchronism with the timing of starting the fluctuation of the respective patterns, a CPU 60 performs the processing of chip-selecting a control output port 69 and outputting a left pattern-under-fluctuation signal, a center pattern- under-fluctuation signal and a right pattern-under-fluctuation signal through a unidirectional output buffer 70 to an external output connector 71.
この各図柄を変動開始するタイミングに同期して、ＣＰＵ６０は、制御出力ポート６９をチップセレクトし単一方向出力バッファ７０を介して外部出力コネクタ７１に左図柄変動中信号、中図柄変動中信号及び右図柄変動中信号を出力する処理を行う。 - 特許庁 - A process for selecting a data unit from a buffer, a process for deciding whether the data unit is the last data of the transmission window, and a process for transmitting polling information together with the data unit when the data unit is decided to be the last data of the transmission window, are sequentially performed to transmit a signal of the communication system.
バッファーからデータユニットを選択する過程と、前記データユニットが送信ウインドーの最後のデータであるかを判断する過程と、前記データユニットが送信ウインドーの最後のデータと判断された時、前記データユニットと共にポーリング情報を伝送する過程と、を順次行って通信システムの信号を伝送する。 - 特許庁 - An improved decoder when receiving pitch lag of a next receive frame uses a matching curve between pitch lag of a previous receive frame and pitch lag of a next receive frame to finely adjust estimation of pitch lag of a lost frame and adjusts and corrects an adaptive code book buffer before use by following frames.
改良されたデコーダが次の受信フレームのピッチラグを受信すると、前の受信フレームのピッチラグと次の受信フレームのピッチラグとの間に適合する曲線を用いて、紛失フレームのピッチラグの推定を微調整し、適応コードブックバッファを後続するフレームによる使用の前に調整および訂正する。 - 特許庁 - This three-dimensional curve-forming system 100 includes: an existing curve storage part 22 associating and previously storing Z buffer values and position data of points constituting a curve in the three-dimensional space; and an input reception means 11 receiving an input curve that is the curve in the two-dimensional space input to a display plane by the user.
三次元曲線化システム１００は、三次元空間の曲線を構成する点の位置データと、Ｚバッファ値とを対応付けて予め記憶する既存曲線記憶部２２と、ユーザによって表示平面に入力された二次元空間の曲線である入力曲線を受け付ける入力受付手段１１とを備える。 - 特許庁 - By a delay (a'+b'+c'+d' or e') given to the feedback clock signal by an input buffer 112 and a DLL delay circuit 113 installed in a feedback path, a delay (a+b+c+d or e) given to a data strobe signal DSQ inputted to the memory control LSI 1 is compensated.
引き戻し経路に配設された入力バッファ１１２およびＤＬＬ遅延回路１１３によって引き戻しクロック信号に与えられる遅延（ａ’＋ｂ’＋ｃ’＋ｄ’またはｅ’）により、メモリ制御ＬＳＩ１に入力されるデータストローブ信号ＤＱＳに与えられる遅延（ａ＋ｂ＋ｃ＋ｄまたはｅ）が補償される。 - 特許庁 - To provide a D/A conversion circuit whose conversion precision can be enhanced without the need for a buffer circuit for weighting purpose where a deviation due to weighting of an output voltage in low-order bits produced resulting from parallel connection between a resistance array for low-order bits and resistors for generating a reference voltage is avoided.
重み付けするためのバッファ回路を設ける必要がなく、かつ、下位ビット用の抵抗列を基準電圧発生用の抵抗と並列接続することから発生する下位ビットの出力電圧の重み付けによるズレをなくすことにより、ＤＡ変換精度を向上させることができるＤＡ変換回路を提供する。 - 特許庁 - After processings up to this step S27 are finished, in the frame buffer, by the synthesis accompanied with shifting in the step S25 and the synthesis accompanied with shifting in this step S27, the image part with high brightness becomes to higher brightness and in the surroundings, the image data with a distribution in accordance with the synthesis accompanied with the shift and high brightness are formed.
このステップＳ２７までの処理を終了すると、フレームバッファには、ステップＳ２５でのずらしを伴う合成と、このステップＳ２７でのずらしを伴う合成とにより、明度が高い画像部分はより明度が高くなるとともに、その周囲もずらしを伴う合成に応じた分布で明度の高い画像データが生成される。 - 特許庁 - When the detected amount of data is equal to a predetermined amount or larger, the stream output control part 205A determines recording to the 1st recording device as abnormal, and changes the recording destination to a separate 2nd recording device 107, and records the digital signal read from the temporary write buffer 204 to the 2nd recording device 107.
ストリーム出力制御部２０５Ａは、前記検出したデータ量が所定量以上である場合、第１の記録装置１０５への書込みが正常でないと判定して、記録先を別の第２の記録装置１０７へ振り替え、一時書込みバッファ２０４から読み出したデジタル信号を第２の記録装置１０７に記録する。 - 特許庁 - An image storage processing part 10e takes out an image data written in a frame buffer 11b by executing an application by an application part 10d, in response to an indication for storing the screen shot image, converts the image data into a storage format, adds thereto the identification information recorded in the identification information memory 20, and stores the image.
画像保存処理部１０ｅは、スクリーンショット画像保存の指示に応じて、アプリケーション部１０ｄによるアプリケーションの実行によりフレームバッファ１１ｂに書き込まれた画像データを取り出し、この画像データを保存形式に変換すると共に、識別情報メモリ２０に記録された識別情報を付加して保存する。 - 特許庁 - When image data is supplied from the host PC 110, the image data is supplied to the laser driver 19 through the buffer memory 36, a control part 16, a FIFO memory 34, and a driving pulse generation part 35, and laser light is radiated in accordance with the image data to form a visible image on the thermosensitive face of the optical disk D.
一方、ホストＰＣ１１０から画像データが供給された場合、その画像データがバッファメモリ３６、制御部１６、ＦＩＦＯメモリ３４および駆動パルス生成部３５を介してレーザドライバ１９に供給され、画像データに対応したレーザ光照射が行われ、光ディスクＤの感熱面に可視画像が形成される。 - 特許庁 - The buffer part 4 is equipped with a plurality of thin plates 6 in rows having a certain mutual spacing 5 in the train advancing direction A, a floor plate 7 laid on the tops 6a of the thin plate 6, and a wire rope 6 inserted into through holes 6b formed in the thin plates 6 for coupling together the thin plates 6.
緩衝部４は、列車の進行方向Ａに所定の相互間隔５を有して、複数配列して設けられる薄板６と、薄板６の上端部６ａに敷設される床板７と、それぞれの薄板６に設けられた貫通孔６ｂに挿入され、薄板６を連結するワイヤーロープ８とを備える。 - 特許庁 - The problems are solved by a system that is used in the three-dimensional computer graphics and includes an initial vertex buffer store (Primary Vertex Cache Store, PVC), a vertex processing unit (VPU), a secondary vertex cache store (SVC), a primitive engine (PE), a fixed primitive assembly (FPA) and a vertex cache controller (VCC), or the like.
上記課題は，３次元コンピュータグラフィックスに用いられるシステムであって，初期頂点バッファストア（Primary Vertex Cache Store, ＰＶＣ）と，頂点プロセッシングユニット（ＶＰＵ）と，第2の頂点キャッシュストア（ＳＶＣ）と，プリミティブエンジン（ＰＥ）と，固定プリミティブアセンブリ（ＦＰＡ）と，頂点キャッシュ制御装置（ＶＣＣ）とを具備するシステムなどにより解決される。 - 特許庁 - Thereafter, the metal board under the insulating resin layer 12 is etched, whereby outer terminals 19, a board reinforcing bodies 20, and mount reinforcing bodies 21 are formed on the underside of the insulating resin layer 12, and buffer metal layers 25 to 27 and a pad 18 are formed on the metal-exposed part of a circuit board 11.
この後、絶縁樹脂層１２の下面の金属板をエッチングすることで、絶縁樹脂層１２の下面に外部端子１９と基板補強体２０と搭載部補強体２１を同時に形成した後、回路基板１１の金属露出部に、無電解メッキ等によりバッファメタル層２５〜２７とパッド１８を形成する。 - 特許庁 - When receiving traffic to the destination of a wireless communication terminal in a doze state (S30: Y), in a state such that there is no empty buffer, an access point generates and transmits a frame for avoiding traffic to another access point, and avoids all traffics which have been buffered to the destination of the radio communication terminal in the doze state (S40).
アクセスポイントは、バッファの空きがない状態でドーズ状態中の無線通信端末宛のトラフィックを受信した場合（Ｓ３０；Ｙ）、他のアクセスポイントにトラフィックを回避するためのフレームを生成、送信して、ドーズ状態中の無線通信端末宛にバッファしていた全てのトラフィックを回避する（Ｓ４０）。 - 特許庁 - Through processing at steps S16 and S18, a source musical performance data series is read forward to sequentially update generation style control data in a current value array area, and after the musical performance data series is read out, generation style control data left in the current value array area are written to the head of a reverse reproduction buffer area.
ステップＳ１６，Ｓ１８の処理より、元演奏データ列を順方向に読み出して現在値配列エリア内の発生態様制御データを順次更新し、演奏データ列の読み出し終了後、ステップＳ２０の処理により、現在値配列エリアに残っている発生態様制御データを逆再生バッファエリアの先頭に書き込む。 - 特許庁 - This electric power steering device 10 has a bearing 50 rotatably supporting a worm wheel 44 as a steering assist gear independently of a pinion shaft 13, and the buffer member 60 is sandwiched between a lock part 65 of an arm 64 connected to the pinion shaft 13 and a lock part 66 provided in the worm wheel 44.
電動パワーステアリング装置１０において、操舵アシストギヤとしてのウォームホイール４４をピニオン軸１３とは独立して回転自在に支持する軸受５０を備えるとともに、緩衝部材６０をピニオン軸１３に結合したアーム６４の係止部６５と、ウォームホイール４４に設けた係止部６６との間に挟持してなるもの。 - 特許庁 - The semiconductor layers 3a, 3b are formed to local areas on the buffer layer 2, and a channel layer 4 is formed in the dopant concentration lower than the semiconductor layers 3a, 3b using the same semiconductor material as the semiconductor substrate 1 on the opposing edges of the semiconductor layers 3a, 3b, or between the opposing edges thereof.
そして、緩衝層２上に夫々局所的に半導体層３ａ及び３ｂを形成し、この半導体層３ａ及び３ｂの対向する端部上及びこれらの間に、半導体基板１と同じ半導体材料を使用し、半導体層３ａ及び３ｂよりもドーパント濃度が低いチャネル層４を形成する。 - 特許庁 - This game machine is provided with the signal line for conducting signals maintaining the identity with main signals transmitted and received by a control part, a signal inversion timing maintaining circuit such as a buffer for preventing or suppressing the change of the inversion timing of reflecting signals holding a threshold level therebetween on the signal line and a connection connector for connecting the inspection equipment.
制御部の送受信する主信号との同一性を維持した信号を導通する信号線と、その信号線上に、閾値レベルを挟んだ反映信号の反転タイミングの変化を防止ないし抑制するバッファ等の信号反転タイミング維持回路と、検査機器に接続するための接続コネクタを備えた。 - 特許庁 - An engine interface unit 15 incorporates a FIFO memory, for example, as an image buffer memory, the transfer state of image data is reported through this FIFO memory to a bus arbitrating circuit 16 and the bus arbitrating circuit 16 varies the priority concerning the bus use of a data transfer processing circuit provided in a device to become a bus master.
エンジンインタフェースユニット１５に画像バッファメモリとして、例えばＦＩＦＯメモリを内蔵させ、このＦＩＦＯメモリを介して画像データの転送状態をバス調停回路１６に通知し、バス調停回路１６が、バスマスタとなる装置が持つデータ転送処理回路のバス使用に関する優先度を可変とする。 - 特許庁 - To effectively mitigate shock when the shock is given from a vehicle body side of a vehicle to a seated occupant in a seat, to keep the conformity feeling with the vehicle, to keep the excellent ride quality on the vehicle, and to provide a seat buffer device of simple constitution.
乗り物の車体側からシートへの着座者に向って衝撃力が与えられようとするとき、この衝撃力が効果的に緩和させられるようにすると共に、乗り物との一体感が良好に保たれて、この乗り物への乗り心地が良好に保たれるようにし、かつ、これが簡単な構成で達成されるようにする。 - 特許庁 - The wireless communication apparatus includes: a battery state monitoring section 111 for monitoring a battery state of the battery; and a communication traffic control section 108 for determining a data time interval capable of obtaining a charge recovery effect on the basis of the battery state and controlling extraction of data from the transmission buffer at the data time interval.
無線通信装置は、バッテリのバッテリ状態を監視するバッテリ状態監視部１１１と、バッテリ状態に基づいて、チャージリカバリ効果が得られるデータ時間間隔を決定し、そのデータ時間間隔で送信バッファからデータを取り出すように制御する通信トラヒック制御部１０８とを有する。 - 特許庁 - The drive system of the display is provided with a plurality of synchronous read/write memories which are made to be a buffer for access to the frame, an image signal generator which processes a digital image, a clock controller which is used as a memory and performs clock control, and a plurality of data drivers which receive the image data and display the same on the display.
このディスプレイの駆動システムはフレームにアクセスするバッファとされる複数の同期読み書きメモリと、ディジタル画像を処理する画像信号ジェネレータと、メモリとして使用されると共にクロックコントロールを行なうクロックコントローラと、画像データを受け取りディスプレイに表示させる複数のデータドライバと、を具えている。 - 特許庁 - In a storage device, a write-back processing part 45 secures a parity buffer region 52 on a cache memory 28 to generate new parity at the occurrence of a write-back request of writing back new data on the cache memory 28 in a disk device taking redundant configuration of the RAID 5, and then writes new data and new parity in a corresponding disk device.
ライトバック処理部４５は、キャッシュメモリ２８上の新データをＲＡＩＤ５の冗長構成をとるディスク装置に書戻す書戻し要求発生時に、キャッシュメモリ２８上にパリティバッファ領域５２を確保して新パリティを生成した後に、新データ及び新パリティを対応するディスク装置に書き込む。 - 特許庁 - The switching section 284 uses the high speed clock CLK3 from the clock conversion section 21 as a switching command to select one bit each out of the 10-bit data of the parallel form according to a predetermined order and output the one-bit data from an output terminal 284b, thus, converts the parallel data into serial data, and transmits the data to an output buffer 286.
切替部２８４は、クロック変換部２１からの高速クロックCLK3を切替指令として用いることで、パラレル形式の１０ビットデータ中から１ビットずつ所定の順序に従って選択して出力端子２８４ｂから出力することで、パラレルデータをシリアル形式のデータに変換し、出力バッファ２８６に渡す。 - 特許庁 - The second weld part β1 and a third weld part γ1 with the respective sheet-like cells 2 placed on the circuit board 3 are formed with metallic thin film parts 6 on the circuit board 3, and the metallic thin film parts 6 buffer ultrasonic vibration to prevent deterioration and strength fall of the sheet-like laminated assembly without opening the melting hole.
回路基板３に各々のシート状電池２が載置された上記第２溶着部β１や第３溶着部γ１では、回路基板３に金属薄膜部６が形成され、この金属薄膜部６が超音波振動を緩衝し、溶融穴が開くことなくシート状積層接続体１の変質や強度の低下を防止する。 - 特許庁 - To provide a blotting device and a blotting method that not only compare favorably with a case using filter paper regarding transfer efficiency, and staining properties by an antibody of a nucleic acid or a protein molecule transferred to a blotting film but also have improved supply efficiency of a buffer solution to gel and use a repeatedly usable water-absorbing substance.
転写効率やブロッティング膜に転写された核酸又は蛋白質分子の抗体による染色性に関して濾紙を用いる場合とほとんど遜色がないばかりか、ゲルへの緩衝液の供給効率に優れ、繰り返し使用が可能な吸水性物質を用いるブロッティング装置及びブロッティング方法を提供する。 - 特許庁 - This method for isolating and purifying a nucleic acid comprises (a) removing cell fragments and other particles with a filter layer reducing the pore diameter viewed in the flow direction or the direction to make a sample flow and (b) then treating the resultant eluate with an anion exchanger in a buffer solution at a low ionic strength or a high ionic strength.
核酸を単離及び精製する方法と、その装置として、ａ）細胞破片及び他の粒子を流れの方向に、又は試料が流れる方向に見てポア径が小さくなるフィルター層によって除く、ｂ）該溶出液をその後、低イオン強度又は高イオン強度のバッファー溶液中で陰イオン交換体により処理する。 - 特許庁 - The primitives are then subjected to a second, normal rendering, processing pass, but the filled Z-buffer 16 and Z-pyramid 8 from the first processing pass are used together with the Z-tests 7 and 10 performed in the second processing pass to determine which primitive should be processed for each sampling point in the second processing pass.
次いで、これらのプリミティブは、第2の通常レンダリングの処理パスに通されるが、第1の処理パスからの書き込まれたZバッファ16およびZピラミッド8は、第2の処理パスで実行されるZテスト7、10とともに使用され、第2の処理パスにおけるそれぞれのサンプリング点についてどのプリミティブが処理されるべきかを決定する。 - 特許庁 - To provide a mold automatic clamp device in a tire vulcanizer constituted so as to absorb upward external force when the upward external force unexpectedly acts on the clamp rod of the automatic clamp device by an operational mistake or the like to buffer an impact and capable of reducing the deformation of the clamp rod or the damage of an internal structure.
操業上のミス等により自動クランプ装置のクランプロッドに不測に上向き外力が作用した場合でも、この上向き外力を吸収して衝撃を緩衝させ、クランプロッドの変形や内部構造の破損といった被害をできるだけ軽減することができるタイヤ加硫装置における金型自動クランプ装置の提供。 - 特許庁 - The method for manufacturing a resist liquid includes the steps of measuring the concentration and/or viscosity of a liquid in a preparation tank, controlling supply amounts of a source liquid and a solvent for dilution based on the measurement, and reserving the resist liquid for products obtained by controlling dilution in a buffer tank for a predetermined period to stabilize.
レジスト液製造方法において、調合タンク内の液体の濃度及び／又は粘度を測定し、この測定結果に基づいて原料液と溶剤の注入分量を調整して希釈制御を行なうとともに、希釈制御されて得られた製品用レジスト液をバッファ槽にて一定期間貯留して安定化させる。 - 特許庁 - A control part 11 switches a stream switching signal 121 so as to designate the black image stream when the termination part of an image stream is supplied to a buffer 15 in performing image reproduction, and switches an image switching signal 122 so as to designate another image signal 124 after a prescribed time passes from the time when the termination part is supplied.
制御部１１は、映像再生時に映像ストリームの終端部分がバッファ１５に供給された時点で、ストリーム切替信号１２１を黒映像ストリームを指定するように切り替え、その時点から所定時間経過後に、映像切替信号１２２を他の映像信号１２４を指定するように切り替える。 - 特許庁 - A p-type hydrogenated microscopic crystal silicon layer 103 whereon a microscopic crystal silicon thin film solar battery si formed on a substrate 101, a microscopic crystal buffer layer 104, an i-type hydrogenated structure, containing at least an n-type hydrogenated microscopic crystal silicon layer 106, and a reflection electrode, formed on the laminated structure, are provided.
微結晶シリコン薄膜太陽電池が、基板と、該基板の上に形成された、ｐ型水素化微結晶シリコン層、微結晶バッファ層、ｉ型水素化微結晶シリコン層、及びｎ型水素化微結晶シリコン層を少なくとも含む積層構造と、該積層構造の上に形成された反射電極と、を備える。 - 特許庁 - This device comprises a fixing jig 20 detachably fixing a measuring cell 12 on a surface of an electric power cable 11, which is provided with a film-like piezoelectric device 13, a detecting electrode 14 placed on a face of the device 13, and a buffer block 15 placed on the other face of the device 13.
フィルム状の圧電素子１３と、圧電素子１３の一方の面上に設けられた検出電極１４と、圧電素子１３の他方の面上に設けられた緩衝ブロック１５を備えた測定用セル１２を、電力ケーブル１１の表面上に着脱可能に固定する固定治具２０を備えている。 - 特許庁 - Since the holding means 11 has elasticity, the means 11 can buffer the load caused by the object contact, and since the portion which is not supported by the support means 12 in the holding means 11 is easily deformable by load application caused by the object contact, the load caused by the object contact can be buffered furthermore.
また、保持手段１１は弾性があるので、物体の接触による荷重を緩衝することができる上、保持手段１１において支持手段１２により支持されていない部位は物体の接触による荷重の印加により変形しやすいので、物体の接触による荷重をさらに緩衝することができる。 - 特許庁
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