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ハードウェアアクセラレータの英語
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「ハードウェアアクセラレータ」を含む例文一覧
該当件数 : 11件
モードの移行を高速に行なうハードウェアアクセラレータを提供する。例文帳に追加
To provide a hardware accelerator which performs mode transition at high speed. - 特許庁
モードの移行を高速に行なうハードウェアアクセラレータを提供する。例文帳に追加
To provide a hardware accelerator which makes a mode transition rapidly. - 特許庁
マイクロコードエンジンを用いたＪａｖａ（登録商標）ハードウェアアクセラレータ例文帳に追加
ハードウェアアクセラレータは、性能を改善するためのホットロックへのアクセスを管理する。例文帳に追加
A hardware accelerator manages access to hot locks to improve performance. - 特許庁
情報処理装置に浮動小数点バイトコードの実行に好適なハードウェアアクセラレータを実現する。例文帳に追加
To achieve a hardware accelerator suitable for execution of a floating-point byte-code in an information processing device. - 特許庁
処理装置がハードウェアアクセラレータを高速に起動させることができる半導体回路を提供することを課題とする。例文帳に追加
To provide a semiconductor circuit for enabling a processor to quickly start a hardware accelerator. - 特許庁
３次元グラフィックスのハードウェアアクセラレータを用いて、ノンゼロワインディングルールで閉領域図形を高速に描画できるようにする。例文帳に追加
To provide a drawing processing apparatus which performs a fast drawing process of a closed region pattern with a non-zero winding rule, using a hardware accelerator of three-dimensional graphics. - 特許庁
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「ハードウェアアクセラレータ」を含む例文一覧
該当件数 : 11件
Ｊａｖａ（登録商標）ハードウェアアクセラレータの解読ステージ１０２とマイクロコードステージ１０４とを分けることは、解読ステージが単一Ｊａｖａ（登録商標）バイトコードの多数のネイティブ命令への変換を可能にする間に、命令レベル並列処理を実施することを可能にする。例文帳に追加
A decoding stage 102 can convert a single Java (R) byte code into many native commands and execute a command level parallel process by dividing a Java (R) hardware accelerator into the decoding stage 102 and a microcode stage 104. - 特許庁
ハードウェアアクセラレータ等に対する割込み要求が競合した場合、タスクの優先度に応じて割込みを受付ながら、特定のタスクの処理が著しく低下することを防ぐことによって処理全体の効率を高められる情報処理装置を提供する。例文帳に追加
To provide an information processor for improving the efficiency of the entire processing by preventing the significant decline of the processing of a specified task while receiving interruption according to the priority of the task when interruption requests to a hardware accelerator or the like conflict. - 特許庁
本発明は、アプリケーションに特化したハードウェアアクセラレータを含んでいるリソグラフィシミュレーション装置構造を利用しており、および、マスクデザインの実証、描写および／または検査を容易にし加速する処理手法を利用している。例文帳に追加
A lithography simulation device structure including a hardware accelerator that is specialized to an application is utilized, and a processing technique that facilitates and accelerates the verification, characterization and/or inspection of a mask design is also utilized. - 特許庁
本発明は、アプリケーションに特化したハードウェアアクセラレータを含んでいるリソグラフィシミュレーション装置構造を利用しており、および、マスクデザインの実証、描写および／または検査を容易にし加速する処理手法を利用している。例文帳に追加
This systen and method employs a lithography simulation system architecture including application-specific hardware accelerators, and a processing technique to facilitate and accelerate verification, characterization and/or inspection of a mask design. - 特許庁
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hardware accelerator
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