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D flip-flopsとは 意味・読み方・使い方
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「D flip-flops」の部分一致の例文検索結果
該当件数 : 42件
The D flip-flops DFFI (i=1 to 10) perform frequency division after the D flip-flops DFF (i-1) which receives a clock of a last phase starts frequency division.例文帳に追加
ＤフリップフロップＤＦＦｉ（ｉ＝２−１０）は、前の相のクロックを受けるＤフリップフロップＤＦＦ（ｉ−１）が分周を開始した後に分周を行う。 - 特許庁
A motor control device includes a digital filter that is composed of a plurality stages of D flip-flops, determines the output in response to the number of H levels of outputs from each D flip-flop, and can remove noise.例文帳に追加
複数段のDフリップフロップから構成されており、各Dフリップフロップの出力のHレベルの数に応じて出力を決定しノイズを除去することができるデジタルフィルタを備える。 - 特許庁
To improve the accuracy of A/D conversion, while making the function of a one-bit D/A converter used concurrently in flip-flops.例文帳に追加
フリップフロップにて１ビットＤ／Ａ変換器の機能を併用させることを可能としつつ、Ａ／Ｄ変換精度を向上させる。 - 特許庁
Since the function of two D latches 110 is structurally same as that of the D flip flop 120, higher speed operation becomes possible than in the case with the same number of D flip flops 120 adopted.例文帳に追加
Ｄラッチ１１０は、構造的に２個でＤフリップフロップ１２０と同じ機能であるので、同数のＤフリップフロップ１２０を採用した場合よりも高速な動作が可能になる。 - 特許庁
The circuit includes an assembly formed of two D-type flip-flops 12, 13, and two NAND logic gates 15, 16 arranged in negative feedback between the two flip-flops.例文帳に追加
２つのＤ型フリップ・フロップ１２、１３、及びその２つのフリップ・フロップの間の負帰還内に配置された２つのＮＡＮＤロジック・ゲート１５、１６で形成されているアセンブリを含む。 - 特許庁
Input terminals of the D flip-flops 2, 5 and 11 are connected to inverted output terminals of the D flip-flops 1, 4 and 10 in the former steps respectively so that '0's are output after the occurrence of the gray code until the appearance of the periodicity.例文帳に追加
また、グレイコードが発生されてから上記の周期性が現れるまで‘０’を出力するために、Ｄフリップフロップ２，５，１１の入力と前段のＤフリップフロップ１，４，１０の反転出力端とを接続する。 - 特許庁
With a clock signal applied to the D flip-flop M3 as a reference, time is delayed by 't', '2t', and '3t', respectively, and the D flip-flops of a memory element operate with time delay.例文帳に追加
ＤフリップフロップＭ３に印加されるクロック信号を基準に，“ｔ”，“２ｔ”，“３ｔ”時間ずつ遅延し，メモリ素子の各Ｄフリップフロップは互いに時差をおいて動作する。 - 特許庁
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「D flip-flops」の部分一致の例文検索結果
該当件数 : 42件
Further, the latency control circuit does not depend upon the banks, and has the same number of D flip-flops for each entry.例文帳に追加
さらに、レイテンシ制御回路はバンクに依らず、エントリ毎に同じ数のＤフリップ・フロップを有するものである。 - 特許庁
A DATA terminal of the CPU 1 is connected to the D terminals of respective flip-flops of the master mode register group 3.例文帳に追加
マスタモードレジスタ群３の各フリップフロップのＤ端子には、ＣＰＵ１のＤＡＴＡ端子が接続されている。 - 特許庁
This frequency-dividing circuit is provided with D-type flip flops DFF1-DFF3 and DFF1a-DFF3a and a delay circuit DL1.例文帳に追加
ＤフリップフロップＤＦＦ１−ＤＦＦ３，ＤＦＦ１ａ−ＤＦＦ３ａと、遅延回路ＤＬ１とを設ける。 - 特許庁
The frequency-dividing circuit 200 includes D flip-flops DFF1 to DFF10 and NOR circuits NR2 to NR10.例文帳に追加
分周回路２００は、ＤフリップフロップＤＦＦ１−ＤＦＦ１０と、ＮＯＲ回路ＮＲ２−ＮＲ１０とを含む。 - 特許庁
The data transmitter 10 is also provided with a transmitting part 12 comprising four D flip-flops 13, 14, 15a and 15b, and the data receiver 20 is provided with a receiving part 22 comprising four D flip-flops 23, 24a, 24b and 26 and a selector 25.例文帳に追加
また、データ送信装置１０は４つのＤフリップフロップ１３，１４，１５ａ，１５ｂからなる送信部１２を備え、データ受信装置２０は４つのＤフリップフロップ２３，２４ａ，２４ｂ，２６及びセレクタ２５からなる受信部２２を備える。 - 特許庁
The clock terminals of the flip-flops of the slave mode register group 4 are connected to the Q terminal of the mode setting register 2 and D terminals are connected to the Q terminals of the respective flip-flops of the master mode register group 3.例文帳に追加
スレーブモードレジスタ群４の各フリップフロップのクロック端子はモード設定レジスタ２のＱ端子に接続され、Ｄ端子はマスタモードレジスタ群３の各フリップフロップのＱ端子に接続されている。 - 特許庁
Shift registers are provided connecting D flip-flops 1 to 2, 3 to 6, and 7 to 14 in cascade respectively for gray code bits D0 to D2.例文帳に追加
グレイコードのビットＤ０〜Ｄ２毎に、Ｄフリップフロップ１〜２、３〜６、７〜１４を従属接続したシフトレジスタを設ける。 - 特許庁
The capacitors C1 and C2 perform an operation for speedily supplying the Q output voltages of the D flip-flops 11 and 12 to the charge pump circuit 2, by capacity-coupling the Q output terminals of the D flip-flops 11 and 12 and the current path of the charge pump circuit 2.例文帳に追加
容量素子Ｃ１，Ｃ２は、Ｄフリップフロップ１１，１２のＱ出力端子とチャージポンプ回路２の電流経路とを容量結合して、Ｄフリップフロップ１１，１２のＱ出力電圧を迅速にチャージポンプ回路２に供給する作用を行う。 - 特許庁
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