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Faults and errorsとは 意味・読み方・使い方
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「Faults and errors」の部分一致の例文検索結果
該当件数 : 8件
according to the doctrines of Wang Yang-ming, the action of correcting faults or errors and also developing one's inborn talents発音を聞く 例文帳に追加
陽明学において,誤りを正して先天的な知をみがくこと - EDR日英対訳辞書
To prevent TLB (conversion index buffer) errors and page faults which tend to lead to a large time loss by stack development.例文帳に追加
スタック成長による大きな時間のロスを招く傾向にあるTLB(変換索引バッファ)エラーおよびページ不良を防止する。 - 特許庁
To inhibit faults and errors of an I/O device from having influence on a logical partition used by a user.例文帳に追加
I/Oデバイスの障害やエラーの影響がユーザが利用する論理区画へ波及するのを抑制することを目的とする。 - 特許庁
Consequently, the granule is prevented from falling on an electronic balance 60, its periphery, and the external surface of the metering bottle 99, and generation of metering errors and faults of the electronic balance 60 can be prevented.例文帳に追加
これにより、電子天秤60やその周囲及び計量瓶99の外面に粉粒体が降りかかることを防ぎ、計量誤差や電子天秤60の故障を防止することができる。 - 特許庁
This system identifies in-range sensor faults by the quality observation of parts in pursuit and the recognition of an abnormal quality change patterns corresponding to sensor errors in an embedded model 10.例文帳に追加
本システムは、埋込みモデル(10)内での追跡部品品質の観察及びセンサ誤差に対応する品質変化の異常パターンの認識により範囲内センサ不良を識別する。 - 特許庁
An ECC function verification data generation circuit 5 automatically generates detection data in which one-bit errors of '1' and '0' faults are simulatively generated in each clock.例文帳に追加
ECC機能検証データ生成回路5は、擬似的に“1”故障および“0”故障の1ビット誤りを発生させた検証データをクロック毎に自動生成する。 - 特許庁
To prevent various faults from occurring as the result of errors with respect to shutdown order in the power on state, when an information processor and a storage device are provided with power supplies separately.例文帳に追加
情報処理装置とストレージ装置が個別に電源が設けられている場合の電源投入時、切断時の順序を誤ることによる様々な障害発生を防止する。 - 特許庁
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「Faults and errors」の部分一致の例文検索結果
該当件数 : 8件
To provide a safety protection instrumentation system and a method for handling it which can prevent errors caused by static logic faults and the timing of signal processing in the safety protection instrumentation system for a reactor using hardware logic such as a field programmable gate array (FPGA).例文帳に追加
FPGAなどのハードウエアロジックを用いた原子炉の安全保護計装システムにおける、スタティックな論理誤りや信号処理のタイミングに起因するエラーを防止することが可能な安全保護計装システムおよびその取扱方法を提供する。 - 特許庁
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