スイッチを内蔵するサンプルホールド回路を複数備える場合に、データのサンプルホールドを前記複数のサンプルホールド回路を用いて順番に行う場合に、何れか１個のサンプルホールド回路でのデータのサンプルホールド回路中は、他のサンプルホールド回路のスイッチの開動作に伴うスイッチング雑音が正しいデータのサンプルホールドを誤らせることを防止する。 - 特許庁

Then, the differentials of the first and second sample hold circuits 5a and 5b or the differentials of the third and fourth sample hold circuits 5c and 5d are calculated by first and second differential amplifying circuits 6 and 7.例文帳に追加

そして、第１、第２のサンプルホールド回路５ａ、５ｂの差動や第３、第４のサンプルホールド回路５ｃ、５ｄの差動を、第１、第２差増増幅回路部６、７で求める。 - 特許庁

To provide a high speed sample-and-hold circuit including plural sample-and-hold circuits connected in parallel between an input and an output.例文帳に追加

入力および出力間に並列接続された複数のサンプルホールドサブ回路を含む高速サンプルホールド回路。 - 特許庁

例文

A/D converters 50 (50A and 50B) convert the output of the sample hold circuits 40 into digital values.例文帳に追加

Ａ／Ｄ変換器（５０）は、サンプルホールド回路の出力をデジタル値に変換する。 - 特許庁

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「sample hold circuits」の部分一致の例文検索結果

該当件数 : 79件

例文

A control means 40 controls first and second sample-hold circuits 32, 33 so that a sample start timing of the first sample-hold circuit 32 comes faster than a sample start timing of the second sample-hold circuit 33.例文帳に追加

制御手段４０が、第１サンプルホールド回路３２のサンプル開始タイミングが第２サンプルホールド回路３３のサンプル開始タイミングよりも早くなるように、第１サンプルホールド回路３２および第２サンプルホールド回路３３を制御する。 - 特許庁

The respective sample-hold circuits hold respective analog voltage signals converted by the DA converter respectively.例文帳に追加

前記各サンプルホールド回路は、前記ＤＡコンバータ器により変換された各アナログ電圧信号をそれぞれホールドする。 - 特許庁

Each of the sample and hold circuits is connected to a series of shift registers 62 to 70.例文帳に追加

サンプル・アンド・ホールド回路の各々は一連のシフト・レジスタ６２〜７０に接続されている。 - 特許庁

To provide a solid-state imaging device configured to relieve, when faults occur in some of sample/hold signal converting circuits disposed for respective columns of a pixel array, the sample/hold signal converting circuits.例文帳に追加

画素アレイの列毎に配置されるサンプルホールド信号変換回路の幾つかが故障した場合に、それを救済できる構成を備えた固体撮像装置を提供すること。 - 特許庁

A system 40 includes several sample and hold circuits 42 to 50, each of which receives the data signal.例文帳に追加

システム４０はデータ信号を受信する複数のサンプル・アンド・ホールド回路４２〜５０を含んでいる。 - 特許庁

A method for reducing the unsuccessful timing in a high speed parallel connection sample-and-hold circuit is such that a hold-signal is synchronized with a clock signal by correcting a hold-signal for each of plural sample-and-hold sub-circuits in the sample-and- hold circuit and corrected hold-signals are utilized respectively in the sample- and-hold sub-circuit.例文帳に追加

高速並列接続サンプルホールド回路１００におけるタイミング不整合を低減する方法はサンプルホールド回路内の複数のサンプルホールドサブ回路の各々についてホールド信号を修正することによりホールド信号をクロック信号に同期化させ、修正されたホールド信号をサンプルホールドサブ回路内でそれぞれ利用することを含んでいる。 - 特許庁

A first sample-hold circuit and a second sample-hold circuit are connected in series on a feedback route, output of the two sample-hold circuits is amplified by a differential amplifier circuit, and phase compensation signals are generated.例文帳に追加