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true complementの部分一致の例文一覧と使い方
該当件数 : 8件
SEMICONDUCTOR MEMORY DEVICE WITH TRUE/COMPLEMENT REDUNDANT STRUCTURE例文帳に追加
ツル—／コンプリメント冗長構造を有する半導体メモリ装置 - 特許庁
The differential D-flip-flop is implemented following a master/slave configuration and responds to the true and complement forms of an input clock signal, an input reset input, and input data signal, and also provides true and complement forms of an output signal.例文帳に追加
差動Dフリップフロップは、マスタ・スレーブ構成に従って実現され、正負形式の入力クロック信号、入力リセット入力、及び入力データ信号に応答すると共に、正負形式の出力信号を提供する。 - 特許庁
The differential D-flip-flop is implemented following a master/slave configuration and responds to the true and complement forms of an input clock signal, an input reset input, and input data signal, and also provides true and complement forms of an output signal.例文帳に追加
差動Dフリップフロップは、マスタ・スレーブ構成に従って実現され、真及び補数形式の入力クロック信号、入力リセット入力、及び入力データ信号に応答すると共に、真及び補数形式の出力信号を提供する。 - 特許庁
The multi-function differential logic gate has four inputs, which can be grouped into two pairs of true and complement signals.例文帳に追加
多機能差動論理ゲートは、２組の正信号と負信号のペアにグループ化することができる４個の入力を有する。 - 特許庁
The multi-function differential logic gate has four inputs, which can be grouped into two pairs of true and complement signals.例文帳に追加
多機能差動論理ゲートは、２組の真の信号と補数信号のペアにグループ化することができる４個の入力を有する。 - 特許庁
The data clocking circuit 20 may comprise true-complement blocks 50, 58 to receive each of incoming data bits 16 and to serve as local oscillators to a mixer 22.例文帳に追加
データクロッキング回路２０は、それぞれの入来データビット１６を受信し、ミキサ２２に対するローカルオシレータとして働く真−補数ブロック５０，５８を備える。 - 特許庁
Each second random access memory element is associated with a memory location to store a flag value indicative of whether the data word stored at that memory location is a true or complement version.例文帳に追加
各第二ランダムアクセスメモリ要素は、そのメモリ位置に格納されているデータワードが真又は補元バージョンのいずれかであることを表わすフラッグ値を格納するためのメモリ位置と関連している。 - 特許庁
Each pair of bit line is integrated to a separate memory cell from each redundant row of pairs of redundant row, therefore, both of true version and complement version of a data value are kept by the pair of redundant row.例文帳に追加
各ビット線対は冗長行対の各冗長行から別個のメモリセルへ結合しており、従ってデータ値の真バージョンと補元バージョンの両方が冗長行対によって維持される。 - 特許庁
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