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Weblio 辞書 > 英和辞典・和英辞典 > マイクロソフト用語 > コード カバレッジの英語・英訳 

コード カバレッジの英語

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マイクロソフト用語集での「コード カバレッジ」の英訳

コード カバレッジ

対訳 code coverage


「コード カバレッジ」を含む例文一覧

該当件数 : 12



例文

設計支援装置、およびソースコードカバレッジ方法、並びにそのプログラム例文帳に追加

DESIGN SUPPORT DEVICE AND SOURCE CODE COVERAGE METHOD, AND PROGRAM THEREFOR - 特許庁

組込型処理装置システム用コードカバレッジ測定方法及び装置例文帳に追加

METHOD AND DEVICE FOR MEASURING CODE COVERAGE FOR EMBEDDED PROCESSOR SYSTEM - 特許庁

生成部206で入力パターンP1,P2からコードカバレッジCCを生成し、算出部207でコードカバレッジ上限情報CMに対するコードカバレッジCCの達成度を算出する。例文帳に追加

In a generation part 206, code coverage CC is generated from the input patterns P1 and P2, and, in a calculation part 207, a code coverage attainment rate with respect to the code coverage upper limit information CM is calculated. - 特許庁

コードカバレッジ計測をエミュレーションにおいて実行することができる回路検証装置を提供する。例文帳に追加

To provide a circuit verification apparatus executing code coverage measurement in emulation. - 特許庁

この実行結果から決定部205でコードカバレッジ上限情報CMを生成する。例文帳に追加

From the execution result, code coverage upper limit information CM is generated in a determination part 205. - 特許庁

コードカバレッジ計測手段102によって生成されるコードカバレッジ情報をコードカバレッジデータベース103に格納し、コードカバレッジデータベース103を利用して、非実行コード記述を削除またはコメントアウトするコード最適化手段104を備えることによって設計データ100および検証ベクタ101の両方のコード最適化を行うという効果を奏する。例文帳に追加

A design apparatus of an integrated circuit device optimizes both of design data 100 and a verification vector 101 by being provided with a code optimizing means 104 for deleting or commenting out a non-execution code description and by storing code coverage information generated by a code coverage measuring means 102 into a code coverage database 103 to use the database 103. - 特許庁

例文

また、回路検証装置1は、所定の計測ポイントついて、それぞれ対応するアサーション記述に変換するアサーション変換部14と、データベースとアサーション記述に基づいて計測を行い得られたアサーション結果112とを受け取り、コードカバレッジ結果113を生成するコードカバレッジ結果伸長部13とを有する。例文帳に追加

The circuit verification apparatus 1 also includes an assertion converting unit 14 configured to convert each of the predetermined measurement points to a corresponding assertion description and a code coverage result decompressing unit 13 configured to receive the database and an assertion result 112 obtained by performing measurement based on the assertion description and generate a code coverage result 113. - 特許庁

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「コード カバレッジ」を含む例文一覧

該当件数 : 12



例文

コードカバレッジの上限を見積もることにより、検証シナリオの機能に関する検証網羅性の向上を図り、LSIの設計障害の正確かつ効率的な検出を図ること。例文帳に追加

To improve verification coverage with respect to the function of a verification scenario, and detect LSI design faults accurately and efficiently, by estimating an upper limit of code coverage. - 特許庁

論理システムの検証において非活性コードに対応する機能を含む非活性動作仕様記述を生成し、コードカバレッジ結果の解析を容易化する手段を提供する。例文帳に追加

To provide a means generating deactivation specification description including a function complying with an inactive code in verification of a logic system for facilitating analysis on a code coverage result. - 特許庁

回路検証装置1は、ハードウエア記述言語により記述された検証対象回路記述107と複数の計測対象の情報が含まれるメトリクス情報108とを読み込み、検証対象回路記述107からコードカバレッジ計測のための複数の計測ポイントを抽出し、抽出した前記複数の計測ポイント中の所定の計測ポイントのみに集約したデータベースを生成するコードカバレッジ計測ポイント抽出部11を有する。例文帳に追加

The circuit verification apparatus 1 includes a code coverage measurement point extracting unit 11 which reads a verification object circuit description 107 described in a hardware description language and metrics information 108 including information about multiple measurement objects, extracts multiple measurement points for code coverage measurement from the verification object circuit description 107, and generates a database including only predetermined measurement points among the extracted multiple measurement points. - 特許庁

プローブが挿入され、コードおよびプローブを表すバイナリを実行することによってデータが収集されると、そのデータは、最適化マップ、およびアークとブロックの関係上にオーバレイされて、コードカバレッジデータが提供される。例文帳に追加

Once the probes are inserted and data are collected by running the binary representing the code and probes, the data may be overlaid onto the optimization map and arc and block relationships to provide code coverage data. - 特許庁

例文

トグル率算出工程109で、従来のネットリストに対するトグル率算出に代えて、半導体集積回路のRTL設計工程で得られるRTL設計段階の接続データに対してコードカバレッジ算出ツールを用いてトグル率を算出することを可能にする。例文帳に追加

In a step 109 of calculating the toggle rate, the toggle rate can be calculated by using a code coverage calculating tool with respect to connection data in an RTL design phase which can be obtained in an RTL designing step of the semiconductor integrated circuit in place of a conventional toggle rate calculation with respect to a net list. - 特許庁

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