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データバスとアドレスバスの英語
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「データバスとアドレスバス」の部分一致の例文検索結果
該当件数 : 90件
ＲＯＭ３０とＲＡＭ４０とで、データバス５１およびアドレスバス５０を共通化する。例文帳に追加
A data bus 51 and an address 50 are shared by ROM 30 and RAM 40. - 特許庁
スヌープブロックは、アドレスバスおよびデータバスに接続され、データバスからアドレスを受取るように構成される。例文帳に追加
A snoop block is connected to the address bus and the data bus and configured to receive an address from the data bus. - 特許庁
バス切換回路１０３は、ウェイト信号ＷＳがＨレベルのときアドレスバスＡＢ１・データバスＤＢ１・コントロールバスＣＢ１とアドレスバスＡＢ３・データバスＤＢ３・コントロールバスＣＢ３とを接続する。例文帳に追加
A bus switching circuit 103 connects address bus AB1-data bus DB1-control bus CB1 and address bus AB3-data bus DB3-control bus CB3, when the wait signal WS is in the H-level. - 特許庁
一方、ウェイト信号ＷＳがＬレベルのときアドレスバスＡＢ１・データバスＤＢ１・コントロールバスＣＢ１とアドレスバスＡＢ２・データバスＤＢ２・コントロールバスＣＢ２とを接続する。例文帳に追加
On the other hand, the address bus AB1-data bus DB1-control bus CB1 and the address bus AB2-data bus DB2-control bus CB2 are connected, when the wait signal SW is in the L-level. - 特許庁
フラッシュメモリは、アドレスバスと、データバスと、制御線と、前記アドレスバスおよびデータバスに接続したアドレス指定可能不揮発性メモリセルアレイとを備える。例文帳に追加
A flash memory is provided with an address bus, a data bus, a control line, and an address specifiable non-volatile memory cell carry 64 connected to the address bus and the data bus. - 特許庁
アドレスバス用スイッチ群７およびデータバス用スイッチ群９はＳＴＯＰ２信号に応答して、アドレスバス１０およびデータバス１１とＣＰＵ１とを切り離す。例文帳に追加
A switch group 7 for an address bus and a switch group 9 for a data bus isolate an address bus 10 and a data bus 11 from the CPU 1 in response to the STOP2 signal. - 特許庁
本発明の制御装置７は、マイクロコンピュータ７０と、ＲＯＭ７１と、ＲＡＭ７２と、アドレスバス７３と、データバス７４とを備えている。例文帳に追加
A control unit 7 comprises the microcomputer 70, ROM 71, RAM 72, the address bus 73, and the data bus 74. - 特許庁
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「データバスとアドレスバス」の部分一致の例文検索結果
該当件数 : 90件
例示的な構成は、上でデータがブロック間で交換されるアドレスバスとデータバスとによって接続された少なくとも２つのブロックを含む。例文帳に追加
An embodiment of the configuration includes at least two blocks connected by an address bus and a data bus on which data are exchanged between the blocks. - 特許庁
10ビットアドレスバス２６と10ビットデータバス２７の少なくとも一方を、パラレル通信の信号線で構成する。例文帳に追加
At least either a 10 bit address bus 26 or a 10 bit data bus 27 is configured of the signal line of parallel communication. - 特許庁
ＣＰＵ１１とメモリ１２とは、アドレスバス１３、データバス１４、リード信号線１５及びライト信号線１６によって接続されている。例文帳に追加
The CPU and the memory are connected together through an address bus 13, the data bus 14, a read signal wire 15 and a write signal wire 16. - 特許庁
画像アドレスバス１２３及び画像データバス１２４は、画像符復号化ユニット８０１と画像表示部９０１とを接続する。例文帳に追加
An image address bus 123 and an image data bus 124 connect an image encoding/decoding unit 801 and an image display part 901. - 特許庁
デバイス７１、７２、７３、７４、…、７ＮのＮ個のデバイス間は、各々１本ずつのデータバスとアドレスバスとにより接続される。例文帳に追加
N devices 71, 72, 73, 74,..., 7N are respectively connected by one of data buses and one of address buses. - 特許庁
そして、観測アドレスデータとアドレスバス上のデータが一致したときに、レジスタ部３５によってデータバス上のデータが記憶される。例文帳に追加
When the observation address data matches data on an address bus, data on a data bus is stored by a register 35. - 特許庁
マイクロプロセッサ２１０のアドレスバスとデータバスの両方を、コプロセッサ２１１と２１２に接続する。例文帳に追加
Both of an address bus and a data bus of a microprocessor 210 are connected with coprocessors 211 and 212. - 特許庁
フレームバッファ３２，３４のデータバス，アドレスバスはフレームバッファ３３のそれとは独立して時分割でＭＰＵから制御可能である。例文帳に追加
Data buses and address buses of the frame buffers 32 and 34 can be controlled by the MPU on a time-division basis independently of those of the frame buffer 33. - 特許庁
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