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列アドレスの英語
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英訳・英語 column address; string address
「列アドレス」の部分一致の例文検索結果
該当件数 : 850件
MAC アドレスを含む文字列。例文帳に追加
The string containing the MAC Address発音を聞く - PEAR
MAC アドレスを表す文字列。例文帳に追加
The string representing the MAC address発音を聞く - PEAR
アドレス貯蔵回路はメモリセルアレイにプログラムされるデータの列アドレス情報を貯蔵するように構成され、列アドレス情報は初期列アドレス及び最終列アドレスを含む。例文帳に追加
An address storage circuit is constituted so as to store the column address information of data programmed in a memory cell array, and the column address information includes an initial column address and a final column address. - 特許庁
例えば、列選択回路は列アドレスが4Nに整列される時列アドレスの列を選択し、列アドレスが4Nに整列されない時上位列アドレスの列を選択する。例文帳に追加
For example, the column selecting circuit selects the column of a column address when the column address is arranged to 4N, and selects the column of a high-order column address when the column address is not arranged to 4N. - 特許庁
列アドレスバッファ18は列アドレス制御信号φ3に従ってメモリセルアレイ22に対する列アドレスYjを生成する。例文帳に追加
A column address buffer 18 generates a column address Yj for a memory cell array 22 according to a column address control signal ϕ3. - 特許庁
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「列アドレス」の部分一致の例文検索結果
該当件数 : 850件
制御信号φ2は列アドレスバッファ18内部で列アドレスが生成される度に有効化される。例文帳に追加
A control signal ϕ2 is validated each time a column address is generated inside the column address buffer 18. - 特許庁
これら行デコーダに隣接配置された回路ブロック24-1,24-2には、アドレス信号中のバンクアドレスをデコードする回路と、アドレス信号中の列アドレスをデコードする列プリデコーダが含まれ、バンクアドレス及び列アドレスのプリデコード信号を各メモリセルアレイブロックに出力する。例文帳に追加
Circuit blocks 24-1 and 24-2 arranged adjacent to the column decoders comprise circuits, which decode bank addresses contained in address signals and row predecoders which decode row addresses contained in address signals and output bank addresses and the predecode signals of the row addresses to memory cell array blocks. - 特許庁
アドレス比較部150は、メモリアドレスの列アドレスと閾値メモリアドレスと比較して、該メモリアドレスが第1、第2ブロックのどちらに属するかの判断を行う。例文帳に追加
An address comparing part 150 compares a column address of a memory address with a threshold memory address, and determines whether the memory address belongs to the first block or the second block. - 特許庁
アドレス分配回路が、(s+t)ビットの内部アドレス信号に応答して、内部アドレス信号を、sビットの行アドレス信号と、sよりも小さいtビットの列アドレス信号とに分配する。例文帳に追加
In the memory, an address diving circuit divides an (s+t)-bit internal address signal into an s-bit row address signal and a column address signal having (t) bits (t is smaller than s) by responding to the internal address signal. - 特許庁
アドレス信号は、パルス幅の違いによってアドレスを示すパルス列で構成する。例文帳に追加
The address signal is composed of a pulse train showing the address by a difference in pulse width. - 特許庁
アドレスカウンタ回路310は、所定モードで用いられる連続した列アドレスを生成する。例文帳に追加
An address counter circuit 310 generates a continuous column address used for the prescribed mode. - 特許庁
書き込めなくするメモリセルの行アドレスデータと列アドレスデータをレジスタに格納する。例文帳に追加
The row address data and the column address data of a memory cell to which writing is disabled are stored in a register. - 特許庁
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