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「integrated RAM」の部分一致の例文検索結果

該当件数 : 109



例文

RAM BUILT-IN SEMICONDUCTOR INTEGRATED CIRCUIT DEVICE例文帳に追加

RAM内蔵半導体集積回路装置 - 特許庁

IMAGING PARALLEL INTERFACE RAM INTEGRATED CIRCUIT例文帳に追加

撮像用パラレルインタフェースRAM集積回路 - 特許庁

RAM MACRO AND INTEGRATED CIRCUIT USING THEREOF例文帳に追加

RAMマクロ及びそれを使用した集積回路 - 特許庁

DISPLAY CONTROL SEMICONDUCTOR INTEGRATED CIRCUIT WITH SINGLE-PORT RAM BUILT THEREIN例文帳に追加

シングルポートRAM内蔵の表示制御半導体集積回路 - 特許庁

METHOD AND SYSTEM FOR TESTING RAM REDUNDANT INTEGRATED CIRCUIT例文帳に追加

RAM冗長集積回路をテストするための方法およびシステム - 特許庁

The searcher and the demodulator are preferably located on the same integrated circuit along with the RAM queue.例文帳に追加

探索器および復調器は好ましくはRAM待ち行列に沿って同じ集積回路に配置される。 - 特許庁

例文

This device is a semiconductor integrated circuit device mounted with a static RAM.例文帳に追加

スタティックRAMを搭載した半導体集積回路装置である。 - 特許庁

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「integrated RAM」の部分一致の例文検索結果

該当件数 : 109



例文

METHOD FOR HOLDING DATA FOR DYNAMIC RAM AND SEMICONDUCTOR INTEGRATED CIRCUIT DEVICE例文帳に追加

ダイナミック型RAMのデータ保持方法と半導体集積回路装置 - 特許庁

FUNCTIONAL TEST FACILITATING CIRCUIT FOR RAM AND INTEGRATED CIRCUIT DEVICE PROVIDED WITH IT例文帳に追加

RAM用機能試験容易化回路及びこれを備えた集積回路装置 - 特許庁

The off-dot number is integrated by a CPU 111, then, the integrated value is stored in the prescribed area of a RAM 113.例文帳に追加

CPU111により、このオフドット数を積算し、その積算値をRAM113の所定エリアに格納する。 - 特許庁

This imaging parallel interface RAM (IPIRAM) is an integrated circuit which appears as a static parallel interface RAM for an external circuit.例文帳に追加

本発明の撮像パラレルインタフェースRAM(IPIRAM)は集積回路で外部回路には静的なパラレルインタフェースRAMにみえる。 - 特許庁

The counted number of pixels is integrated by a CPU 111, then, the integrated value is stored in the prescribed area of a RAM 113.例文帳に追加

CPU111により、この計数された画素数を積算し、その積算値をRAM113の所定エリアに格納する。 - 特許庁

To provide a semiconductor integrated circuit which can surely hold RAM data by preventing RAM data from being destructed due to an asynchronous reset.例文帳に追加

非同期リセットによるRAMデータの破壊を防止して、RAMデータの保持を保証することができる半導体集積回路を提供する。 - 特許庁

The semiconductor integrated circuit 1 comprises: a RAM 2, and a control circuit 10 for controlling the retention test of the RAM 2.例文帳に追加

本発明に係る半導体集積回路1は、RAM2と、そのRAM2のリテンションテストを制御するコントロール回路10とを備えている。 - 特許庁

例文

To provide a highly integrated switching resistance RAM with which a readout time is shortened.例文帳に追加

読み出し時間を短縮するとともに、高集積化されたスイッチング抵抗RAMを実現する。 - 特許庁

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