| 意味 | 例文 (62件) |
line equalizerとは 意味・読み方・使い方
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「line equalizer」の部分一致の例文検索結果
該当件数 : 62件
OPTICAL TRANSMISSION LINE EQUALIZER例文帳に追加
光伝送路等化器 - 特許庁
ATTENUATION EQUALIZER FOR TRANSMISSION LINE例文帳に追加
伝送線路用減衰等化器 - 特許庁
OPTICAL GAIN EQUALIZER AND OPTICAL TRANSMISSION LINE例文帳に追加
光利得等化器および光伝送路 - 特許庁
GAIN EQUALIZER AND OPTICAL AMPLIFICATION TRANSMISSION LINE例文帳に追加
利得等化器及び光増幅伝送路 - 特許庁
EQUALIZER FOR SUBSCRIBER LINE DIGITAL TRANSMISSION SYSTEM例文帳に追加
加入者線ディジタル伝送システムの等化器 - 特許庁
MEMORY DEVICE HAVING BIT LINE EQUALIZER IN CELL ARRAY, AND METHOD FOR ARRANGING BIT LINE EQUALIZER IN CELL ARRAY例文帳に追加
セルアレイにビットライン均等化部を備えたメモリ装置及びビットライン均等化部をセルアレイに配置する方法 - 特許庁
ANALOG RECEIVING EQUALIZER FOR DIGITAL SUBSCRIBER LINE COMMUNICATION SYSTEM例文帳に追加
ディジタル加入者線通信システム用のアナログ受信等化器 - 特許庁
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「line equalizer」の部分一致の例文検索結果
該当件数 : 62件
OFF LINE BATTERY EQUALIZER EQUIPPED WITH INITIAL TRICKLE CHARGING CIRCUIT例文帳に追加
初期トリックル充電回路を備えるオフライン・バッテリー・イコライザ - 特許庁
A bit line equalizer BLE equalizes the potential of the bit line pairs BLt and Blc.例文帳に追加
ビット線イコライザBLEは、ビット線対BLt,BLcの電位をイコライズする。 - 特許庁
To provide a memory device having bit line equalizer in a cell array, and a method for arranging a bit line equalizer in a cell array.例文帳に追加
セルアレイにビットライン均等化部を備えたメモリ装置及びビットライン均等化部をセルアレイに配置する方法を提供する。 - 特許庁
Then, a potential is supplied to the bit line BLL from an equalizer 151.例文帳に追加
その後、ビット線BLLにイコライザ151から電位を供給する。 - 特許庁
To alter the characteristics of an equalizer depending on the characteristics of a radio transmission line.例文帳に追加
無線伝搬路の特性に応じて等化器の特性を変化させる。 - 特許庁
To provide a semiconductor integrated circuit device, an equalizer evaluating system, and an equalizer evaluating method, capable of correctly measuring the gain of an equalizer as a single unit irrespective of a transmission line.例文帳に追加
伝送線路にかかわらず、イコライザ単体の利得を正確に測定することができる半導体集積回路装置、イコライザ評価システム、およびイコライザ評価方法を提供する。 - 特許庁
METHOD, LOGIC AND SYSTEM FOR ON-LINE DATA-PATTERN COMPENSATED ADAPTIVE EQUALIZER CONTROL例文帳に追加
オンラインでデータパターンを補償される適応等化器制御のための方法、ロジック及びシステム - 特許庁
The memory device has a shared sense amplifier between a first memory block and a second memory block and includes a bit line isolation circuit, a bit line equalizer circuit, and a bit line equalizing voltage generating circuit.例文帳に追加
第1メモリブロックと第2メモリブロックとの間に共有センスアンプを有し、ビットラインアイソレーション回路とビットラインイコライザ回路、ビットラインイコライジング電圧発生回路を含む。 - 特許庁
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| 意味 | 例文 (62件) |
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