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processor coresとは 意味・読み方・使い方
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「processor cores」の部分一致の例文検索結果
該当件数 : 127件
CONTROLLING COMPUTER SYSTEM HAVING PROCESSOR INCLUDING A PLURALITY OF CORES例文帳に追加
複数のコアを含むプロセッサを有するコンピュータ・システムの制御 - 特許庁
MULTI-CORE PROCESSOR HAVING ACTIVE AND INACTIVE EXECUTION CORES例文帳に追加
アクティブ及び非アクティブ実行コアを有するマルチコアプロセッサ - 特許庁
The picture processor performs picture processing in parallel by means of the processor cores 34, 36, and 38.例文帳に追加
この画像処理装置は、複数のプロセッサコア34,36,38による画像処理を並列処理する。 - 特許庁
A plurality of cores of the processor are dynamically combined into larger cores that run complex operations with improved efficiency.例文帳に追加
プロセッサの複数のコアが、改善された効率を伴って複雑な動作を実行する、より大きいコアへと動的に組み合わされる。 - 特許庁
The compiler records the number of execution cores being the number of processor cores for executing a target program.例文帳に追加
コンパイラは、対象プログラムを実行するプロセッサ・コアの個数である実行コア数を記録している。 - 特許庁
A first processor core is brought into the system management mode, out of the some processor cores, at least one out of the other processor cores different from the first processor core maintains an operation, and is not brought into the system management mode.例文帳に追加
幾つかのプロセッサコアのうち第1のプロセッサコアがシステム管理モードに入り、第1のプロセッサコアとは異なる他のプロセッサコアのうち少なくとも1つは動作を維持してシステム管理モードには入らない。 - 特許庁
The two processor core models execute a target program of a system comprising two processor cores having endian formats different from each other and a buffer memory for temporarily storing transmission data between the two processor cores to simulate operations of the two processor cores respectively.例文帳に追加
2つのプロセッサコアモデルは、エンディアン形式が夫々異なる2つのプロセッサコアと、2つのプロセッサコア間の転送データを一時記憶するバッファメモリと、を備えるシステムのターゲットプログラムを実行して2つのプロセッサコアの動作を夫々模擬する。 - 特許庁
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「processor cores」の部分一致の例文検索結果
該当件数 : 127件
To provide a multicore processor capable of synchizing programs among processor cores by a simple configuration without increasing size of the program executed in each of processor cores.例文帳に追加
各プロセッサコアで実行されるプログラムのサイズを増大させずに、簡易な構成でプロセッサコア間の同期をとることができるマルチコアプロセッサを提供する。 - 特許庁
This information processor 1 is connected in series with processor cores provided respectively with local memories, and conducts an input and an output between the respective processor cores by an SI register and an SO register.例文帳に追加
情報処理装置1は、ローカルメモリをそれぞれ備えたプロセッサコアが直列に接続され、各プロセッサコア間では、SIレジスタおよびSOレジスタによってデータの入出力を行う。 - 特許庁
This information processor 1 is connected in series with processor cores provided with local memories via a shared memory of a dual port memory, and conducts an input and an output between the respective processor cores via the shared memory.例文帳に追加
情報処理装置1は、ローカルメモリをそれぞれ備えたプロセッサコアが、デュアルポートメモリである共有メモリを介して直列に接続され、各プロセッサコア間では、共有メモリを介してデータの入出力を行う。 - 特許庁
In an operating system operating on a multi-core processor, a plurality of processor cores are grouped into a plurality of core units configured of one or more processor cores, for management.例文帳に追加
マルチコアプロセッサ上で動作するオペレーティングシステムにおいて、複数のプロセッサコアを1以上のプロセッサコアからなる複数のコアユニットにグループ化して管理するようにした。 - 特許庁
A plurality of processor cores 102 apply parallel processing to a plurality of tile data.例文帳に追加
複数のプロセッサコア102によって複数のタイルデータを並列処理する。 - 特許庁
The processor cores 11, 21 responds to the hold signal by declaring hold positive acknowledge signal.例文帳に追加
処理装置コア11、21は、ホールド肯定応答信号を宣言することによりホールド信号に応じる。 - 特許庁
To provide a multi-core processor having active and inactive execution cores.例文帳に追加
アクティブ及び非アクティブ実行コアを有するマルチコアプロセッサを提供する。 - 特許庁
To provide a signal processor reducing overheads of data communication between cores.例文帳に追加
コア間のデータ通信のオーバーヘッドを低減し得る信号処理装置を得る。 - 特許庁
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