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processor local busとは 意味・読み方・使い方
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「processor local bus」の部分一致の例文検索結果
該当件数 : 22件
METHOD AND DEVICE FOR OPTIMIZING BUS IN PROCESSOR LOCAL BUS SYSTEM例文帳に追加
プロセッサ・ローカル・バス・システムでのバス最適化の方法および装置 - 特許庁
DEVICE AND METHOD FOR MANAGING PROCESSOR LOCAL BUS AND COMPUTER PROGRAM PRODUCT例文帳に追加
プロセッサ・ローカル・バスを管理する装置、方法およびコンピュータ・プログラム・プロダクト - 特許庁
The data processor is equipped with a processor 1, a DMA processor 2, a local memory 3, a local memory 4, a memory controller 5, a main memory 6, a DMA processor interface 7, and an address data bus 8.例文帳に追加
データ処理装置は、プロセッサ1、DMAプロセッサ2、ローカルメモリ3、ローカルメモリ4、メモリコントローラ5、メインメモリ6、DMAプロセッサインタフェース7、アドレスバス・データバス8を備える。 - 特許庁
To avoid bus competition without providing a special function means in a bus arbitrating circuit even when a standard local bus is used for a processor system where the local bus of an interlock bus is connected with the system bus of a split bus through a bridge device.例文帳に追加
インタロックバスのローカルバスとスプリットバスのシステムバスとをブリッジ装置により接続したプロセッサシステムにおいて、標準ローカルバスを用いた場合でも、バス調停回路に特別な機能手段を設けることなく、バス競合回避を行う。 - 特許庁
A lock register 22 which manages a lock is installed not at a processor local bus 18 side but at a side band bus 23 side.例文帳に追加
ロックを管理するロックレジスタ22をプロセッサローカルバス18側ではなくサイドバンドバス23側に設ける。 - 特許庁
This open architecture consists of a 64-bit, 100MHz Processor Local Bus (PLB) and a 32-bit, 50MHz On-Chip Peripheral Bus (OPB).発音を聞く 例文帳に追加
このオープン・アーキテクチャは、64ビット、100MHzのプロセッサ・ローカルバス(PLB)と、32ビット、50MHzのオンチップ周辺バス(OPB)とからなっている。 - コンピューター用語辞典
A system bus bridge(SBB) 402 is a multichannel bi-directional bus bridge and offers interconnection between a B bus (input-output bus) 405, a G bus (graphic bus) 404, an SC bus (processor local bus) 421 and an MC bus 422 by using a cross bus switch.例文帳に追加
システム・バス・ブリッジ(SBB)402はマルチ・チャネル双方向バス・ブリッジであり、Bバス(入出力バス)405、Gバス(グラフィック・バス)404、SCバス(プロセッサ・ローカル・バス)421およびMCバス422間の相互接続をクロス・バスイッチを用いて提供する。 - 特許庁
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「processor local bus」の部分一致の例文検索結果
該当件数 : 22件
To provide a multi-processor system for preventing load from being imposed on a processor local bus when a lock is acquired and released.例文帳に追加
ロックの獲得及び解放に際してプロセッサローカルバスに負荷がかからないマルチプロセッサシステムを提供する。 - 特許庁
A medium processor 30 is provided with a processor core 1, a DMA controller 2, a D/A converter 3, an A/D converter 4, an interface 5, a main memory 6, a local bus 7, and a global bus 8.例文帳に追加
メディアプロセッサ30には、プロセッサコア1、DMAコントローラ2、D/Aコンバータ3、A/Dコンバータ4、インターフェース5、主メモリ6、ローカルバス7、及びグローバルバス8が設けられる。 - 特許庁
A remote management device 40 and a graphic unit 30 for displaying data on the monitor 60 of the local data processor is connected to the internal bus of the local data processor.例文帳に追加
遠隔管理装置40とローカルデータ処理装置のモニタ60上にデータ表示を行う為のグラフィックユニット30が、ローカルデータ処理装置の内部バスに接続されている。 - 特許庁
The exclusive circuit 16 is closely connected to the general processor 15 through a local bus, and input and output of data between the exclusive circuit 16 and the general processor 15 are executed at high speed through the local bus.例文帳に追加
専用回路16と汎用プロセッサ15との間はローカルバスによって密結合されており、専用回路16と汎用プロセッサ15との間のデータの入出力はローカルバスを介して高速に実行される。 - 特許庁
A signal (data) supplied from an external device via the CPU of each processor system, or an external bus is once supplied to the local bridge of the processor system; and it is decided, inside the local bridge, whether the signal (data) is made to access to local memories 3-1,..., 3-n on a shared memory 5.例文帳に追加
この各プロセッサシステム毎のCPUもしくはExternal busを介して外部装置から供給される信号(データ)は、そのローカルブリッジに一旦供給され、その内部にて、ローカルメモリ3−1,…,3−nに対するアクセスか、共有メモリ5に対するアクセスかを判定される。 - 特許庁
The data processor is equipped with an image processing processor 51, a DMA controller 52, a bus interconnection 53, a local memory 54, a main memory controller 55, a main memory 56, and a minimum/maximum calculation section 131.例文帳に追加
データ処理装置は、画像処理プロセッサ51、DMAコントローラ52、バスインターコネクション53、ローカルメモリ54、メインメモリコントローラ55、メインメモリ56、最小値・最大値計算部131を備える。 - 特許庁
The DMA controller 2 is connected to the local bus 7 and the global bus 8, and DMA-transfer-controls a data such as the PCM data stored in a memory without interposing a processor or the like.例文帳に追加
DMAコントローラ2は、ローカルバス7及びグローバルバス8に接続され、プロセッサなどを介さずにメモリに格納されているPCMデータなどのデータのDMA転送制御を行う。 - 特許庁
This is a dual-master device which manages a processor local bus(PLB) supporting up to 16 masters as a high-performance on-chip bus used by many system-on-chip(SOC) applications.例文帳に追加
多数のシステム・オン・チップ(SOC)アプリケーションにおいて使用される高性能オンチップ・バスであり、最大16のマスタをサポートするプロセッサ・ローカル・バス(PLB)を管理する二重マスタ装置。 - 特許庁
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