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ゼロバイアスの英語
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英訳・英語 zero bias
「ゼロバイアス」を含む例文一覧
該当件数 : 8件
ボディ電位Vbody_nは、入力信号V__BODYINに応じて、ソース領域に対してボディ領域が逆バイアス、または、ゼロバイアスとなるように印加される。例文帳に追加
The body potential Vbody-n is applied to a source region so that the body region becomes reverse biased or zero biased according to an input signal VBODYIN. - 特許庁
フォトダイオード10を有する感光装置において、フォトダイオードの応答の非直線部分が使用されないようにする「ファットゼロ」バイアスがフォトダイオードに注入される。例文帳に追加
In a photosensitive device having a photodiode 10, a 'fat zero' bias for preventing the nonlinear part of a response of the photodiode from being used is injected into a photodiode. - 特許庁
入力信号V_BODYINは、PMOSトランジスタMPの待機時にはゼロバイアス、動作時には逆バイアスが、ボディ領域へ印加されるように入力される。例文帳に追加
The input signal VBODYIN is inputted, so that zero bias is applied to the body region stand-by by the PMOS transistor MP and reverse bias during operation. - 特許庁
p型多結晶SiC層109は仕事関数が相対的に大きいので、ゼロバイアス状態でもMISHFETのチャネルが空乏化されて、ノーマリオフ動作が生じる。例文帳に追加
Since the p-type polycrystalline SiC layer 109 has a relatively large work function, the channel of the MISHFET is depleted even in a zero bias state, and the normally-off operation is generated. - 特許庁
出力の発振を抑制することができ、暗電流が気になるような小さい光電流の時にはゼロゼロバイアス回路として動作して、回路動作に異常をきたすような大きい光電流の時には出力電流を制限することのできる光検出回路を提供する。例文帳に追加
To provide a light detection circuit that can suppress the oscillation of output, can operate as a zero-bias circuit for a photocurrent in which a dark current is not negligible, and can limit an output current for a large photocurrent causing circuit operation malfunctions. - 特許庁
トレンチ構造38の間隔は、p−チャネル領域36の不純物濃度に応じた間隔であり、かつ、トレンチ構造38及びアノード電極42にゼロバイアスを印加した状態でp−チャネル領域36全体を空乏化するように設定される。例文帳に追加
The interval of the trench structure 38 corresponds to a concentration of impurity in the p-channel region 36, and the p-channel region 36 is entirely depleted while a zero bias is applied to the trench structure 38 and the anode electrode 42. - 特許庁
逆バイアスされる半導体光素子と順(又はゼロ)バイアスされる半導体光素子の活性層どうしを突合せ接合している光集積デバイスにおいて、大きな逆バイアス動作や超高速変調をしても、高速なデバイス動作速度を確保する。例文帳に追加
To ensure a device working speed at a high speed, even by a large reverse bias operation and an ultra-high speed modulation in an optical integrated device, in which the active layers of a reverse biased semiconductor optical element and the positive (or zero) biased semiconductor optical element are abutted and jointed mutually. - 特許庁
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「ゼロバイアス」を含む例文一覧
該当件数 : 8件
この第2のP型領域8は、裏面電極7への電圧非印加時(ゼロバイアス時)にもESDによる大電圧印加時にも、第1のP型領域3とN型半導体基板2の接合部J23のうち、少なくとも表層部S23を覆う空乏層DLを発生させるように形成されている。例文帳に追加
The p-type region 8 is formed to generate a depletion layer DL covering at least a surface layer S23 of a joint J23 between a first p-type region 3 and an n-type semiconductor substrate 2 while no voltage is applied to a back electrode 7 (zero bias) or large voltage is applied by ESD. - 特許庁
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