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読出し書込みカウンタの英語
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「読出し書込みカウンタ」の部分一致の例文検索結果
該当件数 : 10件
読出し可否検出回路8はWカウンタ4で生成された書込みアドレスWAD2とRカウンタ5で生成された読出しアドレスRADとを比較し、読出し可否の判定を行う。例文帳に追加
A read propriety detection circuit 8 compares the write address WAD2 generated in the W counter 4 with a read address RAD generated in an R counter 5 and judges read propriety. - 特許庁
水平方向メモリ4は水平方向カウンタ回路1と垂直方向カウンタ回路2とデコーダ回路3とによって発生された5つの領域データA,B,C,D,Eを水平方向カウンタデコーダ5からの書込みアドレスで一旦書込み、読出しアドレスで読出される。例文帳に追加
A horizontal direction memory 4 once writes therein five regional data A, B, C, D, E generated by a horizontal direction counter circuit 1, a vertical direction counter circuit 2, and a decoder circuit 3 according to write addresses from a horizontal direction counter decoder 5 and the five regional data A, B, C, D, E are read according to read addresses. - 特許庁
垂直方向メモリ6は水平方向メモリ4から出力された5つの領域データA,B,C,D,Eを垂直方向カウンタデコーダ7からの書込みアドレスで一旦書込み、読出しアドレスで読出される。例文帳に追加
A vertical direction memory 6 once writes therein the five regional data A, B, C, D, E outputted from the horizontal direction memory 4 according to writes addresses from a vertical direction counter decoder 7, and the five regional data A, B, C, D, E are read according to read addresses. - 特許庁
エラスティックストア43,44の読出しタイミング生成カウンタ42のロードを、エラスティックストア43,44の書込みタイミングパルス及び読出しタイミング初期化信号で行い、エラスティックストア43,44の書込み、読出しフレーム位相を最適化させる。例文帳に追加
A read timing generation counter 42 for elastic stores 43, 44 is loaded by a write timing pulse and a read timing initializing signal of the elastic stores 43, 44 so as to optimize write and read frame phase of the elastic stores 43, 44. - 特許庁
ディスク装置は、外部装置から読出し/書込み要求を受信すると、取得されたアドレス情報を基本アドレス情報と次アドレス情報とに分けてアドレス情報記憶部に格納するとともにカウンタをインクリメントして、カウンタが最大値の次アドレス情報を選出する。例文帳に追加
The disk drive stores, upon receipt of a reading/writing request from the external device, obtained address information separately as basic address information and following address information to an address information storage part and also increments a counter, and then selects following address information with a maximum value of the counter. - 特許庁
書込みカウンタの値又は読出しカウンタの値が閾値以上となったブロックであっても、実際には異常となっていないブロックを継続して利用することができるようにすることによりフラッシュメモリを延命させることを可能とするフラッシュメモリの延命方法を提供する。例文帳に追加
To provide a method for prolonging life of a flash memory by using a block continuously which is actually not abnormal even with respect to a block in which a write counter value or read counter value is equal to or larger than a threshold. - 特許庁
この方式ではパッケージ内で発生したクロック系異常、パワーオンクリア、Loop Back On信号及びエラスティックストア43,44の書込み、読出しフレーム位相異常等の情報で読出しタイミング生成カウンタ42を初期化している。例文帳に追加
In this system, the read timing generation counter 42 is initialized according to information denoting a fault in a clock system, power-on clear, Loop Back On signal, and a fault in write/read phase of the elastic stores 43, 44 or the like caused in the package. - 特許庁
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「読出し書込みカウンタ」の部分一致の例文検索結果
該当件数 : 10件
複数のメモリバンクのそれぞれに対応して設けられた複数のアドレスカウンタおよび複数のタイミング発生回路と、複数のメモリバンクに共通に設けられた読出し用データバスおよび書込み用データバスと、読出し用データバスに接続されたデータ出力バッファと、書込み用データバスに接続されたデータ入力バッファとを設ける。例文帳に追加
This device is provided with plural address counters and plural timing generating circuits, provided corresponding to each of plural memory banks, a data bus for read-out and a data bus for write-in provided commonly for plural memory banks, a data output buffer connected to the data bus for read-out, and a data input buffer connected to the data bus for write-in. - 特許庁
書き込み要求信号及びリード要求信号を発生するUP/DOWNカウンタに依存することなく、メモリ残量を管理できるようにすると共に、書込み動作及び読出し動作を高速化及び、当該装置を低廉化できるようにする。例文帳に追加
To manage the remaining capacity of a memory without depending upon an UP/DOWN counter which generates a write request signal and a read request signal and to make writing operation and reading operation fast and a relevant device inexpensive. - 特許庁
書込みカウンタレジスタ11はデータがメモリ9に書込まれる際の書込アドレスを生成し、読出カウンタレジスタ12はデータがメモリから読出される際の読出クロックに同期した読出アドレスを読出クロックにあらゆる速度差で非同期な書込クロックに同期させた読出しアドレスを出力する。例文帳に追加
A write counter register 11 generates a write address when the data are written to the memory 9 and a read counter register 12 outputs a read address for which the read address synchronized with the read clock when the data are read from the memory is synchronized with the write clock asynchronous with the read clock at any speed difference. - 特許庁
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read/write counter
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